[发明专利]微处理器、用于控制装置的系统和设备有效
申请号: | 200780100966.0 | 申请日: | 2007-10-04 |
公开(公告)号: | CN101821683A | 公开(公告)日: | 2010-09-01 |
发明(设计)人: | 雷·马歇尔;迈克·加勒德;杰夫·勒利格 | 申请(专利权)人: | 飞思卡尔半导体公司 |
主分类号: | G05B19/042 | 分类号: | G05B19/042 |
代理公司: | 中原信达知识产权代理有限责任公司 11219 | 代理人: | 穆德骏;陆锦华 |
地址: | 美国得*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 微处理器 用于 控制 装置 系统 设备 | ||
技术领域
本发明涉及微处理器、控制系统和包括控制系统的设备。
背景技术
许多硬实时控制系统需要精确地控制致动器,以控制设备或者机 械的处理。例如,需要通过在临界时间接通和断开,或者将机器旋转 的一定角度,或者以特定的电压或者电流来对这些致动器进行精确地 管理。
已知其中使用模拟专用集成电路的控制系统,通常,其提供了快 速、因此更精确的控制环,那些控制系统昂贵和不灵活,因为它们不 能被重新配置来执行在另一个应用中的另一个功能。
从美国专利5233573已知一种微控制器,其包含数字定时器设备和 中央处理单元(CPU)。所述数字定时器设备接收外部信号。在所述外 部信号的转换后,由恒频时钟信号驱动的自由运转的计数器的值被载 入捕获寄存器中,并且使得脉冲累加器递增。所述脉冲累加器被间隔 定时器周期性地复位。因此,可以确定在特定的时段期间的转换时间 和转换数量。CPU使用所述转换时间和转换数量来执行控制功能。
但是,这种现有技术系统的缺点是:虽然CPU灵活并且可以较为 便宜,但是CPU较慢,这使得控制缓慢和不精确。
发明内容
本发明提供了如在所附的权利要求中所述的一种微处理器、用于 控制装置的系统和设备。
在从属权利要求中给出了本发明的具体实施例。
通过以下说明的实施例,本发明的这些和其他方面将变得清楚, 并且参考以下说明的实施例来说明本发明的这些和其他方面。
附图说明
将参考附图,仅仅通过示例来说明本发明的进一步的细节、方面 和实施例。
图1是示意地示出了微处理器的实施例的示例的方框图;
图2示意地示出了燃料喷射系统的方框图;
图3示意地示出了用于控制装置的系统的实施例的示例的方框图;
图4示意地示出了一种用于控制设备的方法的示例的流程图;
图5示意地图解了图3的示例的部件的时序;
图6示意地示出了设备的实施例的示例,所述设备包括用于控制在 设备中的装置的系统。
具体实施方式
参见图1,其中示出了微处理器1的示例。微处理器1可以包括一个 或多个逻辑电路(LC)2和一个或多个定时器系统10。微处理器1可以 例如是通用微处理器。或者,微处理器1可以是微控制器(μC),诸如 用于电子稳定性控制(ESC)系统的控制器、发动机的控制系统,其中, 所述电子稳定性控制(ESC)系统用于调整诸如汽车的车辆的制动和牵 引力。可以以适合于具体实现方式的任何方式来实现微处理器1。微处 理器1可以,例如,除了逻辑电路2之外还包括输入/输出接口(I/O)5 或者其他部件,例如,通信接口、和/或协处理器、和/或模数转换器、 和/或时钟和复位产生单元、和/或电压调整器、和/或存储器4(诸如闪 速存储器、EEPROM、RAM)、和/或纠错码逻辑、和/或其他适合的部 件。
诸如存储器4、I/O 5、和定时器系统10的部件可以连接到逻辑电路 2。在图1的示例中,微处理器1例如包括内部总线3,其将逻辑电路2连 接到在微处理器中的其他部件,例如,连接到存储器4、I/O 5、和定时 器系统10。在图1的示例中,逻辑电路2使用接口20而连接到内部总线3 的输入/输出30。存储器4使用接口40连接到内部总线3的输入/输出31。 I/O 5的接口50经由总线3而连接到逻辑电路2。在图1的示例中,定时器 系统10使用接口113连接到内部总线3的输入/输出33。
微处理器1可以从所述微处理器外部的世界中接收数据,和/或向 所述微处理器外部的世界输出数据。例如,在图1中,I/O 5连接到微处 理器1的输入/输出触点51,例如,连接到用于从微处理器1外部的世界 中接收数据,和/或向微处理器1外部的世界输出数据的输入。
可以以适合于具体实现方式的任何方式来实现逻辑电路2。虽然为 了简单起见,仅仅在图1中示出了单个逻辑电路2,但是微处理器1可以 包括两个或者更多的逻辑电路,并且例如可以是多核处理器。逻辑电 路2可以例如是中央处理单元(CPU)、和/或协处理器、和/或数字信 号处理器、和/或嵌入处理器。
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