[发明专利]数据阵列选择的方法和系统有效

专利信息
申请号: 200810003699.1 申请日: 2008-01-21
公开(公告)号: CN101256471A 公开(公告)日: 2008-09-03
发明(设计)人: 雅各布·L·舍帕德;科尔特·A·劳夫林;罗伯特·A·库博 申请(专利权)人: 国际商业机器公司
主分类号: G06F3/06 分类号: G06F3/06
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 李镇江
地址: 美国*** 国省代码: 美国;US
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摘要:
搜索关键词: 数据 阵列 选择 方法 系统
【说明书】:

技术领域

发明涉及一种选择数据阵列的方法,系统和制品。

背景技术

在某些计算环境中,主机系统可以向控制单元,如IBM的企业存储服务器(ESS)传送请求,以请求ESS所管理的存储设备中的数据,其中ESS可以提供对存储设备,例如通过一个或多个逻辑路径互连的硬盘驱动器的访问。该互连的硬盘驱动器可以配置为直接访问存储设备(DASD),独立盘冗余阵列(RAID),简单盘捆绑(JBOD)等等。控制单元可以在本地存储器中保持关键性系统元数据,其中在某些情形下可能需要该关键性系统元数据来确定系统的配置。如果关键性系统元数据是损坏的(corrupted),无效的或不可用的,则控制单元可能会出现故障或不得不重新配置。关键性系统元数据可能从主机系统上隐匿起来,并且可能只能用于控制单元的操作系统。

发明内容

提供一种方法,系统和制品,其中保持耦合至存储控制器的多个数据阵列。根据预定的选择规则从所述多个数据阵列中选择数据阵列。通过将数据写入到所选择的数据阵列中,在所选择的数据阵列中冗余地存储数据。

在某些实施例中,数据阵列是RAID阵列,其中从所述多个数据阵列中选择数据阵列的步骤还包括:响应于确定了所述多个RAID阵列具有多于三个的RAID阵列,根据预定的选择规则从所述多个RAID阵列中选择三个RAID阵列。

在另外的实施例中,如果第一RAID阵列处于比第二RAID阵列更好的秩细节状态,则优先于第二RAID阵列选择第一RAID阵列用于冗余地存储数据,其中良好秩细节状态好于重建秩细节状态,其中重建秩细节状态好于暴露秩细节状态,并且其中暴露秩细节状态好于退化秩细节状态。

在其他实施例中,多个双环路将多个RAID阵列耦合至存储控制器,其中所选择的第一RAID阵列优选位于与所选择的第二RAID阵列不同的双环路中。

在更多实施例中,用于选择RAID阵列的预定选择规则基于所述多个RAID阵列驱动器类型的可靠性和性能的权重,其中如果根据权重第一RAID阵列好于第二RAID阵列,则优先于第二RAID阵列选择第一RAID阵列用于冗余地存储数据。

附图说明

现在参照附图,其中自始至终,类似的附图标记代表相应的部件:

图1图示了根据某些实施例,计算环境的方框图;

图2图示了根据某些实施例,显示优先化规则指示符数据结构的方框图;

图3图示了根据某些实施例,用于选择数据阵列的操作;

图4图示了根据某些实施例,显示根据秩细节状态的示例性优先化的方框图;

图5图示了根据某些实施例,显示RAID类型,秩细节状态,和RAID 6完全状态对RAID阵列选择的影响的方框图;

图6图示了根据某些实施例,显示RAID 6的示例性优先化的方框图;

图7图示了根据某些实施例,显示根据适配器和双环路的配置选择RAID阵列的方框图;

图8图示了其中实现实施例某些所描述方面的计算机架构的方框图。

具体实施方式

在下述描述中,对构成本发明一部分并且图解说明若干实施例的附图进行参照。应当理解其他实施例也可以使用,并且可以进行结构和操作上的变化。

图1图示了根据某些实施例,计算环境100的方框图。一个或更多主机102通过多个适配器108,向耦合至多个数据阵列如RAID阵列106的存储控制器104传送输入/输出(I/O)请求。在图1中,RAID阵列106也通过参考数字106a,106b,...106n来指示,而多个适配器108也通过参考数字108a,108b,...,108m来指示。

存储控制器104可以包括本领域已知的任何适当的计算设备,例如企业存储服务器,个人计算机,工作站,服务器,大型机,手持计算机,掌上电脑,电话设备,网络设备,等等。尽管图1显示多个数据阵列是RAID阵列106,在替代实施例中数据阵列可以包括本领域已知的任何适当的存储设备,在这里适当的存储设备可以配置为与RAID不同的,诸如DASD,JBOD等的其他配置。

主机102可以通过网络(未示出),诸如局域网(LAN),存储区域网络(SAN),广域网(WAN),无线网络等与存储控制器104进行通信。替代地,主机102可以通过总线接口,例如外设部件互联(PCI)总线或串行接口与存储控制器104进行通信。多个适配器108可以创建将RAID阵列106耦合至存储控制器104的双环路。

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