[发明专利]串联式电涌抑制系统及其方法无效
申请号: | 200810081897.X | 申请日: | 2008-05-20 |
公开(公告)号: | CN101588022A | 公开(公告)日: | 2009-11-25 |
发明(设计)人: | 廖顺安 | 申请(专利权)人: | 廖顺安 |
主分类号: | H01T4/00 | 分类号: | H01T4/00 |
代理公司: | 北京汇泽知识产权代理有限公司 | 代理人: | 张 瑾;王黎延 |
地址: | 台湾省台北县*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 串联式 抑制 系统 及其 方法 | ||
技术领域
本发明涉及电涌抑制技术领域范畴,特别涉及一种串联式电涌抑制系统及其方法。
背景技术
电涌产生来源有两个:一是自然界闪电(lightning flash)所产生的雷击电涌(stroke surge),二是电力系统开关操作时所产生的开关电涌(switchingsurge)。电涌本身具有瞬间的高电压、大电流与大能量的特性,电涌电压可高达数百千伏,电流也高达数十千安;再者,电涌波形上升时间为微秒(μS),而持续时间为数十微秒,因此不论是雷云对雷云闪电放电、雷云对地闪电放电所产生的感应电涌或电力设备本身操作所产生的开关电涌,对电子设备都具潜在的危险性。电涌入侵时会造成电子设施、电力设施、电信设施运转的不稳定,甚至误动作(感受性干扰(susceptibility interference)),严重则损坏终端组件,电子设施、电力设施、电信设施(易损性干扰(vulnerability interference))。因此,现今有许多电子设备、通信设备与电力设备都采用加装电涌吸收器,保护设备安全。
但现有的对于电涌抑制的方法,通常采用避雷管(gas tube)或金属氧化变阻器(MOV,metal oxide varistor)之类电涌抑制组件实现。且其所用技术大都是采用并联的方法,但事实上,这对于电涌放电电流仍无法有效处理,本身保护效果不佳,结果导致残存电涌电流与能量还是会进入被保护设施中,造成相当大的损害,尤其一些高价的重要设备动辄千万乃至上亿元,其上如没有妥善保护,一旦遭受电涌袭击则损失惨重,将难以估计。
因此,针对目前单纯采用电涌抑制组件无法大幅减少进入被保护设施的残存能量,及克服其并联使用上所产生的缺点,进而研发一种由能量着手方式处理电涌,即同时处理电涌电压与放电电流,且可有效降低电涌残存电压与残存能量,能达到实质抑制效果的串联式电涌抑制系统及其方法,即为本发明所欲解决的课题。
发明内容
有鉴于此,本发明的主要目的在于提供一种串联式电涌抑制系统及其方法,可有效降低电涌残存电压与残存能量,保护设备安全。
为达到上述目的,本发明提供了一种串联式电涌抑制方法,主要包括:
(1)以电涌抑制组件与抗流圈构成多层式箝位电压与储能电路,用以降低电涌的残存电压及残存能量;
(2)以该多层式箝位电压与储能电路的一边为接电端,另一边为保护端;以及
(3)以该保护端接设相连通信电路或电气设备,接电端相连对外接线;
该多层式箝位电压与储能电路,以串联方式设在对外接线与通信电路或电气设备之间,形成多层电涌吸收保护器。
本发明还提供了一种串联式电涌抑制系统,主要包括:
两条或两条以上通电线路,该每一条通电线路上具有两个或两个以上抗流圈互串相连而成;
两个或两个以上电涌抑制组件,构成多层状间隔并接设于两条或两条以上通电线路其所串接的抗流圈的相对接点上;
接电端,位设于两条或两条以上通电线路同一边的开放端;以及
保护端,位设于两条或两条以上通电线路另一边的开放端;
该保护端与通信线路相接,该接电端与外接线相连,以串联方式形成多层电涌吸收保护。
本发明进一步提供了一种串联式电涌抑制系统,主要包括:
两条或两条以上通电线路,该每一个通电线路上具有两个或两个以上抗流圈互串相连而成;
地线;
两个或两个以上电涌抑制组件,构成多层状间隔并接设于地线及两条或两条以上通电线路其所串接的抗流圈的相对接点上;
接电端,位设于地线及两条或两条以上通电线路同一边的开放端;以及
保护端,位设于该地线及两条或两条以上通电线路另一边的开放端;
该保护端与电气设备相接,该接电端与外接线相连,以串联方式形成多层电涌吸收保护。
本发明将多层式箝位电压与储能电路,以串联方式设在对外接线与通信电路或电气设备之间,而形成多层电涌吸收保护,能达到实质抑制电涌效果。更重要地是应用本发明,不但可精确推算其抑制电涌的效果,并且还可随客制要求制成符合所需的产品,故可广泛应用于各类大小通信电路及电气设备,有效防止电涌侵袭对通信电路及电气设备的损害,使设施维持正常运转,并大幅降低故障发生的机率。
附图说明
图1为本发明串联式电涌抑制系统的第一实施例的电路示意图;
图2为本发明串联式电涌抑制系统的第二实施例的电路示意图;
图3为本发明串联式电涌抑制系统的电路模块的立体示意图。
附图标记说明
电涌抑制组件1
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