[发明专利]内存数据读取系统及其方法有效
申请号: | 200810082744.7 | 申请日: | 2008-03-05 |
公开(公告)号: | CN101251830A | 公开(公告)日: | 2008-08-27 |
发明(设计)人: | 陈建洲;洪斌峰;炉启彰 | 申请(专利权)人: | 钰创科技股份有限公司 |
主分类号: | G06F13/16 | 分类号: | G06F13/16 |
代理公司: | 北京科龙寰宇知识产权代理有限责任公司 | 代理人: | 孙皓晨 |
地址: | 台湾省*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 内存 数据 读取 系统 及其 方法 | ||
1.一种内存控制系统,其特征在于:其包含有:
一控制单元,其根据一基频频率信号产生一微处理器频率信号,所述的微处理器频率信号包含至少一第一期间与至少一第二期间,且所述的第二期间小于所述的第一期间;
一储存装置,其用以储存复数个地址对应的数据;以及
一微处理器,其根据所述的微处理器频率信号在所述的第一期间输出一所述的地址,且在所述的第一期间至所述的储存装置撷取对应所述的地址的数据,并在所述的第二期间执行所述的数据指示的动作。
2.根据权利要求1记载的内存控制系统,其特征在于:所述的储存装置为一串行只读存储器、或一串行快闪只读存储器。
3.根据权利要求1记载的内存控制系统,其特征在于:所述的储存装置在所述的第一期间译码所述的微处理器输出的指令码、地址码、以读取对应所述的地址的数据。
4.根据权利要求1记载的内存控制系统,其特征在于:还包含一并列串行转换单元,所述的并列串行转换单元用以将从所述的微处理器并列输入的信号转换为串行输出的信号,且将由所述的储存装置中串行输入的数据转换为并列输出数据。
5.根据权利要求4记载的内存控制系统,其特征在于:所述的并列串行转换单元内建在所述的控制单元中。
6.根据权利要求4记载的内存控制系统,其特征在于:所述的并列串行转换单元内建在所述的微处理器中。
7.根据权利要求1记载的内存控制系统,其特征在于:所述的数据为只读存储器程序代码。
8.一种内存数据读取方法,其特征在于:其包含的步骤为:
根据一基频频率信号产生一微处理器频率信号,其中所述的微处理器频率信号包含至少一第一期间与至少一第二期间,且所述的第二期间小于所述的第一期间;以及
根据所述的微处理器频率信号在所述的第一期间输出一地址,且在所述的第一期间至一储存装置撷取对应所述的地址的数据,并在所述的第二期间执行所述的数据指示的动作。
9.根据权利要求8记载的内存数据读取方法,其特征在于:所述的储存装置为一串行只读存储器、或一串行快闪只读存储器。
10.根据权利要求8记载的内存数据读取方法,其特征在于:所述的数据为只读存储器程序代码。
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