[发明专利]传送数据无效

专利信息
申请号: 200810094084.4 申请日: 2008-04-25
公开(公告)号: CN101295241A 公开(公告)日: 2008-10-29
发明(设计)人: 约翰·W·瑞博 申请(专利权)人: 科技资产股份有限公司
主分类号: G06F9/38 分类号: G06F9/38
代理公司: 北京德琦知识产权代理有限公司 代理人: 陆弋;宋志强
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 传送 数据
【说明书】:

技术领域

发明总的来说涉及具有处理架构并进行指令处理的电计算机和数字处理系统,更具体地说,涉及用于对特别支持或进行数字传输操作的指令数据进行处理器的这类电计算机和数字处理系统。

背景技术

在计算领域,处理速度是非常期望的品质,并且对创造更快速的计算机和处理器的探索正在进行中。然而,行业中普遍认为,至少对于利用目前已知的技术来提高微处理器的速度而言,微处理器速度的极限正在迅速地被接近。因此,通过在处理器之间分担计算机任务来提高整体计算机速度的多处理器的使用,越来越受到关注。但是还通常认为,在工作量的分担中几乎不可避免地存在整体效率的一些下降。也就是说,所述多处理器的使用适用以下古老的谚语:仅仅由于一个人可以在60分钟内挖一个柱洞,并不必然得出60个人可以在1分钟内挖一个柱洞的结论。同样的道理几乎适用于任何任务的分工,处理器之间的任务分工也不例外。

当然,正在努力使计算机处理器之间的任务分担更加高效。正在研究和过程改进的正是如何分配任务的问题。本发明人在该领域的工作过程中观察到,在某些场合下,在多CPU环境中将数据从一个CPU传输到另一个CPU可能很麻烦。例如,如果必须将数据从一个CPU传输到另一个CPU,且目标CPU与源CPU之间被一个CPU隔开,则源CPU必须将该数据成一直线直接写入该CPU,然后,该CPU必须读取该数据,并将该数据写入目标CPU,然后目标CPU必须读取该数据。这种过程需要多次读操作和写操作,而且如果要传输大量的数据,则这么多的读命令和写命令可能会阻塞系统运行。

发明内容

相应地,本发明的目的是提供用于多端口读和写操作的系统及方法。

本发明的一方面提供一种计算机,该计算机包括:将该计算机连接到其它器件的多条数据路径;和具有位的寄存器,所述位可编程设置为对所述多条数据路径中的各条数据路径进行寻址,使得该计算机可以通过多条数据路径中作为所述位并发设置的基础的若干条数据路径来进行通信。该计算机可以是计算机阵列的一部分,并且所述其它器件中的至少一个也为该计算机阵列中的计算机。该计算机可以异步通信。

本发明的另一方面提供一种针对计算机传送数据的方法,该方法包括:(a)针对该计算机连接到其它器件的多条数据路径来对所述其它器件设法将所述数据写入该计算机的信号加以监视;(b)从所述其它器件中的首个器件读取所述数据;并且(c)基于具有可编程设置为对所述多条数据路径进行寻址的位的寄存器,将所述数据写入所述其它器件中的一个器件。该计算机可以是计算机阵列的一部分,并且所述其它器件中的至少一个器件也为该计算机阵列中的计算机。该计算机可以异步通信。

简言之,本发明的一个优选实施例是一计算机,该计算机具有将该计算机连接到其它器件的多条数据路径,所述其它器件通常但不一定是其它计算机。该计算机中的寄存器具有位,所述位可编程为对所述数据路径中的各条数据路径进行寻址,从而使该计算机可以通过所述数据路径中作为所述位并发设置的基础的若干条数据路径来进行通信。

简言之,本发明的另一优选实施例是一种针对计算机传送数据的方法。针对该计算机连接到其它器件的多条数据路径来对所述其它器件设法将数据写入该计算机的信号加以监视。然后,从所述其它器件中的首个器件读取数据。并且,基于具有可编程为对多条数据路径进行寻址的位的寄存器,将该数据写入另一器件。

本发明实施例的优势在于它提高了在多处理器之间的数据传输的速度,特别是当处理器被排列为多维阵列,且各处理器具有至少三条路径可以读或写数据。

本发明实施例的另一优势在于它通过在处理器之间分担任务,使多处理器的使用更为容易,从而提高了整体计算速度。

本发明实施例的又一优势在于它特别适合于被异步通信的处理器使用。

本发明实施例的再一优势在于是它在多处理器之间分担任务时减少了开销。

本发明还提供了一种计算机程序,当该计算机程序在合适的计算机上运行时,使该计算机实施根据所述本发明的另一方面的方法。该程序可以是位于载体上,所述载体可以是存贮介质或信号。该存贮介质可以是记录介质或其它例子中的存储设备。

鉴于实施本发明如这里所述的和在附图的图中所示的目前已知是实施本发明的最佳模式以及优选实施例的工业实用性的描述,本发明实施例的这些及其它目的和优势将对本领域技术人员来说将变得明显。

附图说明

本发明实施例的意图和优势将从以下结合附图的详细描述中变得明显,在附图中:

图1为根据本发明的计算机阵列的概略图;

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