[发明专利]液晶显示面板的像素结构及其制作方法有效

专利信息
申请号: 200810094619.8 申请日: 2008-04-24
公开(公告)号: CN101295114A 公开(公告)日: 2008-10-29
发明(设计)人: 林祥麟 申请(专利权)人: 友达光电股份有限公司
主分类号: G02F1/1362 分类号: G02F1/1362;H01L27/12;H01L21/84;H01L21/60
代理公司: 北京律诚同业知识产权代理有限公司 代理人: 梁挥;祁建国
地址: 台湾*** 国省代码: 中国台湾;71
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摘要:
搜索关键词: 液晶显示 面板 像素 结构 及其 制作方法
【说明书】:

技术领域

发明涉及一种液晶显示面板的像素结构及其制作方法,特别是涉及一种广视角液晶显示面板的像素结构及其制作方法。

背景技术

随着市场上对于薄型平面显示器的需求不断增加,液晶显示器已成为目前显示器的主流商品,而其中广视角液晶显示器更是现今业界研发的重点技术。请参考图1与图2。图1与图2为公知液晶显示面板的像素结构示意图,其中图1为像素结构的上视图,图2为图1的像素结构沿切线AA’的剖面示意图。如图1与图2所示,公知液晶显示面板的像素结构包括一基板10,其上定义有一开关组件区12、一显示区13与一周边区14。开关组件区12内设置有一薄膜晶体管,其包含有一半导体层,且半导体层包括一通道区16、一源极区18与一漏极区20分别设置于通道区16的两侧,以及二轻度掺杂漏极(LDD)22分别设置于源极区18与通道区16之间,以及漏极区20与通道区16之间。

半导体层上覆盖有一第一绝缘层24,且第一绝缘层24上设置有一第一图案化导电层,其中第一图案化导电层包括一扫描线26设置于周边区14内,以及一栅极28设置于开关组件区12内并与扫描线26电性连接。第一绝缘层24与第一图案化导电层上设置有一第二绝缘层30,而第二绝缘层30上设置有一第二图案化导电层。第二图案化导电层包含有一数据线32设置于周边区14内,以及一漏极连接垫34设置于开关组件区12内。第二绝缘层30与第一绝缘层24对应源极区18与漏极区20曝露出源极区18与漏极区20,借此数据线32可与源极区18电性连接,而漏极连接垫34则与漏极区20电性连接。

公知像素结构还包含有一第三绝缘层36设置于第二绝缘层30、数据线32与漏极连接垫34上,一共通电极38设置于第三绝缘层36上、一第四绝缘层40设置于共通电极38与第三绝缘层36上,以及一像素电极42设置于第四绝缘层40上并与漏极连接垫34电性连接。

然而,公知液晶显示面板的像素结构具有如下缺点。由于共通电极38与数据线32由不同层材料构成,两者之间必须借助厚度相当大的第三绝缘层36加以隔绝以避免短路,因此使得基板10上必须额外形成一层绝缘层,因而增加了制作过程复杂度并影响透光率。

若直接省去第三绝缘层36,则在第二图案化导电层(包括数据线32)形成后,接续形成的透明图案化共通电极38会与共通电极38位在同一平面,如此一来数据线32与共通电极38之间必须间隔一定的距离避免短路(short),但是相对地间隔距离过大则会牺牲开口率。

发明内容

本发明的目的在于提供一种液晶显示面板的像素结构及其制作方法,以简化像素结构及其制作流程。

为了实现上述目的,本发明提供了一种液晶显示面板的像素结构,其形成于一基板上,该基板包括一开关组件区、一显示区与一周边区。上述像素结构包括一半导体层、一第一绝缘层设置于该基板上且位于该开关组件区内、一第一图案化导电层设置于该第一绝缘层上、一第二绝缘层设置于该第一绝缘层、该栅极与该数据线上,以及一液晶驱动电极结构设置于该显示区。该半导体层包括一通道区,以及一源极区与一漏极区分别设置于该通道区的两侧。该第一绝缘层具有两开口分别曝露出该源极区与该漏极区。该第一图案化导电层包括一栅极设置于该开关组件区的该第一绝缘层上并对应该半导体层的该通道区,以及一数据线设置于该周边区的该第一绝缘层上,其中该栅极的表面具有一扫描线连接区,而该数据线的表面具有一源极连接区。该第二绝缘层具有四开口分别曝露出该源极区、该漏极区、该栅极的该扫描线连接区,以及该数据线的该源极连接区。该第二图案化导电层包括一数据线连接电极经由该第一绝缘层与该第二绝缘层的该开口电性连接该源极区与该数据线的该源极连接区、一扫描线经由该第二绝缘层的该开口电性连接该栅极的该扫描线连接区,以及一漏极连接垫经由该第一绝缘层与该第二绝缘层的该开口电性连接该半导体层的该漏极区。该液晶驱动电极结构包括一共通电极、一像素电极以及一第三绝缘层,设置该第二绝缘层上,其中该像素电极延伸至该开关组件区并借助该漏极连接垫与该漏极区电性连接。

为达上述目的,本发明还提供一种制作液晶显示面板的像素结构的方法,其包括:

提供一基板,其上定义有一开关组件区、一显示区与一周边区,该基板包括:

一半导体层,设置于该基板上且位于该开关组件区内;

一源极区与一漏极区,分别设置于该半导体层的两侧;

一第一绝缘层,设置于该基板上且覆盖该半导体层,该第一绝缘层具有两开口分别曝露出该源极区与该漏极区;

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