[发明专利]形成集成电路结构的方法有效
申请号: | 200810135794.7 | 申请日: | 2008-07-14 |
公开(公告)号: | CN101510525A | 公开(公告)日: | 2009-08-19 |
发明(设计)人: | 苏莉玲;黄震麟;潘兴强;谢静华 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768 |
代理公司: | 隆天国际知识产权代理有限公司 | 代理人: | 陈 晨 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 形成 集成电路 结构 方法 | ||
1.一种形成集成电路结构的方法,包括:
形成介电层;
在该介电层中形成开口;
进行第一沉积步骤以形成晶种层;以及
原处进行第一蚀刻步骤以薄化该晶种层的一较厚部分,且该第一蚀刻步 骤同时使该晶种层的一较薄部分增厚。
2.如权利要求1所述的形成集成电路结构的方法,其中该第一沉积步骤 包括同时的再溅镀。
3.如权利要求1所述的形成集成电路结构的方法,其中该第一蚀刻步骤 包括施加射频电源到射频线圈,其中该射频线圈沿着该集成电路结构正上方 的区域水平缠绕,且施加电源以诱发蚀刻。
4.如权利要求1所述的形成集成电路结构的方法,其中该第一沉积步骤 与该第一蚀刻步骤各自以直流溅镀、射频溅镀、偏压溅镀、磁控溅镀、或离 子金属电浆溅镀进行。
5.如权利要求1所述的形成集成电路结构的方法,在该第一蚀刻步骤 后,还包括原处进行第二沉积步骤以增加该晶种层的厚度。
6.如权利要求5所述的形成集成电路结构的方法,在该第二沉积步骤 后,还包括原处进行第二蚀刻步骤以减少该晶种层的厚度。
7.如权利要求6所述的形成集成电路结构的方法,其中该第二沉积步骤 与该第二蚀刻步骤的结果造成该晶种层的底部厚度减少。
8.如权利要求6所述的形成集成电路结构的方法,其中在该第一沉积部 分、该第一蚀刻步骤、该第二沉积步骤、及该第二蚀刻步骤之后,还包括对 该晶种层的快速沉积步骤。
9.二种形成集成电路结构的方法,包括:
提供半导体基底;
在该半导体基底上形成介电层;
在该介电层中形成开口;
毯覆式形成扩散阻障层,其中该扩散阻障层延伸进入该开口;
进行沉积-蚀刻循环,包括:
进行第一沉积步骤以在该扩散阻障层上形成晶种层;以及
原处进行第一蚀刻步骤以减少该晶种层的一较厚部分的厚度,且该第一 蚀刻步骤同时使该晶种层的一较薄部分增厚;以及
进行电镀以形成金属材料于该晶种层上,其中该金属材料填充该开口。
10.如权利要求9所述的形成集成电路结构的方法,其中该第一沉积步 骤使用第一电源进行以产生沉积效应,且其中该第一蚀刻步骤使用第二电源 进行以产生蚀刻效应。
11.如权利要求10所述的形成集成电路结构的方法,在该沉积-蚀刻循 环之前,还包括开启该第二电源并关闭该第一电源以在该扩散阻障层的一个 表面进行预清理。
12.如权利要求10所述的形成集成电路结构的方法,其中该蚀刻步骤包 括施加射频电源到射频线圈,其中该射频线圈沿着该半导体基底正上方的一 个区域缠绕,且施加第二射频电源到该半导体基底下方的一个静电固定盘。
13.如权利要求9所述的形成集成电路结构的方法,在该沉积-蚀刻循环 后,还包括至少一个额外的沉积-蚀刻循环,其中该至少一个额外的沉积-蚀 刻循环在该沉积-蚀刻循环原处进行。
14.如权利要求9所述的形成集成电路结构的方法,其中在该沉积-蚀刻 循环之后,且在该电镀之前,还包括进行快速沉积步骤。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造