[发明专利]比特解扰、比特解合并以及解第二次速率匹配方法和装置有效
申请号: | 200810149038.X | 申请日: | 2008-09-18 |
公开(公告)号: | CN101677260B | 公开(公告)日: | 2017-03-15 |
发明(设计)人: | 徐建 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | H04L1/00 | 分类号: | H04L1/00;H04L1/18;H04L12/70 |
代理公司: | 北京康信知识产权代理有限责任公司11240 | 代理人: | 尚志峰,吴孟秋 |
地址: | 518057 广*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 比特 合并 以及 第二次 速率 匹配 方法 装置 | ||
技术领域
本发明涉及通信领域,具体地,涉及一种比特解扰、比特解合并以及解第二次速率匹配方法和装置。
背景技术
根据在第三代移动通讯伙伴计划(3rd Generation partnershipproject,简称为3GPP)协议中对高速下行分组接入(High SpeedDownlink Packet Access,简称为HSDPA)所规定的内容,在硬件上实现比特解扰处理、HARQ比特解合并处理、以及解第二次速率匹配处理时,按顺序进行这三步处理,即,首先对一个传输时间间隔(Transmission Time Interval,简称为TTI)内的数据进行比特解扰,再进行HARQ比特解合并,然后对这两步处理之后的结果进行缓存,将数据保存进RAM中,最后对保存在RAM中的数据进行解第二次速率匹配。
上述处理过程的优点是控制机制简单,但需要将处理中的数据进行保存,这样会耗费过多的资源、降低数据的处理效率。
发明内容
考虑到现有技术的存在的在进行比特解扰、HARQ比特解合并、以及解第二次速率匹配的处理过程中,耗费过多的资源、降低数据的处理效率的问题而做出本发明,为此,本发明的主要目的在于提供一种比特解扰、比特解合并和解第二次速率匹配方法和装置,用以解决相关技术中的上述问题。
根据本发明的一个方面,提供一种比特解扰、比特解合并和解第二次速率匹配方法。
根据本发明的比特解扰、比特解合并和解第二次速率匹配方法包括:终端接收数据流,数据流中包括多个数据;在每个时钟内,通过根据e值判断是否对数据流进行解HARQ合并来确定进行比特解扰的数据;根据确定的数据所对应的P值对该数据进行比特解扰;对数据流中的所有数据进行比特解扰之后,对数据流进行去打孔速率匹配。
其中,根据e值判断是否对数据流进行解HARQ合并的处理具体为:在e>0的情况下,确定对数据流进行解HARQ合并;在e<0的情况下,确定不对数据流进行解HARQ合并。
在终端接收到数据流之前,该方法还包括:网络侧向终端发送数据流,并指示数据流为重传数据流或新数据流。
其中,在数据流是新数据流的情况下,在对数据流进行去打孔速率匹配之后,该方法还包括:终端保存数据流。
其中,在数据流是重传数据流的情况下,在对数据流进行去打孔速率匹配之后,该方法还包括:终端读取出之前接收的与重传数据流对应的数据流,并将重传数据流与读取的数据流合并后保存。
根据本发明的另一个方面,提供一种比特解扰、比特解合并和解第二次速率匹配装置。
根据本发明的比特解扰、比特解合并和解第二次速率匹配装置包括:接收模块,用于接收数据流,数据流中包括多个数据;解HARQ合并模块,用于在每个时钟内,通过根据e值判断是否对数据流进行解HARQ合并来确定进行比特解扰的数据;比特解扰模块,用于根据确定的数据所对应的P值对该数据进行比特解扰;速率匹配模块,用于对数据流中的所有数据进行比特解扰之后,对数据流进行去打孔速率匹配。
其中,上述装置还包括:判断模块,用于判断接收模块接收到的数据流是新数据流还是重传数据流;保存模块,在判断模块判断数据流是新数据流的情况下,用于保存新数据流。
优选地,在判断模块判断数据流是重传数据流的情况下,保存模块用于读取出之前接收的与重传数据流对应的数据流,并将重传数据流与读取的数据流合并后保存。
通过本发明的上述技术方案,通过根据e值的正负情况来对接收到的数据进行HARQ比特解合并后,再对数据进行比特解扰、解第二次速率匹配,能够减少占有的物理资源、提高数据的处理效率。
本发明的其它特征和优点将在随后的说明书中阐述,并且,部分地从说明书中变得显而易见,或者通过实施本发明而了解。本发明的目的和其他优点可通过在所写的说明书、权利要求书、以及附图中所特别指出的结构来实现和获得。
附图说明
此处所说明的附图用来提供对本发明的进一步理解,构成本申请的一部分,本发明的示意性实施例及其说明用于解释本发明,并不构成对本发明的不当限定。在附图中:
图1A是根据本发明装置实施例的比特解扰、比特解合并和解第二次速率匹配装置的结构框图;
图1B是根据本发明优选实施例的比特解扰、比特解合并和解第二次速率匹配装置的结构框图;
图2是根据本发明装置实施例的比特解扰、比特解合并和解第二次速率匹配装置具体实现的结构框图;
图3是根据本发明方法实施例的比特解扰、比特解合并和解第二次速率匹配方法的处理流程图;
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