[发明专利]声音信号处理电路无效
申请号: | 200810173696.2 | 申请日: | 2008-11-07 |
公开(公告)号: | CN101540617A | 公开(公告)日: | 2009-09-23 |
发明(设计)人: | 小渕雅宏;新籾雅士;小田岛彻 | 申请(专利权)人: | 三洋电机株式会社;三洋半导体株式会社 |
主分类号: | H04B1/04 | 分类号: | H04B1/04;H04H20/48 |
代理公司: | 北京林达刘知识产权代理事务所 | 代理人: | 刘新宇;陈立航 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 声音 信号 处理 电路 | ||
1.一种声音信号处理电路,其特征在于,具备:
保持电路,其被输入时钟信号以及与上述时钟信号相应的设定数据,并保持上述设定数据;
处理电路,其对并列输入的第一声音信号和第二声音信号中的至少任一个信号实施基于上述保持电路的上述设定数据的处理;以及
设定数据输出电路,其根据与上述时钟信号相应的上述第一声音信号,将上述时钟信号输出到上述保持电路,并且根据与上述设定数据相应的上述第二声音信号,将上述设定数据输出到上述保持电路。
2.根据权利要求1所述的声音信号处理电路,其特征在于,
上述处理电路包括:
信号处理电路,其对上述第一声音信号和上述第二声音信号中的至少任一个信号进行处理;以及
设定电路,其用于根据上述保持电路的上述设定数据对上述信号处理电路的动作进行控制。
3.根据权利要求1或2所述的声音信号处理电路,其特征在于,
上述设定数据输出电路包括:
输出电路,其能够将与上述第一声音信号的电平相应的第一输出信号、以及与上述第二声音信号的电平相应的第二输出信号输出到上述保持电路;以及
控制电路,其控制上述输出电路,使得当与上述时钟信号相应的上述第一声音信号以及与上述设定数据相应的上述第二声音信号被并列地输入到上述输出电路时,在成为一方逻辑电平的选择信号为上述一方逻辑电平的情况下,将上述第一输出信号和上述第二输出信号输出到上述保持电路,在上述选择信号为另一方逻辑电平的情况下,不将上述第一输出信号和上述第二输出信号输出到上述保持电路。
4.根据权利要求1或2所述的声音信号处理电路,其特征在于,
上述保持电路在根据上述时钟信号而输入的地址数据与规定地址数据一致的情况下保持上述设定数据,
上述设定数据输出电路根据与上述时钟信号相应的上述第一声音信号,将上述时钟信号输出到上述保持电路,并且根据与上述地址数据相应的上述第二声音信号,将上述地址数据输出到上述保持电路之后,进一步根据与上述时钟信号相应的上述第一声音信号,将上述时钟信号输出到上述保持电路,并且根据与上述设定数据相应的上述第二声音信号,将上述设定数据输出到上述保持电路。
5.根据权利要求3所述的声音信号处理电路,其特征在于,
上述保持电路在根据上述时钟信号而输入的地址数据与规定地址数据一致的情况下保持上述设定数据,
上述设定数据输出电路根据与上述时钟信号相应的上述第一声音信号,将上述时钟信号输出到上述保持电路,并且根据与上述地址数据相应的上述第二声音信号,将上述地址数据输出到上述保持电路之后,进一步根据与上述时钟信号相应的上述第一声音信号,将上述时钟信号输出到上述保持电路,并且根据与上述设定数据相应的上述第二声音信号,将上述设定数据输出到上述保持电路。
6.根据权利要求1或2所述的声音信号处理电路,其特征在于,
上述保持电路在被输入的指示信号为一方逻辑电平的情况下能够对上述设定数据进行更新,
还具备更新控制电路,该更新控制电路在与上述时钟信号相应的上述第一声音信号被输入到上述设定数据输出电路时,在成为一方逻辑电平的更新控制信号为上述一方逻辑电平的情况下,输出上述一方逻辑电平的上述指示信号,在上述更新控制信号为另一方逻辑电平的情况下,输出上述另一方逻辑电平的上述指示信号。
7.根据权利要求3所述的声音信号处理电路,其特征在于,
上述保持电路在被输入的指示信号为一方逻辑电平的情况下能够对上述设定数据进行更新,
还具备更新控制电路,该更新控制电路在与上述时钟信号相应的上述第一声音信号被输入到上述设定数据输出电路时,在成为一方逻辑电平的更新控制信号为上述一方逻辑电平的情况下,输出上述一方逻辑电平的上述指示信号,在上述更新控制信号为另一方逻辑电平的情况下,输出上述另一方逻辑电平的上述指示信号。
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