[发明专利]具有相位内插功能的时钟产生装置及其相关方法有效
申请号: | 200810184191.6 | 申请日: | 2008-12-19 |
公开(公告)号: | CN101494458A | 公开(公告)日: | 2009-07-29 |
发明(设计)人: | 林嘉亮 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | H03L7/18 | 分类号: | H03L7/18;H03L7/08;H03L7/099;H03K5/13 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 蒲迈文 |
地址: | 中国台湾新*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 具有 相位 内插 功能 时钟 产生 装置 及其 相关 方法 | ||
1.一种时钟产生装置,用以接收一输入时钟以输出一输出时钟,该装置包含有:
一相位内插控制器,用以依据该输入时钟产生一相位内插控制信号;
一相位/频率检测器,用以检测一第二参考时钟与一反馈时钟间的一相位差,并输出一相位误差信号来表示该相位差;
一回路滤波器,滤波该相位误差信号,以产生一第一控制信号;
一相位内插振荡器,用以依据该相位内插控制信号对一第一参考时钟进行相位内插以产生一相位内插信号,及依据该第一控制信号与相位内插信号以产生该输出时钟;以及
一分频电路,用以将该输出时钟进行分频,以产生该反馈时钟。
2.如权利要求1所述的时钟产生装置,还包含有:
一可变延迟模块,耦接于该相位/频率检测器,使用由一第二控制信号所控制的一延迟量来延迟该输入时钟,以产生该第二参考时钟。
3.如权利要求2所述的时钟产生装置,该可变延迟模块还包含:
一延迟控制器,用以接收该输入时钟与该输出时钟,并据以产生该第二控制信号;以及
一可变延迟单元,耦接于该相位/频率检测器与该延迟控制器,使用由该第二控制信号所控制的该延迟量来延迟该输入时钟,以产生该第二参考时钟。
4.如权利要求3所述的时钟产生装置,该延迟控制器还包含:
一混合器,用以混频该输入时钟与该输出时钟,以产生一关联信号;以及
一低通滤波器,用以滤波该关联信号,以产生该第二控制信号。
5.如权利要求2所述的时钟产生装置,还包含:
一固定延迟电路,耦接于该相位内插振荡器,用以延迟该输入时钟以产生该第一参考时钟至该相位内插振荡器。
6.如权利要求1、2、3、4或5所述的时钟产生装置,该相位内插振荡器包含:
一相位内插器,用来于该输出时钟及该第一参考时钟间施行一相位内插以产生一内插时钟,其中该第一参考时钟间具有由该相位内插控制信号所控制的一内插因子;以及
一可变延迟线,耦接于该相位内插器及该回路滤波器,依据由该第一控制信号来延迟该内插时钟,以产生该输出时钟。
7.如权利要求6所述的时钟产生装置,该相位内插器包含:
至少一第一晶体管,用以接收该输出时钟;
至少一第二晶体管,用以接收该第一参考时钟;
一共负载电路,耦接于该第一晶体管与该第二晶体管;
一偏压电路,依据该相位内插控制信号来建立该第一晶体管的一第一偏压状态及该第二晶体管的一第二偏压状态。
8.如权利要求7所述的时钟产生装置,其中该第一晶体管为一第一差动对的一部分,且该第二晶体管为一第二差动对的一部分。
9.如权利要求7所述的时钟产生装置,该偏压电路包含:
一第一电流源,耦接于该第一晶体管,用以提供一第一电流来偏压该第一晶体管;以及
一第二电流源与一开关对,依据该相位内插控制信号而提供一第二电流,来偏压该第一晶体管与该第二晶体管。
10.如权利要求6所述的时钟产生装置,该相位内插控制器包含:
一触发器,用以接收该输入时钟,并输出该相位内插控制信号;以及
一反相器链,用以接收该相位内插控制信号,并输出一重置信号来重置该触发器。
11.如权利要求1、2、3、4、或5所述的时钟产生装置,该相位内插控制器包含:
一触发器,用以接收该输入时钟,并输出该相位内插控制信号;以及
一反相器链,用以接收该相位内插控制信号,并输出一重置信号来重置该触发器。
12.一种时钟产生方法,包含有下列步骤:
依据一输入时钟产生一相位内插控制信号;
检测一第二参考时钟与一反馈时钟间的一相位差,并输出一相位误差信号来表示该相位差;
滤波该相位误差信号以产生一第一控制信号;
依据该相位内插控制信号对一第一参考时钟进行相位内插以产生一相位内插信号;
依据该第一控制信号与相位内插信号以产生一输出时钟;以及
将该输出时钟进行分频,以产生该反馈时钟。
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