[发明专利]具有IEEE1394接口的电视机及其控制接口的方法无效
申请号: | 200810217314.1 | 申请日: | 2008-11-11 |
公开(公告)号: | CN101742202A | 公开(公告)日: | 2010-06-16 |
发明(设计)人: | 林凯 | 申请(专利权)人: | 康佳集团股份有限公司 |
主分类号: | H04N5/775 | 分类号: | H04N5/775 |
代理公司: | 深圳市万商天勤知识产权事务所(普通合伙) 44279 | 代理人: | 顾光一 |
地址: | 518053 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 具有 ieee1394 接口 电视机 及其 控制 方法 | ||
技术领域本发明涉及一种具有IEEE 1394接口的电视机及其控制接口的方法。
背景技术IEEE 1394是一种成熟的数据接口,具有以下的优点:
(1)数字接口:数据能够以数字形式传输,不需数模转换,从而降低了设备的复杂性,保证了信号的质量;
(2)即使主机系统在全速工作时,IEEE 1394设备也可以随时插入或拆除;
(3)即插即用;
(4)采用读/写映射空间的结构,而不是IEEE 1212标准规定的寻址发送数据方式,对于外部电缆和底板技术规格,都有详细规定;
(5)IEEE 1394标准定义了三种传输速率:98.304Mbps,196.608Mbps,392.216Mbps;三种速率可供选择,增加了灵活性;
(6)IEEE 1394总线可适应台式个人机用户的全部I/O要求,并可以与SCSI并口(小型计算机系统接口)、RS232标准串口、IEEE 1284标准并口、Centronics接口、Apple’s Desktop Bus等接口兼容;
(7)接口设备对等(peer-to-peer),不分主从设备,都是主导者和服务者。其中有足够的智能用于连接,不需附加控制功能。如此便可不通过计算机而在两台摄像机之间直接传递数据,也可以让多台计算机共享一台摄像机;
(8)物理体积小,制造成本低,易于安装;
(9)IEEE 1394串行总线不存在专利问题;
(10)适合于家电产品。IEEE 1394的价格降低,部分原因是通过串行数据传输来达到的,它采用了简化电子电路和电缆设计。
可录液晶电视实现了可录模块完全整合在电视机内,只要外接U盘或移动硬盘,观众即可将自己喜欢的电视节目储存其中,便捷实用。在观看电视节目的时候可以边看边录;也可以在收看时对另外的频道进行录制,实现后台操作;还可以预约时间,在上班或深夜的时候定时自动录制,将精彩画面留住。液晶显示器已经非常普及,但是作为传输速度比较快的1394接口,现在的可录液晶电视还没有支持。
发明内容本发明的目的在于公开一种具有1394接口的电视机及其控制接口的方法,便于电视机和其它设备或者存储器之间快速传送电视节目或者其它影音数据。
本发明公开了一种具有IEEE1394接口的电视机,具有主CPU芯片,所述IEEE 1394标准接口进一步包括1394插座、物理层芯片和链路层芯片;所述1394接口插座、物理层芯片、链路层芯片和主CPU依次电连接,实现8位TS流数据的双向传送;在接口设备不是根节点,也没有发生自标识结束中断时,当SlefHDend=1,开启INTO中断,处理一帧图像数据。
本发明开公开了一种具有IEEE1394接口的电视机控制接口的方法,所述电视机具有主CPU芯片,所述IEEE1394接口进一步包括1394插座、物理层芯片和链路层芯片,其特征在于,所述1394接口插座、物理层芯片、链路层芯片和主CPU依次电连接,实现8位TS流数据的双向传送;所述控制接口的方法包括如下步骤:当监测到所述接口已经接入电缆时,第一步,监控接口设备是否为根节点,否则进入下一步;第二步,监控是否发生自标识结束中断,否则进入下一步;第三步,监控是否SlefHDend=1,是则开启INTO中断,处理一帧图像数据。
所述第一步中,监控设备是否根节点,如果是则强制所述电视机为根节点,直至所述设备不是根节点,进入下一步;所述第二步中,监测是否发生自标识结束中断,否则继续监测是否SlefHDend=1,是则在监测是否SlefHDend=1之前顺序执行如下步骤:(1)清除自标识中断位,(2)读取自标识请求包,(3)构造双字应答包和发送配置只读存储器,(4)判断GRF是否已经读空?否则回到(2)读自标识请求包,直至GRF已经读空,(5)设SlefHDend=1;然后监测是否SlefHDend=1,否则回到所述第二步的起始步骤;直至SlefHDend=1,进入下一步。
本发明公开的具有IEEE1394接口的电视机及其控制接口的方法,还包括如下从属技术特征:
所述1394接口插座的tpa和tpb脚直接连接到物理层芯片的tpa和tpb脚;物理层芯片的D0-D78位数据接口、时钟clk脚、请求lreq脚、和使能lkon脚分别对应连接到链路层芯片;链路层芯片的D0-D78位数据接口、帧同步脚Fsync、时钟脚Clk、同步脚Sync和数据有效脚Val对应连接到所述主CPU,引线脚Irq用于控制所述主CPU中断。
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