[发明专利]一种对设备内FPGA芯片统一配置和管理的系统无效
| 申请号： | 200810241924.5 | 申请日： | 2008-12-30 |
| 公开（公告）号： | CN101485576A | 公开（公告）日： | 2009-07-22 |
| 发明（设计）人： | 蒋颂平;黄嘉熙;李春彬;兰海 | 申请（专利权）人： | 深圳市蓝韵实业有限公司 |
| 主分类号： | A61B8/00 | 分类号： | A61B8/00 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518034广东省深圳市*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 设备 fpga 芯片 统一 配置 管理 系统 | ||
1、一种对设备内FPGA芯片统一配置和管理的系统，其特征在于：包括配置和管理逻辑组件和至少一个现场可编程逻辑门阵列FPGA，所述配置和管理逻辑组件与所述现场可编程逻辑门阵列FPGA相连，所述配置和管理逻辑组件包括微处理器、非易失性存储器、复杂可编程逻辑器件CPLD，所述微处理器、所述非易失性存储器和所述复杂可编程逻辑器件CPLD相互连接，所述复杂可编程逻辑器件CPLD与所述现场可编程逻辑门阵列FPGA连接，所述配置和管理逻辑组件用于按照串行方式或并行方式配置指定的一片或多片所述现场可编程逻辑门阵列FPGA。
2、根据权利要求1所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述配置和管理逻辑组件对所述现场可编程逻辑门阵列FPGA的配置数据进行读取、更新或升级。
3、根据权利要求2所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述微处理器设置通讯接口，通过所述通讯接口与上位机进行通讯。
4、根据权利要求3所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述微处理器对所述非易失性存储器的内容进行读写或修改。
5、根据权利要求4所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述微处理器向所述复杂可编程逻辑器件CPLD发送命令并读取所述复杂可编程逻辑器件CPLD的状态值。
6、根据权利要求5所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述非易失性存储器存储所述现场可编程逻辑门阵列FGPA的配置数据和相关信息。
7、根据权利要求6所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述复杂可编程逻辑器件CPLD根据所述非易失性存储器存储的有关所述现场可编程逻辑门阵列FPGA的配置信息，读取所述非易失性存储器的数据并配置所述现场可编程逻辑门阵列FPGA。
8、根据权利要求7所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述复杂可编程逻辑器件CPLD向所述微处理器返回所述现场可编程逻辑门阵列FPGA的配置结果。
9、根据权利要求8所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述非易失性存储器设为Flash存储器或EEPROM存储器。
10、根据权利要求9所述的对设备内FPGA芯片统一配置和管理的系统，其特征在于：所述通讯接口设为USB接口。
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