[发明专利]多处理系统及方法无效

专利信息
申请号: 200880010162.6 申请日: 2008-03-26
公开(公告)号: CN101647002A 公开(公告)日: 2010-02-10
发明(设计)人: 马尔科·J·G·贝库埃;扬·W·范登布兰德 申请(专利权)人: NXP股份有限公司
主分类号: G06F9/46 分类号: G06F9/46;G06F9/48
代理公司: 北京天昊联合知识产权代理有限公司 代理人: 陈 源;张天舒
地址: 荷兰艾*** 国省代码: 荷兰;NL
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摘要:
搜索关键词: 处理 系统 方法
【权利要求书】:

1.一种多处理系统,包括:

处理执行电路(10),被用于同时执行多个处理,所述处理执行电路(10)用于发出来自处理的存取一个共享资源(16)的请求;

与所述共享资源(16)连接的接口(15);

耦合在执行电路(10)和与所述共享资源连接的接口(15)之间的共享存取电路(14),用于对请求中那些有冲突的请求进行排列,

仿真存取电路(12),用于产生信号,以便在仿真拖延时间点对处理中的至少一个处理进行拖延,所述仿真拖延时间点被选择为对仅来自所述至少一个处理的请求和/或仅来自所述至少一个处理的所述请求的定时的一个预定函数,而与对那些冲突的请求进行排列是否使得所述拖延变得必须无关。

2.根据权利要求1的多处理系统,其中所述仿真存取电路(12)包括至少一个缓存器(20,24),用于仅来自所述至少一个处理的请求或这些请求的指示,所述仿真存取电路(12)用于选择所述拖延时间点,所述拖延时间点被选择为对在所述至少一个缓存器(20,24)中指示的那些请求的仿真响应的函数。

3.根据权利要求2的多处理系统,其中仿真存取电路(12)包括一个或多个其他缓存器(24),仅用于所述请求或所述请求的指示,所述仿真存取电路(12)用于根据所述请求的优先级把请求的指示传递到所述至少一个缓存器(20)或一个或多个其他缓存器(24),并选择所述拖延时间点,该拖延时间点被选择为对同时在所述至少一个缓存器(20)和所述一个或多个其他缓存器(24)中的指示的仿真响应的函数。

4.根据权利要求1的多处理系统,其中所述仿真存取电路(12)包括响应缓存器(39),用于在一个时间缓存对于来自所述共享存取电路(14)的请求的至少一个响应,直到由所述仿真存取电路所选择的作为对仅来自所述至少一个处理的请求和/或请求的定时的另一预定函数的投送时间点为止。

5.根据权利要求1的多处理系统,包括多个仿真存取电路(12),每一个仿真存取电路(12)都用于产生信号,以便在拖延时间点对分别的处理进行拖延,所述拖延时间点被选择为对仅来自所述分别的处理的请求和/或请求的定时的一个预定函数,而与对那些冲突的请求进行排列是否使得所述拖延变得必须无关。

6.根据权利要求4的多处理系统,其中至少两个不同的仿真存取电路(12)使用相互不同的预定函数。

7.根据权利要求1的多处理系统,其中所述共享存取电路(14)用于保证对来自各个处理的最早的待决请求或最高优先级的待决请求的控制,每一控制在接收到相关请求后的一个预定时间间隔之内进行。

8.根据权利要求1的多处理系统,包括共享资源(16)。

9.根据权利要求1的多处理系统,其中所述共享资源(16)是处理所共享的存储器。

10.一种同时执行多个数据控制处理的方法,所述方法包括步骤:

发出来自所述处理的存取一个共享资源(16)的请求;

对来自不同处理的冲突请求进行排列;

选择仿真拖延时间点,所述仿真拖延时间点被选择为仅来自所述至少一个处理的请求和/或请求的定时的一个预定函数,而与对那些冲突的请求进行排列是否使得拖延变得必须无关;

使得在所选择的拖延时间点拖延所述至少一个处理。

11.根据权利要求10的方法,包括步骤:根据所述至少一个处理的输入数据的值来产生请求,使得对输入数据的请求数量取决于输入数据。

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