[发明专利]包括环形缓冲器的装置和用于向环形缓冲器分配冗余版本的方法有效
申请号: | 200880019982.1 | 申请日: | 2008-06-17 |
公开(公告)号: | CN101682486A | 公开(公告)日: | 2010-03-24 |
发明(设计)人: | 宇菲·W·布兰肯希普;T·基思·布兰肯希普;布赖恩·K·克拉松;阿吉特·尼姆巴尔克 | 申请(专利权)人: | 摩托罗拉公司 |
主分类号: | H04L1/18 | 分类号: | H04L1/18 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 穆德骏;陆锦华 |
地址: | 美国伊*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 包括 环形 缓冲器 装置 用于 分配 冗余 版本 方法 | ||
1.一种用于将冗余版本分配至环形缓冲器的方法,所述方法包括 下述步骤:
接收系统比特、第一奇偶比特块和第二奇偶比特块,其中,所述 系统比特、所述第一奇偶比特块和所述第二奇偶比特块均包括虚比特;
单独地对所述系统比特、第一奇偶比特块和第二奇偶比特块进行 块交织;
将所述第一奇偶比特块与所述第二奇偶比特块进行交错,以创建 交错的奇偶比特;
将所述交织的系统比特添加到所述交错的奇偶比特前面,以创建 环形缓冲器;
从所述环形缓冲器中删除一个或多个列,以形成缩短的环形缓冲 器;
将冗余版本定义为开始于所述缩短的环形缓冲器的特定行;
接收冗余版本以及期望比特的数目;以及
输出开始于所述冗余版本比特位置的所述数目的期望比特。
2.根据权利要求1所述的方法,进一步包括下述步骤,
将所述冗余版本定义为开始于所述缩短的环形缓冲器的列顶部。
3.根据权利要求2所述的方法,其中,所述将冗余版本定义为开 始于所述缩短的环形缓冲器的列顶部的步骤包括将冗余版本定义为开 始于所述缩短的环形缓冲器的八个列顶部的步骤。
4.根据权利要求2所述的方法,其中,所述将冗余版本定义为开 始于所述缩短的环形缓冲器的列顶部的步骤包括将冗余版本定义为开 始于所述缩短的环形缓冲器的四个列顶部的步骤。
5.根据权利要求2所述的方法,进一步包括下述步骤,
将第一冗余版本定义为开始于第σ列的顶部,其中,σ是偏移列的 数目。
6.根据权利要求2所述的方法,进一步包括下述步骤,
通过将第一冗余版本定义为开始于具有相对于所述缩短的环形缓 冲器开端的偏移的位置,来对系统比特进行打孔。
7.根据权利要求1所述的方法,其中所述输出开始于冗余版本位 置的比特的步骤包括在早于环形缓冲器末端的点绕回到环形缓冲器开 端。
8.根据权利要求1所述的方法,其中所述删除一个或多个列的步 骤包括从环形缓冲器的最后一列删除列。
9.根据权利要求1所述的方法,其中所述删除一个或多个列的步 骤包括基于floor(NIR/C)确定每段的缓冲器大小,其中,C是用于串 接传输块的段的码字的数目,通过码块分割规则被确定,并且其中, NIR是每混合自动重复请求过程的总软缓冲器大小。
10.一种用于将冗余版本分配至传输块的环形缓冲器的装置,包 括:
编码器,所述编码器输出系统比特、第一奇偶比特块和第二奇偶 比特块;
速率匹配电路,所述速率匹配电路接收所述系统比特、第一奇偶 比特块和第二奇偶比特块,并且创建具有虚比特的环形缓冲器,并且 其中,所述环形缓冲器的特定行包含冗余版本(RV)的开始点,并且 其中,所述速率匹配电路从所述环形缓冲器中删除一个或多个列,以 形成缩短的环形缓冲器,并且其中,所述速率匹配电路从特定冗余版 本开始将非虚比特从所述缩短的环形缓冲器输出至发射器;
发射电路,所述发射电路接收所述非虚比特并且发射所述非虚比 特。
11.根据权利要求10所述的装置,其中,所述缩短的环形缓冲器 的八个列顶部被定义为冗余版本的开始位置。
12.根据权利要求10所述的装置,其中,所述缩短的环形缓冲器 的四个列顶部被定义为用于冗余版本的开始位置。
13.根据权利要求10所述的装置,其中,所述缩短的环形缓冲器 包括交织的系统比特、交织和交错的第一和第二奇偶比特块。
14.根据权利要求10所述的装置,其中,所述速率匹配电路在第σ 列的顶部开始第一冗余版本,其中,σ是偏移列的数目。
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