[发明专利]用于同步、重定时的模数转换的系统和方法无效

专利信息
申请号: 200880111276.X 申请日: 2008-06-06
公开(公告)号: CN101821951A 公开(公告)日: 2010-09-01
发明(设计)人: 伊藤长秀;E·凯米拉;W·洛 申请(专利权)人: LSI公司
主分类号: H03M1/00 分类号: H03M1/00
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 金晓
地址: 美国加*** 国省代码: 美国;US
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摘要:
搜索关键词: 用于 同步 定时 转换 系统 方法
【权利要求书】:

1.一种重定时的模数转换器电路,所述电路包括: 

第一组次级交织器,其中所述第一组次级交织器包括: 

第一次级交织器,其中所述第一次级交织器包括同步于第一时钟相位的第一组比较器; 

第二次级交织器,其中所述第二次级交织器包括同步于第二时钟相位的第二组比较器; 

第二组次级交织器,其中所述第二组次级交织器包括: 

第三次级交织器,其中所述第三次级交织器包括同步于第三时钟相位的第三组比较器; 

第四次级交织器,其中所述第四次级交织器包括同步于第四时钟相位的第四组比较器;以及 

全局交织器,其中所述全局交织器至少部分基于所述第二组次级交织器的输出来选择所述第一组比较器中的一个,以及其中所述全局交织器至少部分基于所述第一组次级交织器的输出来选择所述第三组比较器中的一个。 

2.根据权利要求1所述的电路,其中所述第一次级交织器的输出和所述第二次级交织器的输出同步于所述第三时钟相位。 

3.根据权利要求2所述的电路,其中所述第三次级交织器的输出和所述第四次级交织器的输出同步于所述第一时钟相位。 

4.根据权利要求3所述的电路,其中来自所述第二组次级交织器的输出是同步于所述第一时钟相位的所述第四次级交织器的输出,以及其中来自所述第一组次级交织器的输出是同步于所述第三时钟相位的所述第二次级交织器的输出。 

5.根据权利要求1所述的电路,其中所述电路进一步包括多个参考电压,以及其中所述多个参考电压的每一个被提供至所述第一组比较器、所述第二组比较器、所述第三组比较器和所述第四组比较器中的每一组中的相应比较器。 

6.根据权利要求5所述的电路,其中所述参考电压由各个数模转换器产生,每个所述数模转换器接收不同的可编程数字值。 

7.根据权利要求6所述的电路,其中所述可编程数字值被保存在查找表中。 

8.根据权利要求1所述的电路,其中来自所述第一组比较器的输出被提供至使用所述第三时钟相位时钟控制的寄存器,以及其中由多路复用器至少部分基于来自所述第二组次级交织器的输出来选择来自所述寄存器的其中一个输出。 

9.根据权利要求8所述的电路,其中所述多路复用器是第一多路复用器,其中所述寄存器是第一寄存器,其中来自所述第二组比较器的输出被提供至使用所述第四时钟相位时钟控制的第二寄存器,以及其中由第二多路复用器至少部分基于来自所述第一多路复用器的输出来选择来自所述第二寄存器的其中一个输出。 

10.根据权利要求1所述的电路,其中来自所述第三组比较器的输出被提供至使用所述第一时钟相位时钟控制的寄存器,以及其中由多路复用器至少部分基于来自所述第一组次级交织器的输出来选择来自所述寄存器的其中一个输出。 

11.根据权利要求10所述的电路,其中所述多路复用器是第一多路复用器,其中所述寄存器是第一寄存器,其中来自所述第四组比 较器的输出被提供至使用所述第二时钟相位时钟控制的第二寄存器, 

以及其中由第二多路复用器至少部分基于来自所述第一多路复用器的输出来选择来自所述第二寄存器的其中一个输出。 

12.一种用于模数转换的方法,所述方法包括: 

使用第一组比较器执行第一组模数转换; 

使用第二组比较器执行第二组模数转换; 

使用第三组比较器执行第三组模数转换; 

使用第四组比较器执行第四组模数转换; 

至少部分基于第一寄存结果来从所述第一组模数转换中选择一个结果,以提供第一选择结果; 

至少部分基于所述第一选择结果来从所述第二组模数转换中选择一个结果,以提供第二选择结果; 

至少部分基于第二寄存结果来从所述第三组模数转换中选择一个结果,以提供第三选择结果;以及 

至少部分基于所述第三选择结果来从所述第四组模数转换中选择一个结果,以提供第四选择结果; 

寄存所述第四选择结果以提供所述第一寄存结果;以及 

寄存所述第二选择结果以提供所述第二寄存结果。 

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