[发明专利]锁频装置无效

专利信息
申请号: 200910151883.5 申请日: 2009-07-03
公开(公告)号: CN101594141A 公开(公告)日: 2009-12-02
发明(设计)人: 廖志明;陈嘉章;陈旻益 申请(专利权)人: 松翰科技股份有限公司
主分类号: H03L7/00 分类号: H03L7/00;G06F13/00
代理公司: 中科专利商标代理有限责任公司 代理人: 梁爱荣
地址: 台湾省新*** 国省代码: 中国台湾;71
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摘要:
搜索关键词: 装置
【权利要求书】:

1.一种锁频装置,其特征在于,包含:

一数字控制震荡器,用以产生一输出频率信号;以及

一比较单元,接收一保持连接信号(keep alive signal)与前述输出频率信号、及/或帧起始(start of frame)信息,且比较该保持连接信号与该输出频率信号,以产生一校正信号;及/或比较该帧起始信息与该输出频率信号,以产生该校正信号;

其中,前述数字控制震荡器根据前述校正信号来调整前述输出频率信号。

2.如权利要求1所述的锁频装置,其特征在于,前述输出频率信号为被调整至锁定一通用序列总线进行数据传输时的一预设频率。

3.如权利要求1所述的锁频装置,其特征在于,还包含一滤波单元,该滤波单元用以滤除前述保持连接信号及/或前述帧起始信息的噪声。

4.如权利要求1所述的锁频装置,其特征在于,前述数字控制震荡器为一电流控制震荡器。

5.如权利要求4所述的锁频装置,其特征在于,前述数字控制震荡器包含:

N(N为正整数)个电流源,用以产生N个大小相同或N个大小不同的电流;

N个开关,每一开关根据前述校正信号来开启(on)或关闭(off)其连接的一前述电流源;以及

至少一震荡器,根据流过前述N个开关的电流总和来产生前述输出频率信号。

6.如权利要求3所述的锁频装置,其特征在于,前述比较单元包含:

一计数器,根据前述过滤后的保持连接信号(keep alive signal)或前述帧起始(start of frame)信息来启动或停止计数,且用以在该保持连接信号或该帧的一周期内计数前述输出频率信号的频率数;以及

一第一判断单元,根据前述频率数与一预设临界值的大小来决定是否更新前述校正信号。

7.如权利要求6所述的锁频装置,其特征在于,前述比较单元还包含一第二判断单元,根据前述频率数与一预设校正范围的大小来决定是否更新前述校正信号。

8.如权利要求6所述的锁频装置,其特征在于,前述比较单元还包含一缓存单元,该缓存单元是用以储存前述频率数。

9.如权利要求1所述的锁频装置,其特征在于,前述比较单元包含:

一计数器,根据前述保持连接信号(keep alive signal)或前述帧起始(start of frame)信息来启动或停止计数,且用以在前述保持连接信号或该帧的一周期内计数前述输出频率信号的频率数目;以及

一第一判断单元,根据前述频率数与一预设临界值的大小来决定是否更新前述校正信号。

10.如权利要求9所述的锁频装置,其特征在于,前述比较单元还包含一第二判断单元,根据前述频率数与一预设校正范围的大小来决定是否更新前述校正信号。

11.如权利要求10所述的锁频装置,其特征在于,前述比较单元还包含一缓存单元,该缓存单元是用以储存前述频率数。

12.如权利要求1所述的锁频装置,其应用于通用序列总线装置中。

13.如权利要求1所述的锁频装置,其特征在于,前述保持连接信号符合USB 2.0低速度(low speed)的规范,且前述帧起始信息符合USB2.0全速度(full speed)的规范。

14.一种通用序列总线装置,其特征在于,包含:

一序列接口引擎,接收一保持连接信号(keep alive signal),及/或一帧起始(start of frame)信息且以一输出频率信号来作为该序列接口引擎的操作频率;

一数字控制震荡器,用以产生前述输出频率信号;以及

一比较单元,接收前述保持连接信号及/或该帧起始信息与前述输出频率信号,且比较该保持连接信号与该输出频率信号,以产生一校正信号;及/或比较该帧起始信息与该输出频率信号,以产生该校正信号;

其中,前述数字控制震荡器根据前述校正信号来调整前述输出频率信号。

15.如权利要求14所述的通用序列总线装置,其特征在于,前述输出频率信号被调整至锁定该通用序列总线装置进行数据传输时的一预设频率。

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