[发明专利]带有恒定误比特率的高速链路的可调整发射器功率有效
申请号: | 200910159706.1 | 申请日: | 2009-07-07 |
公开(公告)号: | CN101626352A | 公开(公告)日: | 2010-01-13 |
发明(设计)人: | A·马特维克 | 申请(专利权)人: | 英特尔公司 |
主分类号: | H04L25/02 | 分类号: | H04L25/02;G06F13/38 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 汤春龙;王丹昕 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 带有 恒定 比特率 高速 可调整 发射器 功率 | ||
技术领域
本发明涉及高速链路,并且具体地说,涉及与高速链路相关联的 功率节省。
背景技术
随着计算机的演变,它们已从简单的算术计算范围发展到用于许 多媒体和非媒体相关应用的媒体中心。因此,计算机系统经常包括许 多外围或输入/输出装置。此外,半导体工艺和计算机设计的进步使得 计算机系统能够在单个物理处理器上包括更多的晶体管和处理能力, 同时也允许多个物理处理器驻留在单个系统中。
作为集成电路及其处理能力进步的必然结果,装置之间的互连也 已提升以便为高功率组件提供适当的带宽。一个具体的示例是架构中 的组件可利用点对点链路耦合。
然而,用于这些链路的发射器经常设计为以满足极限规范准则的 功率电平操作。例如,用于物理链路,即在发射器与接收器之间的传 输线路的规范可存在,该规范定义长度和其它属性。因此,发射器经 常以高功率电平操作以确保跨最大长度传输线路的数据的适当传输; 即使实际链路/传输线路比指定最大值更短。因此,在可利用更少的功 率实现数据传输的相同准确性时,可能消耗额外的功率以确保准确的 数据传输。
发明内容
本发明的第一方面在于一种设备,包括:互连代理,包括以某个 振幅在链路上发送模式的发射器,其中所述发射器要基于与所述模式 相关联的错误率动态调整功耗。
本发明的第二方面在于一种设备,包括:发射器逻辑,以第一差 分电压在链路上发送第一数量的比特,其中第一数量的比特要与第一 置信度值相关联;以及接收器逻辑,接收指示未检测到与所述第一数 量的比特相关联的错误的无错误消息;其中响应接收所述消息,所述 发射器逻辑要按目标置信度值和所述第一置信度值的比率缩放所述 第一差分电压。
本发明的第三方面在于一种系统,包括:
第一代理,包括以第一差分电压发送训练模式的发射器逻辑;
第二代理,通过链路耦合到所述第一代理,所述第二代理包括: 接收逻辑,接收所述训练模式;错误逻辑,确定是否在所述训练模式 中检测到错误;以及发送逻辑,响应所述错误逻辑确定在所述训练模 式中未检测到错误,向所述第一代理发送无错误消息以指示在所述测 试模式期间未检测到错误;
其中响应所述第一代理接收指示在所述测试模式期间未检测到 错误的所述无错误消息,包括在所述第一代理中的发射器逻辑还要按 大于一的值将所述第一差分电压缩放成经缩放的差分电压。
本发明的第四方面在于一种方法,包括:
从发送代理以第一振幅电平将第一数量的比特发送到接收代理;
在所述接收代理处确定在所述第一数量的比特中未检测到错误;
响应确定在所述第一数量的比特中未检测到错误,将所述第一振 幅电平缩放成大于所述第一振幅电平的第二振幅电平。
附图说明
本发明通过示例描述,并不是要限于附图的图形。
图1示出包括利用点对点互连耦合到芯片组的多个处理器及耦合 到芯片组的其它可能互连(interconnects)的系统的实施例。
图2示出利用分层互连栈的双向互连架构的框图的实施例。
图3示出用于基于错误率确定最佳发射器振幅的方法的流程图的 实施例。
图4示出为发射器确定操作振幅的示范训练阶段的实施例。
具体实施方式
在下面的说明中,陈述了许多特定的细节,如特定的互连、特定 的西格马(sigma)值、特定的信号振幅及其缩放(scale)因子、测试模 式的特定类型、数量和大小等示例,以便提供本发明的详尽理解。但 是,本领域的技术人员将明白,实践本发明可无需采用这些特定细节。 在其它实例中,诸如特定的发射器和接收器逻辑、校验和以及比特错 误检测算法、互联和相关联逻辑的其它操作细节等熟知的组件或方法 未详细描述,以免不必要地混淆本发明。
本文中所述的方法和设备是用于调整发射器的振幅以优化功耗。 具体而言,调整发射器的功率主要参照诸如点对点相干互连架构等说 明性链路论述。然而,用于调整发射器功率的方法和设备并不限于此, 这是因为它们可通过诸如图1中所述任何互连等任何熟知的互连及结 合用于将发射器连接到接收器的任何其它熟知互连实现。
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