[发明专利]一种具有极小传输延时的自动整形方法及电路有效

专利信息
申请号: 200910169243.7 申请日: 2009-08-24
公开(公告)号: CN101640525A 公开(公告)日: 2010-02-03
发明(设计)人: 王乐康;李照华;符传汇;石磊;陈克勇;郭伟峰 申请(专利权)人: 深圳市明微电子股份有限公司
主分类号: H03K5/01 分类号: H03K5/01
代理公司: 北京英特普罗知识产权代理有限公司 代理人: 孙丽芳
地址: 518000广东省深圳市南山*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 具有 极小 传输 延时 自动 整形 方法 电路
【说明书】:

技术领域

发明涉及单线传输协议下,为避免级联传输的数据出现错误而进行自动 整形的领域,尤其涉及具有极小传输延时的自动整形方法及实现该方法的电路。

背景技术

在灯点显示系统中,由于每一个显示控制芯片能控制的灯点数量有限,若要 实现大规模的灯点显示系统,特别是为了节省数量庞大的并联连线,就必须将 显示控制芯片级联以此来控制更多的灯点。灯点是单色灯或者由红色,绿色和 蓝色灯组成的一个像素点。

级联的芯片需要独立地控制与其相连的灯点。数据总线(通常包括数据线, 时钟线,输出使能信号线等)逐级传输数据,这些数据用来控制灯点的显示。 如图1所示,单线传输是所有级联芯片中,数据总线最少的一种传输方式,仅 需要一条数据总线Dbus;灯点显示系统中,多个显示控制芯片级联,级联的第 一个显示控制芯片为第一级芯片101,第二个显示控制芯片为第二级芯片102, 第三个显示控制芯片为第三级芯片103,以此类推,第n个显示控制芯片为第n 级芯片,其中,n为自然数。

用于显示控制的单线传输协议是以数据总线Dbus上的某种沿信号为起始信 号。不失一般性,以上升沿为例。数据总线Dbus的上升沿到来时,通过检测高 电平的维持时间Th作为判断所传输的数据信号是数据0还是数据1的根据。假 设数据0代表高电平的维持时间Th为T0,数据1代表高电平的维持时间Th为 T1,那么,如果Th<T0,则认为传输的数据信号是数据0;如果Th>T1,则认 为传输的信号是数据1;其中,时间T1大于T0,在此,之所以在判断阈值T1 和T0之间留有一定时间间隙,是为了与在实际情况中所允许的采样误差范围相 适应。显示控制芯片的数据输入端接收到的数据DATA,以及显示控制芯片的内 部从其数据输入端读到的数据DATA_DISPLAY的时序波形图如图2所示。

当多个显示控制芯片级联时,由于多种原因而造成数据信号在芯片级联过 程中将逐级被衰减。这些原因包括:显示控制芯片内部数据传输的延时不同, 显示控制芯片内部对数据上升沿和下降沿的处理不同,显示控制芯片外部数据 总线Dbus的负载不同等。造成的衰减有可能是高电平的衰减,也有可能是低电 平的衰减,且不可控。以高电平衰减为例,由于衰减的逐级积累,如图3所示, 当级联到第n级芯片时,在第一级芯片102处为数据1的数据信号(Th>T1)逐 渐变成为数据0的数据信号(Th<T0),级联传输的数据出现了错误。

为了根除级联传输时由于信号衰减所造成的错误,可以采用自动整形技术。 自动整形技术是指将输入的代表的数据0或者数据1的数据信号,经过处理后 再输出相应的标准的数据0或者数据1的数据信号,如图4所示,当判断输入 的数据信号代表的是数据0时,则输出整形为高电平持续时间Th为T0的数据 信号,当判断输入的数据信号代表的是数据1时,则输出整形为高电平持续时 间Th为T1的数据信号。但是,因为只有当对数据信号进行采样之后,才能判 断输入的数据信号是数据0还是数据1。所以,以判断的结果作为整形电路输出 整形数据信号的依据,都会产生不必要的延时。当数据总线Dbus的上升沿到来 时,需要等待一段时间(Ts-T0)后,显示控制芯片的输出端口才向下一级显示 控制芯片输出高电平,其中,Ts代表显示控制芯片的采样时间。在现有的能自 动整形的显示控制芯片中,这段等待的时间(Ts-T0)是必须的,每经过一个显 示控制芯片,所浪费的时间与每个数据的时间长度是相当的,由于级联而累加 的浪费时间则相当可观,如图4所示,第一级芯片101输出延时为(Ts-T0),而 到第n级芯片输出延时则为n*(Ts-T0)。

发明内容

本发明的第一个目的在于解决在单线级联系统中由于自动整形所带来的输 出延时的问题,提供一种具有极小传输延时的自动整形方法。

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