[发明专利]闪存储存系统、闪存控制器与数据处理方法无效

专利信息
申请号: 200910211597.3 申请日: 2009-11-10
公开(公告)号: CN102053796A 公开(公告)日: 2011-05-11
发明(设计)人: 叶志刚 申请(专利权)人: 群联电子股份有限公司
主分类号: G06F3/06 分类号: G06F3/06;G06F12/02
代理公司: 北京同立钧成知识产权代理有限公司 11205 代理人: 刘芳
地址: 中国台湾*** 国省代码: 中国台湾;71
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摘要:
搜索关键词: 闪存 储存 系统 控制器 数据处理 方法
【权利要求书】:

1.一种闪存储存系统,包括:

一闪存芯片,具有多个实体区块并且每一所述实体区块具有多个实体地址:

一连接器,用以电性连接至一主机系统;以及

一闪存控制器,电性连接至该闪存芯片与该连接器,用以配置多个逻辑地址并且将所述逻辑地址映射至部分所述实体地址,其中该主机系统使用一档案系统来存取所述逻辑地址,并且该档案系统包括至少一档案系统空间资讯,

其中该闪存控制器识别所述逻辑地址之中的至少一已删除逻辑地址并且将该至少一已删除逻辑地址所映射的实体地址中的数据标记为无效,其中在该至少一档案系统空间资讯中,储存于该至少一已删除逻辑地址中的数据已被删除。

2.根据权利要求1所述的闪存储存系统,还包括一档案系统分析单元,

其中该档案系统分析单元配置在该主机系统中,

其中该档案系统分析单元扫描该至少一档案系统空间资讯以识别所述逻辑地址之中的至少一闲置逻辑地址,并且该闪存控制器将该至少一闲置逻辑地址识别为该至少一已删除逻辑地址。

3.根据权利要求2所述的闪存储存系统,其中该至少一档案系统空间资讯至少包括一档案配置表,并且该档案配置表记录对应每一所述逻辑地址的一链接值,

其中该档案系统分析单元依据对应每一所述逻辑地址的链接值来识别所述逻辑地址之中的该至少一闲置逻辑地址。

4.根据权利要求1所述的闪存储存系统,其中该档案系统分析单元是以一应用程序型式或一驱动程序型式配置在该主机系统中。

5.根据权利要求1所述的闪存储存系统,其中该闪存控制器扫描该至少一档案系统空间资讯以识别所述逻辑地址之中的至少一闲置逻辑地址并且将该至少一闲置逻辑地址识别为该至少一已删除逻辑地址。

6.根据权利要求5所述的闪存储存系统,其中该至少一档案系统空间资讯至少包括一档案配置表,并且该档案配置表记录对应每一所述逻辑地址的一链接值,

其中该闪存控制器依据对应每一所述逻辑地址的链接值来识别所述逻辑地址之中的该至少一闲置逻辑地址。

7.根据权利要求1所述的闪存储存系统,还包括一档案读取单元,

其中该档案读取单元配置在该主机系统中,

其中该档案读取单元依据该至少一档案系统空间资讯来从所述逻辑地址中读取未被删除的所有数据,其中该闪存控制器从该档案读取单元所读取的逻辑地址所映射的实体地址中读取未被删除的所有数据。

8.根据权利要求7所述的闪存储存系统,其中该闪存控制器记录所述逻辑地址之中未被该档案读取单元读取的至少一逻辑地址,并且将未被该档案读取单元读取的该至少一逻辑地址识别为该至少一已删除逻辑地址。

9.根据权利要求7所述的闪存储存系统,其中该闪存控制器记录所述实体地址之中至少一未被读取的实体地址,并且将该至少一未被读取的实体地址所映射的至少一逻辑地址识别为该至少一已删除逻辑地址。

10.根据权利要求7所述的闪存储存系统,其中该档案读取单元是以一应用程序型式或一驱动程序型式配置在该主机系统中。

11.一种闪存控制器,配置于一闪存储存装置中,用于管理该闪存储存装置的一闪存芯片,其中该闪存芯片具有多个实体区块,每一所述实体区块具有多个实体地址且该闪存储存装置电性连接至一主机系统,该闪存控制器包括:

一微处理器单元;

一闪存接口单元,电性连接至该微处理器单元,用以电性连接至该闪存芯片;

一主机接口单元,电性连接至该微处理器单元,用以电性连接至该主机系统;以及

一存储器管理单元,电性连接至该微处理器单元,用以配置多个逻辑地址并且将所述逻辑地址映射至部分所述实体地址,其中该主机系统使用一档案系统来存取所述逻辑地址,并且该档案系统包括至少一档案系统空间资讯,

其中该存储器管理单元识别所述逻辑地址之中的至少一已删除逻辑地址并且将该至少一已删除逻辑地址所映射的实体地址中的数据标记为无效,其中在该至少一档案系统空间资讯中,储存于该至少一已删除逻辑地址中的数据已被删除。

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