[实用新型]一种报警处理单元、探测器主机以及泄漏电缆入侵探测器有效

专利信息
申请号: 200920066403.0 申请日: 2009-01-04
公开(公告)号: CN201364632Y 公开(公告)日: 2009-12-16
发明(设计)人: 瞿国民;宋祖安;祁巍;吴自征;张海荣 申请(专利权)人: 上海申达自动防范系统工程有限公司
主分类号: G08B13/24 分类号: G08B13/24
代理公司: 上海专利商标事务所有限公司 代理人: 陈 亮
地址: 20006*** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 报警 处理 单元 探测器 主机 以及 泄漏 电缆 入侵
【说明书】:

技术领域

实用新型涉及一种泄漏电缆入侵探测器,尤其涉及一种可自动保存探测器历史报警记录并具备事件追溯功能的泄漏电缆入侵探测器。

背景技术

泄漏电缆入侵探测器是一种室外围界入侵探测设备,主要应用于银行、机场、别墅、政府机关、公安监狱、军事目标、企业仓库等重要建筑周界外围,以安全防范报警为主要目的。其浅埋地下安装的隐蔽性、电磁波立体空间防范、全天候工作的特点获得市场愈来愈多的认同。

系统由探测器主机和两根特殊加工的泄漏电缆组成。探测器主机由发射单元、接收单元、处理单元以及电源组成。

发射单元产生高频能量馈入并沿发射电缆传输,部分能量通过泄漏电缆泄缝漏入空间,在被警戒空间范围内建立电磁场,其中一部分能量被安装在旁边的接收电缆接收,形成收发能量的耦合。当入侵者进入这两根电缆形成的感应区内时,这部分电磁能量受到扰动,引起接收信号的变化,这个变化的信号经放大处理后被检测出来,并推动报警指示灯点亮和打开继电器触点。中心控制室通过继电器接点传来的变位状态推动报警音响。

目前的同类产品属非智能型,报警事件现行有效,一旦报警线路或中控室出现异常情况,极有可能出现漏报现象,而事后又无法追溯。

实用新型内容

本实用新型的目的在于解决上述问题,提供了一种报警处理单元,可将报警数据保存下来。

本实用新型的另一目的在于提供了一种探测器主机,包含上述的报警处理单元。

本实用新型的又一目的在于提供了一种泄漏电缆入侵探测器,包含上述的探测器主机。

本实用新型的技术方案为:本实用新型揭示了一种报警处理单元,其中,包括:

微控制器;

存储器电路,与该微控制器连接,该微控制器对该存储器电路进行报警数据和时标数据的写入以保存;

硬时钟电路,与该微控制器连接,提供时标。

上述的报警处理单元,其中,该微控制器是ARM7控制器,该存储器电路是非易失性数据存储器,该硬时钟电路中设有独立的32.768KHz振荡器以及锂电池。

上述的报警处理单元,其中,该ARM7控制器设有GPIO引脚,控制该非易失性数据存储器的写入使能引脚,保证数据保存的可靠性。

本实用新型还揭示了一种探测器主机,包括发射单元、接收单元、报警处理单元、显示单元和电源,该接收单元、该报警处理单元和该显示单元依次连接,其中,该报警处理单元进一步包括:

微控制器;

存储器电路,与该微控制器连接,该微控制器对该存储器电路进行报警数据和时标数据的写入以保存;

硬时钟电路,与该微控制器连接,提供时标。

上述的探测器主机,其中,该微控制器是ARM7控制器,该存储器电路是非易失性数据存储器,该硬时钟电路中设有独立的32.768KHz振荡器以及锂电池。

上述的探测器主机,其中,该ARM7控制器设有GPIO引脚,控制该非易失性数据存储器的写入使能引脚,保证数据保存的可靠性。

本实用新型还揭示了一种泄漏电缆入侵探测器,包括探测器主机和泄漏电缆,其中该探测器主机包括发射单元、接收单元、报警处理单元、显示单元和电源,该接收单元、该报警处理单元和该显示单元依次连接,其中,该报警处理单元进一步包括:

微控制器;

存储器电路,与该微控制器连接,该微控制器对该存储器电路进行报警数据和时标数据的写入以保存;

硬时钟电路,与该微控制器连接,提供时标。

上述的泄漏电缆入侵探测器,其中,该微控制器是ARM7控制器,该存储器电路是非易失性数据存储器,该硬时钟电路中设有独立的32.768KHz振荡器以及锂电池。

上述的泄漏电缆入侵探测器,其中,该ARM7控制器设有GPIO引脚,控制该非易失性数据存储器的写入使能引脚,保证数据保存的可靠性。

本实用新型对比现有技术有如下的有益效果:本实用新型通过先进的ARM控制器和非易失性数据存储器自动保存探测器历史报警记录,实现事件追溯功能,填补了传统的泄漏电缆入侵探测器没有历史报警事件查询功能的空白。

附图说明

图1是本实用新型的泄漏电缆入侵探测器的较佳实施例的框图。

图2是本实用新型的报警处理单元的较佳实施例的框图。

图3是本实用新型的探测器主机的较佳实施例的框图。

图4是本实用新型的装置中的ARM7控制器的电路图。

图5是本实用新型的装置中的硬时钟电路的电路图。

图6是本实用新型的装置中的存储器电路的电路图。

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