[实用新型]一种列控中心主处理设备无效

专利信息
申请号: 200920246773.2 申请日: 2009-11-02
公开(公告)号: CN201665226U 公开(公告)日: 2010-12-08
发明(设计)人: 徐松;叶峰;何刚;漆联邦;杨光伦;谭晓光;孙可;孙永来;余学虎;王一民;侯石岩 申请(专利权)人: 北京全路通信信号研究设计院;北京新松佳和电子系统股份有限公司
主分类号: B61L27/04 分类号: B61L27/04;G05B19/042
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 逯长明;王宝筠
地址: 100073 *** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 中心 处理 设备
【说明书】:

技术领域

实用新型涉及控制系统技术领域,特别是涉及一种列控中心主处理设备。 

背景技术

在铁路系统中,列控中心是CTCS(China Train Control System,中国列车控制系统)的核心安全设备,用于根据调度命令、进路状态、线路参数等产生进路及临时限速等相关控车信息,通过有源应答器及轨道电路传送给列车。其中,列控中心系统平台包括A系统和B系统两套子系统,构成二乘二取二系统。 

其中,主处理设备是列控中心的核心设备,现有技术中,主处理设备为串行总线结构,且为集中控制板,外部接口板都为非智能控制板。所有的逻辑运算、时序控制等处理都由主处理设备来完成。因此,主处理设备的性能相对较低,处理能力富余量少。 

实用新型内容

有鉴于此,本实用新型的目的在于提供一种列控中心主处理设备,能够提高列控中心主处理设备的性能。 

为实现上述目的,本实用新型提供了如下方案: 

一种列控中心主处理设备,包括:至少两个中心处理器CPU子系统及一个外部同步时钟,各CPU子系统具有各自的CPU及工业标准体系结构ISA总线,各CPU之间具有双口随机存取存储器RAM;其中, 

所述中心处理器CPU,用于通过ISA总线从外部板卡接收数据,并对交叉比较一致的数据进行逻辑运算; 

所述双口RAM,用于对各CPU接收到的数据以及各CPU的逻辑运算结果进行交叉比较; 

所述ISA总线,用于交叉比较一致的各CPU的逻辑运算结果输出,并输出安全状态信号; 

所述外部同步时钟,用于推动输入输出各CPU的数据保持同步。 

优选的,每个CPU都集成有两路异步串口UART,其中一路异步串口UART1作为调试接口引出到面板上;另一路异步串口UART2作为备用通道连接到后母板上。 

优选的,各CPU的UART1通过光耦隔离并转变为RS232信号连接到面板插座,各CPU的UART2直接连接到后母板上。 

优选的,各CPU之间还包括同步串行接口及输入/输出信号接口,其中, 

所述同步串行接口采用双工通信模式,用于传输同步握手信号及控制信号; 

所述输入/输出信号接口用于各CPU交换工作状态。 

优选的,各CPU还各自带有实时时钟。 

优选的,还包括: 

通用输入/输出GPIO信号接口,用于与独立的通信接口单元上对应的CPU交换握手信号。 

优选的,还包括: 

CF驱动接口,用于对各CPU的程序和/或数据进行更新,各CPU共享一个CF驱动接口。 

优选的,还包括: 

电源转换模块,用于将母板输入的电源转化为所述列控中心主处理设备所需的电源。 

优选的,每个CPU子系统单独用一个电源模块;列控中心主处理设备对外通信隔离电源单独用一个电源模块。 

根据本实用新型提供的具体实施例,本实用新型公开了以下技术效果: 

本实用新型提供的列控中心主处理设备采用并行总线式结构,因此,便于外部智能控制板的接入,同时主处理设备采用外部同步时钟控制,可以实现各个板卡间的任务级同步,提高设备的可靠性和安全性。其中,接入外部智能控制板的好处在于:主处理器可以仅对外部接收到的数据进行逻辑运算及交叉比较等最核心的工作,安全监视、通信接口等功能可以由智能化的外部接口板来完成,因此,可以提高主处理器的处理性能,增加主处理设备的处理能力富余。 

附图说明

为了更清楚地说明本实用新型实施例或现有技术中的技术方案,下面将对实施例中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本实用新型的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其他的附图。 

图1是本实用新型实施例提供的列控中心主处理设备示意图; 

图2是本实用新型实施例的中心处理器结构示意图; 

图3是本实用新型实施例中异步串口接口示意图; 

图4是本实用新型实施例的中心处理器间通信示意图; 

图5是本实用新型实施例中GPIO连接示意图; 

图6是本实用新型实施例中CF卡驱动接口示意图。 

具体实施方式

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