[实用新型]一种数字视频字符叠加系统无效

专利信息
申请号: 200920247460.9 申请日: 2009-10-20
公开(公告)号: CN201557187U 公开(公告)日: 2010-08-18
发明(设计)人: 程鹏;李晶华 申请(专利权)人: 大连捷成实业发展有限公司
主分类号: H04N5/445 分类号: H04N5/445;G09G5/02;H04N9/64
代理公司: 大连东方专利代理有限责任公司 21212 代理人: 李洪福
地址: 116023 辽宁*** 国省代码: 辽宁;21
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摘要:
搜索关键词: 一种 数字视频 字符 叠加 系统
【说明书】:

技术领域

本实用新型涉及一种视频信号处理技术,特别是一种数字视频字符叠加系统。

背景技术

如图1所示,现有的数字视频字符叠加系统的字符叠加方法都是将输入的数字视频信号进行串并转换处理,然后通过控制器控制视频解码芯片将并行的数字视频信号转换为模拟视频信号(CVBS),同时控制器还要控制字符叠加芯片输出所需加字的键信号和填充信号。键信号为低电平时表示此时无加字信息,键信号为高电平时表示此时有加字信息,填充信号即为加字信号。将模拟视频信号和填充信号作为两路输入送给切换芯片,将键信号作为切换芯片的控制信号,这样在键信号为高电平时输出模拟视频信号,在键信号为低电平是输出填充信号,就实现了在视频信号上叠加字符。这种方法的不足之处在于:受到字符叠加芯片限制,叠加字符的颜色单一;不能提供数字视频信号加字。这些不足之处限制了字符叠加方法的应用,无法满足不同使用者、不同场合的需求。

发明内容

为解决现有技术存在的上述问题,本实用新型要设计一种多种字符叠加颜色和多种输出格式的数字视频字符叠加系统。

为了实现上述目的,本实用新型的技术方案如下:一种数字视频字符叠加系统包括串并转换芯片、控制器、视频解码器、字符叠加芯片,还包括FPGA处理芯片,所述的串并转换芯片与FPGA处理芯片单向连接,所述的FPGA处理芯片还分别与控制器和字符叠加芯片双向连接、并与视频解码器单向连接,所述的控制器还与字符叠加芯片单向连接。

本实用新型所述的FPGA处理芯片的功能有二个:一是根据定时基准信号第4个字包含的场消隐状态和行消隐状态信息将输入的SDI信号的行、场同步信号分离出来并传送给字符叠加芯片;二是在有填充信号时根据填充字的颜色将所对应的数据填入到数据块中形成字信号,并根据键信号来判断是输出原来的SDI信号还是字信号。

本实用新型所述的FPGA处理芯片是XC3S500E芯片。

与现有技术相比,本实用新型具有以下有益效果:

1、由于本实用新型是在数字视频信号上叠加字符,可以直接修改数据流中的Cb、Y、Cr、Y的值,该值就是用来控制亮度、颜色的,所以可以任意选择叠加字符的颜色,从而实现了多种字符叠加颜色的目的。这种方法可以满足对叠加字符颜色有要求的使用者。

2、由于本实用新型是在数字视频信号上叠加字符,叠加完字符的数字视频信号经过视频解码芯片转换为模拟视频信号输出,因此同时具有叠加字符的数字视频信号和叠加字符的模拟视频信号,这就达到了多种输出格式的要求,满足了同时需要在数字视频和模拟视频上叠加字符的使用者,拓展了字符叠加的使用范围。

附图说明

本实用新型共有附图3张,其中:

图1是现有数字视频字符叠加系统的示意图。

图2是本实用新型的数字视频字符叠加系统的示意图。

图3是定时基准信号图。

图中,1、串并转换芯片,2、FPGA处理芯片,3、视频解码器,4、控制器,5、字符叠加芯片。

具体实施方式

下面结合附图对本实用新型进行进一步地描述。如图2所示,一种数字视频字符叠加系统包括串并转换芯片1、控制器4、视频解码器3、字符叠加芯片5,还包括FPGA处理芯片2,所述的串并转换芯片1与FPGA处理芯片2单向连接,所述的FPGA处理芯片2还分别与控制器4和字符叠加芯片5双向连接、并与视频解码器3单向连接,所述的控制器4还与字符叠加芯片5单向连接。所述的FPGA处理芯片2的功能有二个:一是根据定时基准信号第4个字包含的场消隐状态和行消隐状态信息将输入的SDI信号的行、场同步信号分离出来并传送给字符叠加芯片5;二是在有填充信号时根据填充字的颜色将所对应的数据填入到数据块中形成字信号,并根据键信号来判断是输出原来的SDI信号还是字信号。所述的FPGA处理芯片2是XC3S500E芯片。

本实用新型的字符叠加方法包括以下步骤:

A、串并转换芯片1将输入的数字视频信号进行串并转换处理输出并行的数字视频信号。即将串行数据转换为10bit并行数据,视频数据字是以27兆字/秒的速率复用传送的,其顺序是:Cb、Y、Cr、Y、Cb、Y、Cr,……其中,Cb,Y,Cr这三个字指的是同址的亮度和色差信号取样,后面的Y字对应于下一个亮度取样。

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