[实用新型]一种实现MVB总线与第三方设备互连的装置有效
申请号: | 200920259946.4 | 申请日: | 2009-12-30 |
公开(公告)号: | CN201629759U | 公开(公告)日: | 2010-11-10 |
发明(设计)人: | 易伟民;罗林;肖家博 | 申请(专利权)人: | 株洲南车时代电气股份有限公司 |
主分类号: | H04L12/28 | 分类号: | H04L12/28;H04L12/40 |
代理公司: | 上海硕力知识产权代理事务所 31251 | 代理人: | 王法男 |
地址: | 412000 湖南*** | 国省代码: | 湖南;43 |
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摘要: | |||
搜索关键词: | 一种 实现 mvb 总线 第三 设备 互连 装置 | ||
技术领域
本实用新型涉及一种机车网络通讯装置,尤其是一种应用于机车车辆网络通讯,实现MVB总线与多种第三方设备的数据转换装置。
背景技术
目前在我国机车网络通讯产品中,IEC61375标准所规定的TCN(Train CommunicationNetwork的简写,即列车通讯网,目前国际标准的TCN网络标准号为IEC61375-1)网络日益占据主导地位,同时在大量的新老设备上其它通讯方式仍然会并存较长一段时间。在我国地铁、轻轨、干线机车等多个领域存在着大量的将TCN网络的MVB(multifunction vehicle bus的简写,即多功能车辆总线)总线与其它不具有MVB接口的设备进行互连的需求。例如一些设备,可能具有RS232、RS485、CAN、以太网或者并行总线接口,系统集成方需要将这些设备统一上挂到MVB网络,以便统一管理和操控。一种现有技术是芬兰EKE公司机箱式TCN产品,这种装置可以实现MVB总线与VME并行总线的数据交换。这种现有技术采用类似芬兰EKE公司的机箱式TCN产品,这种装置因为机箱结构的局限,不利于列车个体狭长、空间紧凑的安装特点,在一些车型上安装有困难,并且只能实现单独的MVB与VME数据交换。2008年4月23日公开,文献号为CN101170524A,名称为基于ARM的MVB-以太网网关的中国实用新型专利申请公开了一种基于ARM7核实现了单独的MVB与以太网数据交换的技术方案。2008年2月13日公开,文献号为CN101123592A,名称为基于ARM7核微处理器的MVB-CAN网关的中国实用新型专利申请公开了一种基于ARM7核实现单独的MVB与CAN数据交换的装置。这两种现有技术由于一个模块只能实现一种数据交换,并且由于采用的是单核CPU,在处理通讯协议栈、数据交换协议栈时,对于同时处理实时控制功能不利。另有一些未批量的产品上,已经具有RS232接口,但是仅仅将其作为调试接口而未实现RS232与MVB的数据交换。目前尚无专门的通讯产品在一个独立模块上,实现MVB与上述多种接口的数据交换。
实用新型内容
本实用新型的目的在于针对现有机车网络通讯产品的不足,提供一种实现MVB总线与多种第三方设备的数据转换装置,以达到在一个产品上实现MVB总线与多种接口的第三方设备进行数据交换,具有较广泛的接口匹配能力的目的。
按照本实用新型,上述技术问题是通过下述技术方案来实现的:
一种实现MVB总线与第三方设备互连的装置,包括CPU、MVB模块、电源模块和CPU最小系统,CPU与MVB模块相连,电源模块与CPU和MVB模块相连,该装置还包括至少两种总线通讯接口,所述总线通讯接口与CPU相连,通过CPU与MVB模块进行数据交换。
作为本实用新型进一步的实施方式,所述装置进一步包括CPLD,CPLD分别与CPU和MVB模块相连,CPLD将CPU的控制信号和地址信号进行时序调整后传递给MVB模块。
作为本实用新型进一步的实施方式,所述装置进一步包括AMS总线接口,所述AMS总线接口通过CPLD进而与CPU相连,完成AMS并行总线通信。从而使得我国铁路大量使用的基于AMS总线的机箱式产品也能连入MVB网络,极大拓展了MVB网络的应用范围。
作为本实用新型进一步的实施方式,所述装置进一步包括以太网络接口电路,所述以太网络接口电路与CPU相连;所述装置进一步包括RS232接口电路,所述RS232接口电路与CPU相连;所述装置进一步包括RS485接口电路,所述RS485接口电路与CPLD相连;所述装置进一步包括CAN总线接口电路,所述CAN总线接口电路与CPLD相连。这样做能在一个装置上实现MVB总线与多种接口的数据交换,使得本实用新型所述的装置具有较广泛的接口匹配能力。
作为本实用新型进一步的实施方式,所述CPU包括两个内核,其中一个内核执行总线通讯与数据交换功能,另一个内核执行实时控制功能。这样可在实现总线通讯、数据转换的同时,很好地完成数据通讯的实时控制功能。
作为本实用新型进一步的实施方式,所述装置包括SDRAM和FLASH,SDRAM与CPU相连,作为程序的运行空间,FLASH分别与CPU、CPLD和MVB模块相连,作为程序的存储空间。
作为本实用新型进一步的实施方式,所述MVB模块包括MVB通讯控制器,MVB通讯存储器和缓冲器,MVB通讯控制器分别与MVB通讯存储器和缓冲器相连,所述缓冲器包括地址缓冲器和数据缓冲器。
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