[实用新型]信令语音采集网关有效
申请号: | 200920270616.5 | 申请日: | 2009-11-20 |
公开(公告)号: | CN201813391U | 公开(公告)日: | 2011-04-27 |
发明(设计)人: | 庞志耕 | 申请(专利权)人: | 北京五岳鑫信息技术股份有限公司 |
主分类号: | H04L12/66 | 分类号: | H04L12/66;H04Q3/00;H04L12/26 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 100085 北京市海淀区*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 语音 采集 网关 | ||
技术领域
本实用新型可广泛应用针对信令网的运行维护管理系统、增值业务系统或授权部门的合法监测系统。具体可用于七号信令网络监测、基于信令监测的增值业务、话务监测、移动传输网络优化,提供STM-1接口。
背景技术
随着通信技术的不断发展,通信网络日益复杂。信令是通信网的神经,支撑和控制着通信网的正常运行。七号信令是目前国内最主要的局间信令,在固定网、移动网上都得到了广泛采用。七号信令系统是数字通信网中采用最多的公共信道信号技术,随着七号信令的普及,七号信令的业务量不断增加,特别是在移动信令网上,原有64kbps信令链路已经不能完全适应业务量增长的需求;目前,我们公司已有的嵌入式多通道信令采集设备已经能解决以上问题,但是当前的信号传输方式已经扩展到利用光纤,信号在光纤中传输的优势非常明显,并且光纤网络覆盖面越来越广,应该充分利用。
发明内容
为了克服现有信令采集系统容量小,扩展性差,传输速率低等不足,本实用新型的目的是提供一种信令语音采集网关,该设备采用模块化设计,单台提供最多4对155M光纤接入;设备同时对1024条64K满负荷信令通道或32条单向高速2Mbps信令链路进行采集;支持64K信令链路和高速2M信令链路的混合采集;可以对所有通道数据按接收到的时间进行排序,并将消息信令单元通过以太网口发出;同时,该设备还支持2048个通道的语音采集、叠加,并通过以太网口发出;支持多台设备堆叠使用,以获得更大容量;可同时支持多个客户端连接;采用高速DSP处理器、高性能的嵌入式CPU。
为了实现上述目的,本实用新型采用以下技术方案:一种信令语音采集网关,它主要由壳体和内置于壳体内的信令语音采集板、嵌入式处理器和双路光接口板构成;信令语音采集板固定在壳体内,嵌入式处理器通过连接器与信令语音采集板相连,处于信令语音采集板上方,双路光接口板通过侧面的连接器与信令语音采集板相连;
所述信令语音采集板的语音和信令数据处理通路由时隙交换电路、时钟同步器、现场可编程门阵列FPGA、数字信号处理DSP电路构成;双路光接口板的数据处理通路由时隙交换电路、现场可编程门阵列FPGA、收发器、SFP模块构成;时隙交换电路主要由时隙交换芯片构成;
时隙交换电路、FPGA、DSP、嵌入式处理器的地址总线、数据总线、控制总线相连;时隙交换电路中的时隙交换芯片输出码流有两个方向,一路与双路光接口板的时隙交换芯片 相连接,另一路与FPGA的串行码流输入端相连;FPGA的EDMA同步信号输出端与DSP的并行数据输入端EMIFA相连;DSP的输入/输出端EMIFB与外扩SDRAM的输入/输出端相连;DSP的输出码流MCBSP口与FPGA相连;DSP的PCI/HPI复用端口与嵌入式处理器的PCI口相连;信令语音采集板上设有两个千兆网口和一个串口;信令语音采集板通过千兆网络接口电路与计算机千兆网口相连;嵌入式处理器的调试信号通过信令语音采集板的串口与计算机串口接口电路相连。
双路光接口板的时隙交换芯片一路码流与信令语音采集板的时隙交换芯片相连,另一路与双路光接口板的FPGA相连;FPGA的另一路串行码流与收发器相连;收发器有两路串行码流分别与两个SFP模块相连。
该设备还设有SONET/SDH系统时钟同步器,主要是产生系统同步时钟给时隙交换芯片、FPGA、DSP、收发器;另外,还有一个锁相环,为收发器提供参考时钟。
所述壳体由上、下两部分组成,上、下壳体通过螺钉固定在一起;电源模块和信令语音采集板固定在下壳体上,两个千兆网口、串口、电源指示灯、系统运行指示灯以及8路光口运行指示灯设置在下壳体前面板上;下壳体后面板上是4个双路光接口板插口、电源接口和电源开关。
本实用新型的特点是:大容量,单台设备可提供4对STM-1接入,实时采集STM-1线路上的七号信令,对STM-1线路上的语音通道录音。
附图说明
图1为本实用新型电路板组成示意框图
图2为本实用新型信令语音采集板控制电路的原理框图
图3为本实用新型双路光接口板控制电路的原理框图
图4为信令语音采集板上时隙交换芯片各引脚具体连接图
图5为信令语音采集板上FPGA的A部分各引脚具体连接图
图6为信令语音采集板上FPGA的B、C部分各引脚具体连接图
图7为DSP的A部分各引脚连接图
图8为DSP的B部分各引脚连接图
图9为DSP的C、D、F三部分各引脚具体连接图
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