[发明专利]锁存电路装置的条件控制的系统和方法有效
申请号: | 200980101922.9 | 申请日: | 2009-01-09 |
公开(公告)号: | CN101911487A | 公开(公告)日: | 2010-12-08 |
发明(设计)人: | 哈里·M·拉奥;钟成;陈志勤 | 申请(专利权)人: | 高通股份有限公司 |
主分类号: | H03K3/037 | 分类号: | H03K3/037 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 刘国伟 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 电路 装置 条件 控制 系统 方法 | ||
1.一种电路装置,其包含:
用以接收复位控制信号的第一输入;
响应于锁存器的输出的第二输入;以及
逻辑电路,其适合于响应于在所述第一输入处接收到所述复位控制信号而基于所述第二输入有条件地复位所述锁存器。
2.根据权利要求1所述的电路装置,其中所述逻辑电路在所述输出的状态表示为一的值时复位所述锁存器,且当所述输出的所述状态表示零值时不复位所述锁存器。
3.根据权利要求1所述的电路装置,其中所述逻辑电路包含:
控制电路,其包括NAND门、一个或一个以上反相器及OR门;以及
晶体管,其包括耦合至所述OR门的输出的栅极端子,且响应于所述控制电路以将所述锁存器复位至已知状态。
4.根据权利要求3所述的电路装置,其中所述NAND门包括响应于所述复位控制信号的第一输入及响应于所述锁存器的所述输出的第二输入。
5.根据权利要求1所述的电路装置,其中所述锁存器包含异步锁存器装置。
6.根据权利要求1所述的电路装置,其中所述逻辑电路适合于在所述锁存器的所述输出表示不同于复位状态值的状态值时复位所述锁存器。
7.一种方法,其包含:
接收复位信号,所述复位信号指示多个锁存器的复位操作;
检测与所述多个锁存器中的每一者相关联的状态值;以及
响应于所述复位信号,基于所述检测到的状态值选择性地复位所述多个锁存器中的一些但非全部。
8.根据权利要求7所述的方法,其中所述多个锁存器中的每一者耦合至电源,且其中所述复位操作与对应电源噪声相关联。
9.根据权利要求8所述的方法,其中选择性地复位所述多个锁存器中的一些但非全部减小所述对应电源噪声。
10.根据权利要求7所述的方法,其中选择性地复位所述多个锁存器中的一些但非全部包含选择性地对所选择锁存器启用复位信号,所述所选择锁存器包括所述多个锁存器中的一些但非全部。
11.根据权利要求10所述的方法,其中所述所选择锁存器包括具有输出值的锁存器,所述输出值不同于复位值。
12.根据权利要求7所述的方法,其进一步包含:
接收第二复位信号;
检测与所述多个锁存器中的每一者相关联的第二状态值;以及
响应于接收到所述第二复位信号,基于所述检测到的第二状态值选择性地复位所述多个锁存器中的一些但非全部。
13.一种电路装置,其包含:
适合于存储数据的多个锁存电路,所述多个锁存电路中的每一者包括锁存器输出;
多个反馈路径,所述多个反馈路径中的每一者耦合至相应锁存器输出,所述相应锁存器输出与所述多个锁存电路中的相应锁存电路相关联;以及
响应于所述多个反馈路径中的每一者的逻辑电路,所述逻辑电路适合于响应于由所述多个反馈路径提供的值选择性地复位所述多个锁存电路中的一者或一者以上。
14.根据权利要求13所述的电路装置,其中所述逻辑电路适合于确定所述多个锁存电路中的每一者的输出值,且基于所述所确定的输出值有条件地复位所述多个锁存电路中的所述一者或一者以上。
15.根据权利要求13所述的电路装置,其中所述逻辑电路包含多个逻辑电路,且其中所述多个逻辑电路中的每一者耦合至所述多个锁存器中的对应锁存器的复位输入。
16.根据权利要求15所述的电路装置,其中所述多个逻辑电路中的每一逻辑电路包含用以接收复位信号的第一输入及耦合至相应反馈路径的第二输入。
17.根据权利要求13所述的电路装置,其中所述逻辑电路包括耦合至所述多个反馈路径中的相应反馈路径的至少一个逻辑门,所述逻辑电路耦合至至少一个开关装置,所述至少一个开关装置耦合至所述多个锁存电路中的每一者,其中所述逻辑门适合于当所述相应反馈路径处的值指示非复位值时有条件地激活所述至少一个开关。
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