[发明专利]用于检测差分逻辑保护的加密电路中异常的方法、以及实现所述方法的电路有效
申请号: | 200980131525.6 | 申请日: | 2009-07-30 |
公开(公告)号: | CN102124470A | 公开(公告)日: | 2011-07-13 |
发明(设计)人: | J-L·当热;S·吉耶;F·弗拉芒 | 申请(专利权)人: | 法国电信教育集团-巴黎电信学院 |
主分类号: | G06F21/02 | 分类号: | G06F21/02;G06F21/00 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 刘瑜;王英 |
地址: | 法国*** | 国省代码: | 法国;FR |
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摘要: | |||
搜索关键词: | 用于 检测 逻辑 保护 加密 电路 异常 方法 以及 实现 | ||
1.一种在由差分逻辑保护的电路中检测异常的方法,所述差分逻辑处理由一对分量(at,af)表示的逻辑变量,第一网络的单元(T)对所述对中的第一分量执行逻辑功能,第二网络的对偶单元(F)以互补逻辑对第二分量操作,所述逻辑功能由每对单元(T,F)在将所述变量置于已知状态的预充电阶段(21)对到所述单元的输入执行,随后是求值阶段(22),其中由所述单元来执行计算,所述方法特征在于,通过在所述预充电阶段期间或在所述求值阶段期间发生的至少一个不一致状态来检测异常。
2.如权利要求1所述的方法,其特征在于,由差分逻辑保护的所述电路是加密电路。
3.如前述任意一项权利要求所述的方法,其特征在于,逻辑门用于检测在所述预充电阶段期间发生的不一致状态,如果一致状态是(0,0)则该逻辑门是“或”门,或者如果所述一致状态是(1,1)则该逻辑门是“与”门。
4.如前述任意一项权利要求所述的方法,其特征在于,用于检测在所述求值阶段期间发生的不一致状态的逻辑门是“同或”门。
5.如前述任意一项权利要求所述的方法,其特征在于,多路器(35)使得能够选择通过检测到不一致状态而产生的信号(FAULT),其中,用于在所述预充电阶段(34)检测不一致状态的门的输出在所述预充电阶段被选择,用于在所述求值阶段(33)检测不一致状态的门的输出在所述求值阶段被选择,所述选择由配置信号(PRE/EVAL)来控制。
6.一种由差分逻辑保护的电路,所述差分逻辑处理由一对分量表示的逻辑变量,第一网络的单元(T)对所述对中的第一分量执行逻辑功能,第二网络的对偶单元(F)以互补逻辑对第二分量操作,所述逻辑功能由每对单元在将变量置于已知状态的预充电阶段对到所述单元的输入执行,随后是求值阶段,其中由所述单元来执行计算,所述电路特征在于,所述电路包括至少一个检测模块(47),所述检测模块(47)实现如前述权利要求中的一项所述的方法,并且所述检测模块(47)包括用于在所述预充电或所述求值阶段期间在所述电路的监控的节点处测试在所述逻辑变量的两个分量之间的不一致的模块。
7.如权利要求6所述的电路,其特征在于,所述电路是FPGA型的可编程电路。
8.如权利要求6所述的电路,其特征在于,所述电路是ASIC型的电路。
9.如权利要求6至8中的任意一项所述的电路,其特征在于,至少一个所述检测模块包括用于在所述预充电阶段期间针对来自要监控的单元的输出检测不一致状态的模块(34)。
10.如权利要求6至9中的任意一项所述的电路,其特征在于,至少一个所述检测模块包括用于在所述求值阶段期间针对来自要监控的单元的输出检测不一致状态的模块(33)。
11.如权利要求6至10中的任意一项所述的电路,其特征在于,通过链接来收集所述检测模块的输出,结果通过“或”门(53,54,63,64)被集中到至少一个等电位点(56,67)。
12.如权利要求11所述的电路,其特征在于,每个检测链的输出连接到触发器,所述触发器由时钟信号(CLK)触发,并且当该链的检测模块(51,52,61,62)中的一个检测到至少一个不一致状态时,生成值为1的全局输出(GLOBAL_FAULT)。
13.如权利要求6至10中的任意一项所述的电路,其特征在于,所述电路检测模块中的至少一部分被组织为树结构(71,72,73,74),最末检测模块(74)生成全局信号,所述全局信号指示是否已经在由所述模块监控的所述电路节点中的一个处检测到至少一个不一致状态。
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