[发明专利]电子器件用外延基板及其生产方法有效
申请号: | 200980156805.2 | 申请日: | 2009-12-14 |
公开(公告)号: | CN102318049A | 公开(公告)日: | 2012-01-11 |
发明(设计)人: | 生田哲也;清水成;柴田智彦 | 申请(专利权)人: | 同和电子科技有限公司 |
主分类号: | H01L21/338 | 分类号: | H01L21/338;C23C16/34;H01L21/205;H01L29/778;H01L29/812 |
代理公司: | 北京林达刘知识产权代理事务所(普通合伙) 11277 | 代理人: | 刘新宇;李茂家 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 电子器件 外延 及其 生产 方法 | ||
1.一种电子器件用外延基板,其包括Si单晶基板、作为绝缘层形成于所述Si单晶基板上的缓冲层和在所述缓冲层上的外延生长的多个III族氮化物层形成的主层压体,其中将外延基板的横向定义为电流传导方向,所述电子器件用外延基板的特征在于:
所述缓冲层至少包括与所述Si单晶基板接触的初期生长层和在所述初期生长层上由超晶格多层结构构成的超晶格层压体;
所述初期生长层由AlN材料制成;
所述超晶格层压体通过将由Ba1Alb1Gac1Ind1N(0≤a1≤1,0≤b1≤1,0≤c1≤1,0≤d1≤1,a1+b1+c1+d1=1)材料制成的第一层和具有与所述第一层的带隙不同的带隙的由Ba2Alb2Gac2Ind2N(0≤a2≤1,0≤b2≤1,0≤c2≤1,0≤d2≤1,a2+b2+c2+d2=1)材料制成的第二层交替层压形成;和
所述超晶格层压体和所述主层压体在所述缓冲层侧的部分均具有1×1018/cm3以上的碳浓度。
2.根据权利要求1所述的电子器件用外延基板,其中所述第一层由AlN材料制成和所述第二层由Alb2Gac2N(a2=0,0<b2≤0.5,0.5≤c2<1,d2=0)制成。
3.根据权利要求1或2所述的电子器件用外延基板,其中:
所述Si单晶基板具有1000Ω·cm以上的比电阻,和在从所述基板与所述初期生长层之间的界面至所述基板的0.1μm深度的所述Si单晶基板的部分中,III族原子总的最大浓度为1×1016/cm3以下;和
在从所述基板与所述初期生长层之间的界面至所述基板的0.3μm深度的位置处,所述Si单晶基板的III族原子的总浓度为1×1015/cm3以下。
4.一种电子器件用外延基板的生产方法,其通过在Si单晶基板上依次形成作为绝缘层的缓冲层和作为在所述缓冲层上外延生长的多个III族氮化物层的主层压体来生产,其中将外延基板的横向定义为电流传导方向,所述方法包括以下步骤:
形成所述缓冲层以至少包括与所述Si单晶基板接触的初期生长层和在所述初期生长层上的由超晶格多层结构构成的超晶格层压体;
由AlN材料形成所述初期生长层;
通过将由Ba1Alb1Gac1Ind1N(0≤a1≤1,0≤b1≤1,0≤c1≤1,0≤d1≤1,a1+b1+c1+d1=1)材料制成的第一层和具有与所述第一层的带隙不同的带隙的由Ba2Alb2Gac2Ind2N(0≤a2≤1,0≤b2≤1,0≤c2≤1,0≤d2≤1,a2+b2+c2+d2=1)材料制成的第二层交替层压形成所述超晶格层压体;和
形成所述超晶格层压体和所述主层压体在所述缓冲层侧的部分以具有1×1018/cm3以上的碳浓度。
5.根据权利要求4所述的电子器件用外延基板的生产方法,其进一步包括形成所述Si单晶基板以具有:1000Ω·cm以上的比电阻;在从所述基板与所述初期生长层之间的界面至所述基板的0.1μm深度的部分中,III族原子总的最大浓度为1×1016/cm3以下;和在从所述基板与所述初期生长层之间的界面至所述基板的0.3μm深度的位置处,III族原子的总浓度为1×1015/cm3以下。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造