[发明专利]通用存储装置无效
申请号: | 201010132744.0 | 申请日: | 2010-03-17 |
公开(公告)号: | CN101814058A | 公开(公告)日: | 2010-08-25 |
发明(设计)人: | 陈万瑶;王廷平;匡启和;肖佐楠;郑茳 | 申请(专利权)人: | 苏州国芯科技有限公司 |
主分类号: | G06F13/16 | 分类号: | G06F13/16 |
代理公司: | 苏州创元专利商标事务所有限公司 32103 | 代理人: | 马明渡 |
地址: | 215011 江苏省苏州市高*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 通用 存储 装置 | ||
技术领域
本发明涉及电子存储装置,特别涉及一种具有多种存储访问接口的通用型存储装置。
背景技术
电子存储装置是计算机系统和电子设备用来存放程序和数据的记忆设备。各种电子设备常常使用各种不同数据存储方式,如Nand Flash、Nor Flash等,在使用时需要进行坏块扫描等各种复杂操作,给用户的直接使用带来不便;电子设备中又有着各种不同的通信接口,例如USB接口、并行总线接口、SPI接口(串行设备接口)、I2C接口、SD接口等,如果需要在具有不同接口的电子设备之间进行数据的传输和转存,往往需要专门设计通信接口,或者通过转接器来实现(例如SPI接口转USB接口),带来设计上的不便以及成本上的增加。而目前的电子存储装置,比如Flash存储器,一般只具有单一USB接口,如果需要与不同接口连接要通过转接器来实现。由此可见,目前单一接口的电子存储装置存在的不足是通用性差。因此,如何设计一种具有多种存储访问接口的通用型存储装置是本发明需要解决的问题。
发明内容
本发明提供一种具有多种存储访问接口的通用存储装置,目的是要觖决目前存储装置与不同接口连接的通用性问题。
为达到上述目的,本发明采用的技术方案是:一种通用存储装置,包括Flash存储器、Flash控制器、CPU以及存储访问接口电路,CPU通过地址总线、数据总线和控制总线与Flash控制器双向连接,Flash控制器至少通过控制信号线和数据信号线与Flash存储器连接,其创新在于:
所述存储访问接口电路至少包含下列五种接口电路中的两种:
(1)USB接口以及USB接口控制器;
(2)并行总线接口以及并行总线接口控制器;
(3)SPI接口以及SPI接口控制器;
(4)I2C接口以及I2C接口控制器;
(5)SD接口以及SD接口控制器;
CPU通过地址总线、数据总线和控制总线分别与USB接口控制器、并行总线接口控制器、SPI接口控制器、I2C接口控制器和SD接口控制器双向连接;USB接口控制器与USB接口连接;并行总线接口控制器与并行总线接口连接;SPI接口控制器与SPI接口连接;I2C接口控制器与I2C接口连接;SD接口控制器与SD接口连接;
所述通用存储装置还设有一个配置模式寄存器,该配置模式寄存器设有三个用于配置模式的信号输入端口,配置模式寄存器通过地址总线、数据总线和控制总线与CPU连接。
上述技术方案中的有关内容解释如下:
1、上述方案中,SPI接口指的是串行设备接口。
2、上述方案中,所述Flash存储器可以是Nand Flash存储器,也可是Nor Flash存储器。当Flash存储器为Nand Flash存储器时,Flash控制器通过控制信号线和数据信号线与Flash存储器连接,不需要通过地址信号线连接;当Flash存储器为Nor Flash存储器时,Flash控制器通过控制信号线、数据信号线和地址信号线与Nor Flash存储器连接。
3、上述方案中,为了方便配置模式信号,可以在三个用于配置模式的信号输入端口分别配置一个开关,用于控制高电平或低电平输入。
本发明通用存储装置提供了数据存储器Flash并提供了Flash管理,为装置设计了多种常用接口,外部的数据访问请求首先通过某种接口通知该装置,该装置通过对请求的解析访问相应地址的Flash。
由于上述技术方案运用,本发明与现有技术相比具有下列优点和效果:
1、本发明通用存储装置支持USB接口、并行总线接口、SPI接口(串行设备接口)、I2C接口和SD接口,可以通过模式的配置灵活选择所要使用的接口。
2、本发明通用存储装置提供可管理的Flash存储器以及多种访问接口,使得电子设备的数据存储与访问可以直接通过该装置实现,而不需要额外的设计或者转接器,给电子设备的设计使用带来便利,并能够节约成本。
3、本发明通用存储装置以Nand/Nor Flash存储器作为存储介质,并且提供Flash管理,使用户可以透明的线性访问Flash的空间,并且通过ECC进行数据纠错,一定程度上保证了数据的可靠性。
附图说明
附图1为本发明通用存储装置结构原理图;
附图2为本发明通用存储装置内部工作流程图;
附图3为本发明通用存储装置的外部访问端控制流程图;
附图4为本发明通用存储装置中的并行总线接口信号示意图;
附图5为本发明通用存储装置中的SPI接口信号示意图;
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