[发明专利]可通过并行总线集成分布系统的单板录波器无效

专利信息
申请号: 201010186971.1 申请日: 2010-05-28
公开(公告)号: CN101886938A 公开(公告)日: 2010-11-17
发明(设计)人: 郑高群;李尚柏;周维;钟睿 申请(专利权)人: 四川大学
主分类号: G01D9/00 分类号: G01D9/00
代理公司: 成都和睿达专利代理事务所(普通合伙) 51217 代理人: 潘育敏
地址: 610064 四*** 国省代码: 四川;51
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摘要:
搜索关键词: 通过 并行 总线 集成 分布 系统 单板 录波器
【权利要求书】:

1.一种可通过并行总线集成分布系统的单板录波器,其特征在于:单板录波器上设置有并行总线;该并行总线通过总线接口与母板并行总线相连接;多个单板录波器依次对应插接到母板上构成分布集成录器装置;并行总线包括时钟总线、同步控制线与状态线、校时总线以及复位总线;所述同步控制线有7条,状态线有6条,其中,计算控制线与计算状态线、队列同步控制线与队列状态线、录波控制线与录波状态线、录值控制线与录值状态线、定值控制线与定值状态线以及令牌控制线与令牌状态线一一对应,其余一条控制线是看门狗控制线;各总线连接到母板上对应的总线控制电路;

单板录波器上集成有可编程ISP芯片,ISP芯片中烧制有同步时钟电路、译码电路和逻辑控制电路;单板录波器由前端电路、数字信号处理器DSP及外围接口电路、ARM微处理器及外围接口电路、并行总线和可编程ISP芯片几大部分组成;所述前端电路包括模拟信号调理、模数转换、光电隔离和数据锁存电路;前端电路与DSP以及ISP中的译码电路与DSP读写操作电路共同构成同步采样电路;在数字信号处理器DSP与ARM微处理器之间设计有数据同步传输电路;所述同步时钟电路产生的时钟信号与分布集成录波装置系统母板产生的时钟信号一致;同步时钟电路中包括时钟总线和同步时钟自动切换电路;

单板录波器上还设置有CF卡接口电路,网络接口电路,并集成有SPI同步串行网;同时单板录波器还通过母板集成有具有优先令牌环的RS485环网以及RS422主从网;

单板录波器通过网络交换机与远端服务器和本地工作站相连。

2.如权利要求1所述的单板录波器,其特征在于:单板录波器单独使用时不与母板连接,在单板录波器的总线插头上插接一个具有跳接线的接口板,通过跳线将单板录波器的各种控制总线与对应的状态线直接接通。

3.如权利要求1所述的单板录波器,其特征在于:所述计算控制线通过连接器接至母板上;多个子录波器的计算控制线在母板上按逻辑“或”的方式连接;计算同步控制电路由或门(9U1)及D触发器(9U7)构成,其中或门的输入分别接至各个子录波器经过自动切换电路后的计算控制线,其输出接至D触发器(9U7)的D端,D触发器输出则分别接至各子录波器插槽的计算状态线;

所述录值控制线与状态线,录波控制线与状态线以及定值控制线与状态线3对一一对应的控制线与状态线通过连接器接至母板上,然后分组按逻辑“或”的方式连接;录值、录波及定值控制电路由或门及D触发器组成,录值控制电路由或门(9U2)及D触发器(9U8)组成,录波控制电路由或门(9U3)及D触发器(9U9)组成,定值控制电路由或门(9U4)及D触发器(9U10)组成;(9U2)、(9U3)及(9U4)的输入分别来自各个子录波器经过自动切换电路后的录值控制线、录波控制线及定值控制线,D触发器(9U8)、(9U9)及(9U10)的输出则分别接至各个子录波器插槽的录值状态线、录波状态线及定值状态线;

所述队列同步控制电路由与子录波器插槽一一对应的8个2选1多路开关(0U11)-(7U11)所构成的优先自动切换链路及与门(9U6)组成;其中各个多路开关的A输入端均接至子录波器经过自动切换电路后的队列同步控制线,而B输入端则接至下一个子录波器所对应的多路开关的输出端Z;多路开关0U11的输出端Z作为优先自动切换链路的控制输出,直接接至与门(9U6),(9U6)的输出即为系统的队列同步状态线;链路中各个多路开关均受自身控制端S的控制;当母板插槽上插接有子录波器且该子录波器工作正常时,S将Z切到A,否则S将Z切到B。

4.如权利要求1所述的单板录波器,其特征在于:所述时钟总线是指由同一个4M晶振源产生、并经录波器ISP中分频电路获得的一套时钟信号,即本地时钟;同时在分布集成录波装置的母板ISP中,也有一套相同的时钟,即系统时钟;系统时钟与本地时钟被同时引入到单板录波器上自动切换电路的输入端,经过自动切换电路输出后,再经过脉宽整形电路以及延迟电路处理,最终被送到单板录波器的采样电路以及数字信号处理器DSP与微处理器ARM的中断输入引脚;同步时钟自动切换电路由2选1多路开关和计数器构成。

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