[发明专利]在PCIExpress上启用基于ID的流的方法和装置有效

专利信息
申请号: 201010194859.2 申请日: 2010-05-27
公开(公告)号: CN101901205A 公开(公告)日: 2010-12-01
发明(设计)人: A·辛格豪尔;D·哈利曼 申请(专利权)人: 英特尔公司
主分类号: G06F13/42 分类号: G06F13/42
代理公司: 上海专利商标事务所有限公司 31100 代理人: 钱慰民;袁逸
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: pciexpress 启用 基于 id 方法 装置
【权利要求书】:

1.一种装置,包括:

对要在串行点对点互连端口上发送的数据包定序的存储器定序逻辑,如果第二数据包包括指示所述第二数据包是次序无关的属性标志置位并且如果所述第二数据包包括与包含在第一数据包中的ID不同的ID,则所述存储器定序逻辑用在所述第一数据包之后到达的所述第二数据包绕过迟延的第一数据包。

2.如权利要求1所述的装置,其特征在于,还包括存储器逻辑,如果所述第二数据包包括与排队发送的每个早先接收的数据包中包含的ID不同的ID,则所述存储器逻辑用在第一数据包后到达的第二数据包绕过迟延的第一数据包。

3.如权利要求1所述的装置,其特征在于,所述第二数据包包括未提交的请求数据包,并且所述第二数据包ID包括请求者ID。

4.如权利要求1所述的装置,其特征在于,所述第二数据包包括完成数据包,且所述第二数据包ID包括完成者ID。

5.如权利要求1所述的装置,其特征在于,所述ID包括数据包的首部的字节4和5。

6.如权利要求1所述的装置,其特征在于,所述第一和第二数据包均包含处于已提交请求队列中的写请求。

7.如权利要求1所述的装置,其特征在于,所述串行点对点互连是外设部件互连Express(PCI)链路,并进一步包括与PCIE链路通信耦合的处理器、系统存储器和图形加速器。

8.如权利要求1所述的装置,其特征在于,所述端口是下游端口。

9.一种装置,包括:

沿串行点对点链路传输数据包的端口;

存储要在所述端口上传输的已提交请求的数据包的第一队列;

存储要在所述端口上传输的未提交请求的数据包的第二队列;以及

如果未提交请求的首部指示所述请求是次序无关的且所述未提交请求的首部包括与第一队列中早先接收的已提交请求的请求者ID不同的请求者ID,则所述逻辑选择性地绕过来自所述第一队列的迟延的已提交请求并在所述端口上传输来自第二队列的未提交请求,所述未提交请求是在迟延的已提交请求之后接收到的。

10.如权利要求9所述的装置,其特征在于,还包括存储要在所述端口上传输的完成数据包的第三队列,如果所述完成的首部指示所述请求是次序无关的且如果所述完成的首部包括与所述第一队列中早先接收的已提交请求的请求者ID不同的完成者ID,则所述逻辑选择性地绕过来自所述第一队列的迟延的已提交请求并在所述端口上传输来自所述第三队列的所述完成,所述完成是在迟延的已提交请求之后接收到的。

11.如权利要求9所述的装置,其特征在于,还包括如果一已提交请求的首部指示所述请求是次序无关的且所述已提交请求的首部包括与迟延的已提交请求的请求者ID不同的请求者ID,则所述逻辑选择性地绕过来自所述第一队列的延迟的已提交请求并在所述端口上发送来自第一队列的已提交请求,所述请求是在迟延的已提交请求之后接收到的。

12.如权利要求9所述的装置,其特征在于,所述端口是上游端口。

13.如权利要求9所述的装置,其特征在于,还包括可通信地耦合于串行点对点链路的处理器、系统存储器和图形加速器。

14.如权利要求9所述的装置,其特征在于,还包括第二队列,用来存储与每个未提交请求数据包关联的已提交请求指针以指示存储在所述第一队列中的哪些已提交请求是在每个未提交请求数据包之前接收到的。

15.如权利要求9所述的装置,其特征在于,所述属性标志包括所述数据包首部的字节1的位2。

16.一种装置,包括:

包括包含协议栈的输入/输出(I/O)模块的设备,所述协议栈包括物理层、链路层、事务处理层,其中所述协议栈在串行点对点链路上传输数据包,所述数据包包括标志置位以指示所述操作是次序无关的。

17.如权利要求16所述的装置,其特征在于,指示所述操作是次序无关的所述标志置位包括所述数据包首部的字节1的位2。

18.如权利要求16所述的装置,其特征在于,所述操作选自组:存储器写或消息请求、读请求、I/O或配置写请求、读完成和I/O或配置写完成。

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