[发明专利]在处理器中提供用于系统管理模式的状态存储装置有效
申请号: | 201010277405.1 | 申请日: | 2010-08-31 |
公开(公告)号: | CN102004668A | 公开(公告)日: | 2011-04-06 |
发明(设计)人: | M·S·纳图;T·兰加拉詹;G·B·多希;S·M·达塔;B·加尼桑;M·J·库马尔;R·S·帕塔萨拉蒂;F·宾斯;R·N·默西;R·C·斯旺森 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F9/48 | 分类号: | G06F9/48 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 柯广华;徐予红 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 处理器 提供 用于 系统 管理模式 状态 存储 装置 | ||
技术领域
本发明涉及在处理器中提供用于系统管理模式的状态存储装置。
背景技术
大多数计算机系统处理器支持称为系统管理模式(SMM)的特殊操作模式。SMM提供对于操作系统(OS)软件透明的不同操作环境。此模式常常被原始设备制造商(OEM)用于执行例如系统管理、装置、电源和热管理的特殊任务。服务器相关的可靠性、可用性和可服务性(RAS)功能常常使用SMM来实现。通常通过向处理器发送系统管理中断(SMI)消息来进入SMM。当确认SMI时,处理器将当前处理器上下文(也称为处理器保存状态)保存到系统存储器中专门分配给SMM的部分,称为系统管理随机存取存储器(SMRAM),并且执行SMRAM中包含的SMI处理程序(handler)代码。当SMI处理程序完成其操作时,它执行特殊的(仅在SMM中有效的)恢复指令,该指令使处理器从SMRAM重新加载所保存的处理器上下文并恢复执行中断的任务。
在多处理器系统中,一般将SMI消息广播到所有处理器。SMI处理程序选择一个处理器(称为SMM主控(monarch))来处理事件。此处理器等待直到所有其他处理器会合(rendezvous)在SMM内,之后才处理SMI事件。非主控处理器保留在SMM中,直到主控完成事件处理。当处理了SMM事件时,主控将以信号通知其他处理器退出SMM。实现这种同步的进入和退出行为以阻止两个并行环境(OS与SMM)之间的任何资源冲突。即,如果一些处理器在OS环境中是活动的,而同时其余的处理器在SMM环境中是活动的,则可能的是:它们可能修改共享的资源,并由此干扰彼此的操作,从而导致系统崩溃。此外,某些SMM事件只能由特定逻辑处理器或一组逻辑处理器来处理。广播确保了此条件总是被满足,因为所有逻辑处理器都将进入SMI。
因此,多处理器系统中的SMI处理是复杂的且能消耗所有系统资源,阻止其他有用工作的处理,因为当处理器处于SMM中时,它就不可用于操作系统。
发明内容
本发明提供一种设备,包括:处理器核,执行指令并进入系统管理模式(SMM),其中当进入所述SMM时,所述处理器核将存储所述处理器核的状态存储装置中存在的活动状态到所述处理器核的存储单元中,并将通过插入与所述SMM关联的值到所述状态存储装置中来设立SMM执行环境。
本发明还提供一种方法,包括:响应系统管理中断(SMI)事件,确定处理器上执行的所有线程是否已进入系统管理模式(SMM)会合状态;以及如果否,则确定其余线程是否正在执行长流操作或处于SMI禁止的状态中,以及如果是,则使用主控线程在其余线程执行所述长流操作或处于所述SMI禁止的状态中时处理所述SMI事件,否则在处理所述SMI事件之前等待其余线程进入所述SMM会合状态。
本发明还提供一种系统,包括:第一处理器,包括执行指令和进入系统管理模式(SMM)的第一核、指示所述第一核上执行的线程是否处于长流操作中的第一指示符、指示所述线程是否处于系统管理中断(SMI)禁止的状态中的第二指示符以及存储单元,其中在进入所述SMM时,所述第一核将存储所述第一核的状态存储装置中存在的活动状态到所述存储单元中并将存储SMM执行状态到所述状态存储装置中,所述存储单元专用于在所述SMM期间存储所述活动状态;第二处理器,包括执行指令和进入所述SMM的第二核、指示所述第二核上执行的第二线程是否处于长流操作中的第一指示符、指示所述第二线程是否处于所述SMI禁止的状态中的第二指示符以及第二存储单元,其中在进入所述SMM时,所述第二核将存储所述第二核的状态存储装置中存在的活动状态到所述第二存储单元中并将存储SMM执行状态到所述状态存储装置中,所述第二存储单元专用于在所述SMM期间存储所述活动状态;以及动态随机存取存储器(DRAM),耦合到所述第一和第二处理器,其中所述DRAM的一部分是用于所述系统的系统管理随机存取存储器(SMRAM)。
附图说明
图1是根据本发明的一个实施例的处理器的框图。
图2是根据本发明的一个实施例的多处理器系统的框图。
图3是根据本发明的一个实施例的方法的流程图。
图4是根据本发明的另一个实施例的方法的流程图。
具体实施方式
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