[发明专利]LED电源控制芯片有效

专利信息
申请号: 201010290595.0 申请日: 2010-09-25
公开(公告)号: CN101977464A 公开(公告)日: 2011-02-16
发明(设计)人: 陈光德;倪端 申请(专利权)人: 陈光德;倪端
主分类号: H05B37/02 分类号: H05B37/02
代理公司: 浙江杭州金通专利事务所有限公司 33100 代理人: 赵红英
地址: 310002 浙*** 国省代码: 浙江;33
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摘要:
搜索关键词: led 电源 控制 芯片
【权利要求书】:

1.一种LED电源控制芯片,其特征在于它包括:信号测量模块、采样控制模块、通信接口、样本比较器、时钟及分频模块、芯片地址模块、易失存储器、非易失存储器、24小时循环计数器、LED并联支路断路数加法器、时间比较器、PWM模块,信号测量模块和采样控制模块相连,以建立采样的通道和获取采样数据;采样控制模块分别和样本比较器、易失存储器、PWM模块相连,样本比较器和非易失存储器相连,以和来自非易失存储器的样本数据进行比较并将所得结果保存于易失存储器,易失存储器和PWM模块相连,采样控制模块对环境亮度值与易失存储器中的所保存的当前值做比较,如果环境亮度值发生变化,采样控制模块将向PWM模块发送环境亮度变化信号;采样控制模块同时对所测量的温度值与非易失存储器中的设定值做比较,如果不在正常温度范围内,采样控制模块向PWM模块发送温度异常信号,非易失存储器和PWM模块相连,PWM模块提取存储在非易失存储器的参数,24小时循环计数器与时间比较器相连,时间比较器和非易失存储器、PWM模块相连,时间比较器用于和来自非易失存储器中的定时值进行比较,当有定时起点到或者定时终点到信号发生,时间比较器将启动与PWM模块的连接,以启动依据此条件的PWM计算;时钟分频模块与24小时循环计数器相连,芯片地址模块与易失存储器相连,将芯片地址存入其中,通信接口与易失存储器相连,以将芯片地址取回到远程主机;通信接口与24小时循环计数器相连是为了启动校正时间,通信接口与非易失存储器相连,是为了设置、修改参数或接收参数,LED并联支路断路数加法器与PWM模块、易失存储器相连,对所有的LED支路的并联断路状况做进位加法运算,如果LED并联支路出现异常,将进位加法运算结果送入易失存储器,并向PWM模块传送LED并联支路异常信号。

2.如权利要求1所述的一种LED电源控制芯片,其特征在于:所述信号测量模块包括内置芯片的3个电阻,一个是标准精密电阻RS,一个是热敏电阻RT,一个是常规电阻R,RS和R通过通断控制模块(105)与采样控制模块(106)相连,热敏电阻RT通过与选通开关(104)相连后,通过通断控制模块(105)再与采样控制模块(106)相连,三个电阻的另一端则相连在一起,与一个芯片外的电容C1相连,C1的另一端接地。

3.如权利要求2所述的一种LED电源控制芯片,其特征在于:光敏电阻RL放在芯片外,与芯片内的选通开关(104)相连后,再通过通断控制模块(105)与采样控制模块(106)相连。

4.如权利要求2所述的一种LED电源控制芯片,其特征在于:环境光电压信号V(t)通过选通开关(101)连接电阻R1,电阻R1分别与充电电容C2、比较器(102)的反相端相连、比较器(103)的同相端相连,比较器(103)的反相端接地构成一零比较器,参考电压Vf与比较器(102)的同相端相连,比较器(102)的输出连接至芯片的管脚B0,此管脚连接到采样控制模块(106),比较器(103)的输出连接至芯片的管脚B1,此管脚连接到采样控制模块(106),选通开关(101)的选通信号线通过芯片管脚B2连接到采样控制模块(106)。

5.如权利要求1或2所述的一种LED电源控制芯片,其特征在于:它还设有备用电池充电模块,备用电池充电模块与时钟分频模块相连,以获得正确的时钟。

6.如权利要求5所述的一种LED电源控制芯片,其特征在于所述备用电池充电模块:主电源VCC经电阻R2连接到比较器(201)的同相端,比较器(201)的同相端经过R3接地,比较器(201)的输出端通过电阻R4连接到三极管Q的基极,Q的发射极通过二极管D2向电池BT充电,Q的集电极通过二极管D1与主电源VCC相连,Q的发射极通过电容C3与地相连,Q的发射极与电阻R6相连,然后通过R7与地相连,Q的基极通过电阻R5与地相连,Q的发射极与电阻R6相连,然后连接到比较器(201)的反相端抑获取反馈信号。

7.如权利要求1或2所述的一种LED电源控制芯片,其特征在于所述芯片地址模块具有4个地址编程管脚A0~A3,4个地址编程管脚A0~A3分别连接到芯片地址模块(301),芯片地址模块的根据4个编程引脚可以确定芯片地址,4个地址编程管脚A0~A3通过接电源VCC和接地的组合可以构成0地址除外的15个不同的地址,可以实现最大由15颗芯片构成主机芯片结构网络。

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