[发明专利]电脑系统及电脑系统的开机方法无效
申请号: | 201010293666.2 | 申请日: | 2010-09-27 |
公开(公告)号: | CN102419719A | 公开(公告)日: | 2012-04-18 |
发明(设计)人: | 殷吉志;范存辉 | 申请(专利权)人: | 鸿富锦精密工业(深圳)有限公司;鸿海精密工业股份有限公司 |
主分类号: | G06F11/14 | 分类号: | G06F11/14;G06F9/445 |
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地址: | 518109 广东省深圳市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 电脑 系统 开机 方法 | ||
1.一种电脑系统,包括CPU、基板管理控制器及主BIOS存储器,CPU调用并运行主BIOS存储器内存储的程序,其特征在于:电脑系统还包括辅BIOS存储器,其内存储有与主BIOS存储器内存储的相同的BIOS程序,CPU运行调用的程序过程中向基板管理控制器发送反馈信号,用以指示BIOS程序的运行状态,基板管理控制器根据接收到的反馈信号,判断是否需要将辅BIOS存储器内存储的程序覆盖主BIOS存储器内存储的程序,以恢复主BIOS存储器内存储的程序,CPU再调用并运行恢复后的主BIOS存储器内存储的程序。
2.如权利要求1所述的电脑系统,其特征在于:基板管理控制器包括核心芯片,CPU调用并运行主BIOS存储器内存储的程序时,依次向核心芯片发送第一反馈信号、第二反馈信号与第三反馈信号,核心芯片对应第一反馈信号、第二反馈信号及第三反馈信号分别预设第一时间间隔、第二时间间隔及第三时间间隔,并根据预设的时间间隔内是否收到对应的反馈信号,相应判断是否需要将辅BIOS存储器内存储的程序覆盖主BIOS存储器内存储的程序。
3.如权利要求2所述的电脑系统,其特征在于:基板管理控制器还包括BMC存储器,核心芯片读取辅BIOS存储器内存储的程序,并存储于BMC存储器内,核心芯片再将存储于BMC存储器内存储的程序覆盖主BIOS存储器内原先存有的程序。
4.如权利要求2所述的电脑系统,其特征在于:核心芯片从启动至超过预设的第一时间间隔,仍未接收到到第一反馈信号,即将辅BIOS存储器内存储的程序覆盖主BIOS存储器内存储的程序。
5.如权利要求4所述的电脑系统,其特征在于:核心芯片接收到第一反馈信号后,超过预设的第二时间间隔仍未接收到第二反馈信号,亦未接收到第三反馈信号,即将辅BIOS存储器内存储的程序覆盖主BIOS存储器内存储的程序。
6.如权利要求1所述的电脑系统,其特征在于:电脑系统还包括开关模组,用以实现基板管理控制器与主BIOS存储器、辅BIOS存储器之间的连接通信,以及主BIOS存储器与CPU之间的连接与通信。
7.如权利要求6所述的电脑系统,其特征在于:开关模组具有初始状态与应急状态,核心芯片控制开关模组的状态,使开关模组处于初始状态时,CPU通过开关模组调用并运行主BIOS存储器内存储的程序,开关模组处于应急状态时,核心芯片通过开关模组恢复主BIOS存储器内存储的程序,核心芯片再将开关模组恢复初始状态。
8.如权利要求1所述的电脑系统,其特征在于:电脑系统还包括南桥芯片,CPU通过南桥芯片建立与基板管理控制器和主BIOS存储器之间的连接与通信。
9.一种电脑系统的开机方法,其包括以下步骤:
提供一种电脑系统,包括基板管理控制器、主BIOS存储器、辅BIOS存储器及CPU,基板管理控制器包括核心芯片及BMC存储器,主BIOS存储器与辅BIOS存储器内储存有相同的程序,CPU调用并运行主BIOS存储器内存储的程序时,依次向核心芯片发送第一反馈信号、第二反馈信号与第三反馈信号,核心芯片对应第一反馈信号、第二反馈信号及第三反馈信号分别预设有对应的时间间隔;
CPU调用并运行主BIOS存储器内存储的程序,并向核心芯片发送反馈信号;
核心芯片判断是否超过预设的时间间隔仍未接收到对应的反馈信号;及
若超过预设的时间间隔仍未接收到对应的反馈信号,核心芯片利用辅BIOS存储器内存储的程序恢复主BIOS存储器内存储的程序,并返回至CPU调用并运行主BIOS存储器内存储的程序,并向核心芯片发送反馈信号这一步骤。
10.如权利要求9所述的电脑系统的开机方法,其特征在于:核心芯片判断是否超过预设的时间间隔仍未接收到对应的反馈信号这一步骤中,当在预设的时间间隔内接收到对应的反馈信号时,还包括核心芯片判断接收到的反馈信号的类型这一步骤。
11.如权利要求10所述的电脑系统的开机方法,其特征在于:核心芯片判断接收到的反馈信号的类型这一步骤中,当接收到的反馈信号为第一反馈信号或者第二反馈信号时,再返回至核心芯片判断是否超过一定的时间间隔仍未接收到反馈信号这一步骤。
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