[发明专利]TURBO解码装置及通信装置有效

专利信息
申请号: 201010509416.8 申请日: 2010-09-29
公开(公告)号: CN102035559A 公开(公告)日: 2011-04-27
发明(设计)人: 今福和章;大渊一央;宫崎俊治;山田英明;斋藤睦巳;井上胜;堀田真吾 申请(专利权)人: 富士通株式会社
主分类号: H03M13/29 分类号: H03M13/29;H04L1/00
代理公司: 隆天国际知识产权代理有限公司 72003 代理人: 张浴月;张志杰
地址: 日本国神奈*** 国省代码: 日本;JP
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摘要:
搜索关键词: turbo 解码 装置 通信
【说明书】:

技术领域

此处讨论的实施例涉及一种turbo(快速)解码装置及通信装置。

背景技术

通常的,存在有各种方法作为用于诸如移动终端或基站的通信装置的数据发送和接收的通信方法。例如,通信方法包括LTE(Long Term Evolution,长期演进)、HSPA+(High Speed Packet Access+,高速分组接入+)等等。此外,使用LTE和HSPA+的通信装置使用turbo码作为纠错码。

使用turbo码的通信装置在对用turbo码编码的信号进行解码的过程中执行交织处理和反交织处理。在这种情况下,交织处理是一种用于对存储在存储器中的信号顺序进行再排列的处理。而且,反交织处理是一种用于对交织处理再排列的信号顺序进行恢复的处理。

进一步解释说明关于用于对turbo码编码的信号进行解码的turbo解码处理的一个示例。例如,通信装置在接收到信号(A)时对接收到的信号(A)执行解码处理,并将其结果存储在存储器中。然后,通信装置对信号(A)执行交织处理,在交织处理后对信号(b)执行解码处理,并再次将其结果存储在存储器中。然后该通信装置对信号(B)执行反交织处理,在反交织处理后对信号(C)执行解码处理,并再次将其结果存储在存储器中。在这种情况下,信号(A)和信号(C)的顺序是相同的。

在这种情况下,交织处理和反交织处理的处理方法依赖于turbo码的编码方法而不同。此外,turbo码的编码编码方法依赖于通信方法而不同。因此,例如,LTE和HSPA+执行不同的交织处理和反交织处理。例如,使用LTE的通信装置使用“QPP(Quadratic Permutation Polynomial Interleaver,二次置换多项式交织器)”。另一方面,使用HSPA+的通信装置使用“PIL(Prunable Prime Interleaver,可删性质数交织器)”。

当执行turbo解码处理时,存在一种能通过并行执行多个存储器的读写来并行执行解码处理的通信装置。例如,通信装置将信号分为多个信号,并对所分成的信号并发执行解码处理。在这种情况下,安装在并发执行解码处理的通信装置上的每个存储器的容量和存储器的数量依赖于信号的最大尺寸、交织处理和反交织处理的处理方法、通信装置并发执行的处理数量等等而不同。

例如,因为在LTE和HSPA+中的信号最大尺寸是不同的,安装在使用LTE的通信装置上的存储器和安装在使用HSPA+的通信装置上的存储器在每个存储器的容量和存储器的数量方面彼此不同。这种技术已经被公开为公知的,例如,日本特许公开号2008-135813、2008219892以及2008-118628和国际公开号WO2006/082923。

期望一种能并发执行相应于多种通信方法的解码处理的通信装置。此外,也需要该通信装置在相应于多个通信方法之后相应于用于多个通信方法的turbo解码处理。考虑到安装在并发执行解码处理的通信装置上的存储器的容量和数量依赖于通信方法而不同,需要一种安装装置来根据通信方法在其上安装各存储器。

例如,当实现相应于LTE和HSPA+的通信装置时,安装装置分别安装用于使用LTE执行turbo解码处理的存储器以及用于使用HSPA+执行turbo解码处理的存储器。

然而,这会存在一些问题,安装装置依赖于通信方法分别安装存储器,由此增加了存储器的负担。

因而,本发明一个实施例在一方面的一个目的是提供一种能减轻存储器负担的turbo解码装置及通信装置。

发明内容

根据本发明一个实施例的一个方面,turbo解码装置包括:存储单元,用于在对使用turbo码编码的编码信号进行解码的过程中所执行的交织处理中存储数据;以及访问单元,用于访问所述存储单元以读写数据。所述存储单元包括多个存储电路,通过耦合所述多个存储电路而被形成为一个存储空间,以及根据所述存储电路的组合作为第一记忆库结构运行,或作为第二记忆库结构运行,其中,通过所述第一记忆库结构分配第一容量给每个记忆库,通过所述第二记忆库结构分配第二容量给每个记忆库。所述访问单元根据所述编码信号的通信方法来选择所述存储单元作为所述第一记忆库结构和所述第二记忆库结构中的哪一个运行,并根据所选择的记忆库结构访问所述存储单元。

附图说明

图1为一阐释了根据第一实施例的turbo解码装置的结构示例的框图;

图2为一简单阐释了根据第二实施例的turbo解码装置的示例的图示;

图3为一阐释了根据第二实施例的turbo解码装置的结构示例的框图;

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