[发明专利]通用序列总线数据处理装置无效

专利信息
申请号: 201010557992.X 申请日: 2010-11-19
公开(公告)号: CN102479167A 公开(公告)日: 2012-05-30
发明(设计)人: 林灿云;黄柏璋 申请(专利权)人: 英业达股份有限公司
主分类号: G06F13/38 分类号: G06F13/38
代理公司: 北京律诚同业知识产权代理有限公司 11006 代理人: 陈红;郑焱
地址: 中国台湾台*** 国省代码: 中国台湾;71
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摘要:
搜索关键词: 通用 序列 总线 数据处理 装置
【说明书】:

技术领域

发明涉及一种数据处理装置,且特别是涉及一种通用序列总线数据的处理装置。

背景技术

通用序列总线(Universal Serial Bus,USB)提供一种用来连接外围装置至计算机装置的串行总线标准,已渐渐取代个人计算机上的其它串行或并列连接埠。

目前,具有USB接口的外围装置因具有即插即用的功能,因此于推出后,受到消费者的热烈欢迎。USB2.0协议可以提供高达480M位/每秒的传输速率。但随着多媒体技术的发达,若欲以USB2.0协议下载25GB的多媒体档案,则需耗费长达十数分钟之久,恐怕无法满足消费者的需求。因此,遂有USB3.0协议的推出,USB3.0协议可以提供高达4.8G位/每秒的传输速率,因此,若欲下载该25GB的多媒体档案,则仅需原来1/10时间。

但,毕竟USB2.0协议仍是目前的主流,绝大部分USB接口的外围装置仍只支持USB2.0协议,因此,为了能通用于将来USB3.0协议以及目前USB2.0协议,目前的USB控制器均设计成同时支持USB2.0及USB3.0协议,造成成本居高不下。

因此,如何建立一仅需使用单一支持USB3.0协议的USB控制器,却能同时读取USB2.0及USB3.0协议数据的架构及成为工程师追求的目标。

此外,同时支持USB2.0协议与USB3.0协议的连接器均设计为具有9根针脚(pin),其中USB2.0协议的接口是通过4根针脚传输数据,而USB3.0协议的接口是通过另外5根针脚传输数据。所以在此架构下,USB2.0协议的数据与USB3.0协议的数据其实是相互独立传输至USB控制器,亦即USB2.0与USB3.0是各自独立的架构系统,彼此并不会产生影响。

发明内容

本发明的一目的即是在提供一种通用序列总线(USB)数据的处理装置,借由南桥芯片提供的USB2.0控制器来处理USB2.0数据,移除对一可同时处理USB2.0及USB3.0协议数据芯片的需求。

本发明的一态样在提供一种通用序列总线数据处理装置,包括:一连接器,用以接收一USB3.0协议数据及一USB2.0协议数据;一第一控制器,耦接该连接器,其中该第一控制器具有处理该USB3.0协议数据的功能;以及一南桥芯片,具有一第二控制器,该第二控制器具有处理该USB2.0协议数据的功能,该南桥芯片耦接该第一控制器,而该南桥芯片的该第二控制器耦接该连接器;其中当该连接器接收该USB 3.0协议数据时,该USB 3.0协议数据被传送至该第一控制器进行处理,以及当该连接器接收该USB 2.0协议数据时,该USB 2.0协议数据被传送至该第二控制器进行处理。

在一实施例中,连接器包括:一第一接头,耦接该第一控制器,并用以接收该USB3.0协议数据;以及一第二接头,耦接该第二控制器,并用以接收该USB2.0协议数据。

在一实施例中,该连接器包括一接头,而该接头同时耦接至该第一控制器和该第二控制器,并用以接收该USB3.0协议数据及该USB2.0协议数据。一驱动模块用以辨识该接头所接收的数据为该USB3.0协议数据或是为该USB2.0协议数据。其中当该驱动模块辨识该接头所接收的数据为该USB3.0协议数据时,该第一控制器处理该接头所接收的数据,而该驱动模块辨识该接头所接收的数据为该USB2.0协议数据时,该第二控制器处理该接头所接收的数据。

在一实施例中,其中该南桥芯片通过一PCI接口与该第一控制器耦接。

在一实施例中,该第一控制器仅具有处理该USB3.0协议数据的功能。该第二控制器仅具有处理该USB2.0协议数据的功能。

在一实施例中,其中该连接器包括一接头,而该接头同时耦接至该第一控制器和该第二控制器,并用以接收该USB3.0协议数据及该USB2.0协议数据。一驱动模块用以辨识该接头所接收的数据为该USB3.0协议数据或是为该USB2.0协议数据。

综合上述所言,本发明借由整合在南桥芯片104内的USB2.0控制器处理USB2.0协议数据传输,因此对USB3.0协议数据仅需由一颗单独支持USB3.0协议的控制器进行处理,可大幅降低控制器成本。

附图说明

为了让本发明的上述和其它目的、特征、优点与实施例能更明显易懂,所附附图的说明如下:

图1所示为一个人计算机的基本架构;

图2所示为根据本发明一实施例的通用序列总线的连接结构概略图;

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