[发明专利]一种同步异频时钟对齐的设计电路无效
| 申请号： | 201010558878.9 | 申请日： | 2010-11-25 |
| 公开（公告）号： | CN102480289A | 公开（公告）日： | 2012-05-30 |
| 发明（设计）人： | 迟志刚 | 申请（专利权）人： | 上海华虹集成电路有限责任公司 |
| 主分类号： | H03L7/07 | 分类号： | H03L7/07 |
| 代理公司： | 上海东创专利代理事务所(普通合伙) 31245 | 代理人： | 曹立维 |
| 地址： | 201203 上海*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 一种 同步 时钟 对齐 设计 电路 | ||
【权利要求书】：
1.一种同步异频时钟对齐的设计电路，其特征在于包含延迟单元、采样逻辑单元、相位反转判别逻辑单元、反向器和选择器。
2.如权利要求1所述的一种同步异频时钟对齐的设计电路，其特征在于所述反相器和选择器的数目为两个或多个，用于校正相位反转的时钟。
3. 如权利要求1所述的一种同步异频时钟对齐的设计电路，其特征在于所述延迟单元用于避免采样时钟采样到被采样时钟的亚稳态。
4. 如权利要求1所述的一种同步异频时钟对齐的设计电路，其特征在于所述相位反转判别逻辑单元分析采样逻辑单元送出的采样序列，判断时钟相位是否对齐。
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