[发明专利]一种机架内的时间同步方法及设备有效

专利信息
申请号: 201010566514.5 申请日: 2010-11-30
公开(公告)号: CN102142954A 公开(公告)日: 2011-08-03
发明(设计)人: 陈晖 申请(专利权)人: 中兴通讯股份有限公司
主分类号: H04L7/00 分类号: H04L7/00
代理公司: 北京同达信恒知识产权代理有限公司 11291 代理人: 黄乃雷
地址: 518057 广东省深圳市南山*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 机架 时间 同步 方法 设备
【权利要求书】:

1.一种机架内的时间同步方法,其特征在于,包括如下步骤:

在第一信号线上,发送侧用同步脉冲的上升沿向接收侧指示将开始数据传送;

在第二信号线上,发送侧以大于nHz的频率向接收侧传输脉冲信号,n大于1;

在第三信号线上,发送侧在同步脉冲处于高电平的有效状态后当第二信号线上的信号处于下降沿时发送时间值数据,接收侧在接收到指示后当第二信号线上的信号处于上升沿时采样时间值数据;

接收侧在时间值接收完毕后,根据接收的时间值对本地时钟进行校正。

2.如权利要求1所述的方法,其特征在于,发送侧发送的时间值为发送侧在第一信号线上进行指示的时间值加上时钟周期校正值后,再加上发送侧与接收侧之间的线路延时,其中,时钟周期校正值为:[(时间值的bit位数/时间值每个周期传输的数量)-0.5]个时钟周期。

3.如权利要求2所述的方法,其特征在于,n为2M;和/或,时间值为80bit,每次传送1bit。

4.如权利要求1或2或3所述的方法,其特征在于,进一步包括:

发送侧在接收侧接收完毕后,使第一信号线上的同步脉冲信号处于低电平的失效状态。

5.如权利要求4所述的方法,其特征在于,发送侧在接收侧接收完毕后,从同步脉冲的上升沿开始,再经过[(时间值的bit位数/时间值每个周期传输的数量)-0.5]个时钟周期后使第一信号线上的同步脉冲信号处于低电平的失效状态。

6.一种机架内的时间同步接口设备,其特征在于,包括:发送模块与接收模块,发送模块中的同步发送单元与接收模块中的同步接收单元相连,发送模块中的时钟发送单元与接收模块中的时钟接收单元相连,发送模块中的数据发送单元与接收模块中的数据接收单元相连,接收模块还包括校正单元,其中:

同步发送单元,用于在第一信号线上,用同步脉冲的上升沿向同步接收单元指示将开始数据传送;

时钟发送单元,用于在第二信号线上,以大于nHz的频率向时钟接收单元传输脉冲信号,n大于1;

数据发送单元,用于在第三信号线上,在同步发送单元发送的同步脉冲处于高电平的有效状态后当第二信号线上的信号处于下降沿时发送时间值数据;

数据接收单元,用于在第三信号线上,在同步接收单元接收的同步脉冲处于高电平的有效状态后当第二信号线上的信号处于上升沿时采样时间值数据;

校正单元,用于在时间值接收完毕后,根据接收的时间值对本地时钟进行校正。

7.如权利要求6所述的设备,其特征在于,数据发送单元进一步用于确定发送的时间值为同步发送单元在第一信号线上进行指示的时间值加上时钟周期校正值后,再加上发送模块与接收模块之间的线路延时,其中,时钟周期校正值为:[(时间值的bit位数/时间值每个周期传输的数量)-0.5]个时钟周期。

8.如权利要求7所述的设备,其特征在于,时钟发送单元进一步用于采用n为2M的频率;

和/或,数据发送单元进一步用于确定发送的时间值为80bit,每次传送1bit。

9.如权利要求6或7或8所述的设备,其特征在于,发送模块进一步包括:

失效单元,用于在数据接收单元接收完毕后,使第一信号线上的同步脉冲信号处于低电平的失效状态。

10.如权利要求9所述的设备,其特征在于,失效单元进一步用于在数据接收单元接收完毕后,从同步脉冲的上升沿开始,再经过[(时间值的bit位数/时间值每个周期传输的数量)-0.5]个时钟周期后使第一信号线上的同步脉冲信号处于低电平的失效状态。

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