[实用新型]一种存储式信号发生器无效
申请号: | 201020644902.6 | 申请日: | 2010-12-07 |
公开(公告)号: | CN201867434U | 公开(公告)日: | 2011-06-15 |
发明(设计)人: | 杜忠勤 | 申请(专利权)人: | 西安华澳电子科技有限公司 |
主分类号: | G01R1/28 | 分类号: | G01R1/28;G01R31/26 |
代理公司: | 西安新思维专利商标事务所有限公司 61114 | 代理人: | 李罡 |
地址: | 710075 陕西省西安市太*** | 国省代码: | 陕西;61 |
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摘要: | |||
搜索关键词: | 一种 存储 信号发生器 | ||
技术领域
本实用新型属于半导体测试技术领域,具体涉及一种存储式信号发生器。
背景技术
现有技术中,信号发生器有纯硬件形式、软硬件结合形式。纯硬件形式是指仅由硬件线路构成的信号发生器,没有软件功能,因此一般信号周期、幅度不能随意选择,信号频率也不能随软件控制而改变。
此外,纯硬件形式信号发生器难以同时保证线路简洁、失真度小和性能稳定等特征。
发明内容
为了满足测试系统对于模拟信号源要求,本专利克服了现有纯硬件形式技术中的缺点,提供了一种结构简单,使用方便、性能稳定的存储式信号发生器形式。采用的技术方案是:
一种存储式信号发生器,其特征在于:所述存储式信号发生器包括数据发生电路、数模转换和放大滤波电路和输出选择通道电路,所述数据发生电路的输出端接数据转化和放大滤波电路的输入端,数据转化和放大滤波电路的输出端连接输出选择通道电路的输入端。
所述数据发生电路由外部时钟、控制逻辑电路、寻址电路、存储器EPROM组成,所述控制逻辑电路的输出端和时钟分别连接寻址电路的两个输入端,寻址电路的输出端连接存储器EPROM的输入端,存储器EPROM的输出端和时钟连接数模转换和放大滤波电路。
所述数模转换和放大滤波电路由采样保持器、DAC单元、跟随器、放大/滤波器构成,所述DAC单元的输入端连接存储器EPROM的输出端和时钟,DAC单元的输出端经过积分器连接放大/滤波器的输入端,另一个采样保持器的输出端连接放大/滤波器的另一输入端。
所述输出选择通道电路由模拟开关阵列构成,所述模拟开关阵列连接放大/滤波器的输出端。
相对于现有技术,本专利采用了软硬件结合形式,将模拟信号写入储存器EPROM中,通过控制读出并经过放大和滤波得到波形信号,结构简单,使用方便。其信号的周期数、幅度和频率都可以通过软件来实现控制。
附图说明
图1为本实用新型结构图。
具体实施方式
参见图1,一种存储式信号发生器,包括数据发生电路、数模转换电路、放大/滤波电路和输出选择通道电路。所述数据发生电路与数据转换电路、放大滤波电路、输出选择通道电路依次连接。其中,数据发生电路由外部时钟、控制逻辑电路、寻址电路、存储器EPROM组成,所述控制逻辑电路的输出端和时钟分别连接寻址电路的两个输入端,寻址电路的输出端连接存储器EPROM的输入端,存储器EPROM的输出端和时钟连接数模转换电路的输入。所述数模转换和放大滤波电路由采样保持器、DAC单元、跟随器、放大/滤波器构成,DAC单元的输入端连接存储器EPROM的输出端和时钟,DAC单元的输出端经过积分器连接放大/滤波器的输入端,而DAC的参考电压端和采样保持器的输出端连接,同时接到放大/滤波器的另一输入端;放大滤波器的输出与选择通道电路输入连接。选择通道电路由模拟开关阵列构成,所述模拟开关阵列的通断由系统总线控制。
本实用新型发生一种周期模拟信号,其原始形式被逐点存储在EPROM中。在生成时,其频率由外部时钟频率确定,输出的周期数通过控制逻辑选定,输出幅度通过基准DAC输出信号驱动的采样保持器输出确定。输出路径由模拟开关阵列组成的输出选择通道电路在软件控制下,从而得到参数测试需要的模拟信号。
其中,信号的存储和输出由控制逻辑、寻址电路、时钟和EPROM实现,数模变换和信号滤波由DAC单元、积分器、放大/滤波器、采样保持、时钟完成,输出路径由模拟开关阵列实现。
其工作过程如下:模拟信号的数据写在EPROM储存器中。当需要模拟信号时,控制逻辑输入控制信号,控制寻址电路产生数据地址,同时选择存储器对应地址的数据输出,输出的数据信号加到DAC转换器输入,并从DAC输出对应的模拟信号。输出的模拟信号经过跟随器接到放大/滤波电路进行放大和滤波,形成平滑的模拟信号,模拟信号的幅度可以通过放大/滤波电路的增益进行调整,同时是受采样保持器的输出电平确定的。模拟信号的频率是由寻址频率确定的。
输出信号幅度可以通过采样保持器输出电平和放大/滤波电路的放大倍数调整来确定。
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