[实用新型]串行通信信号电平幅值的监测装置无效

专利信息
申请号: 201020650548.8 申请日: 2010-12-10
公开(公告)号: CN201886062U 公开(公告)日: 2011-06-29
发明(设计)人: 周文华 申请(专利权)人: 上海申瑞电力科技股份有限公司
主分类号: G01R19/00 分类号: G01R19/00
代理公司: 上海申汇专利代理有限公司 31001 代理人: 林炜
地址: 200233 上海市徐*** 国省代码: 上海;31
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摘要:
搜索关键词: 串行 通信 信号 电平 监测 装置
【说明书】:

技术领域

实用新型涉及信号监测技术,特别是涉及一种串行通信信号电平幅值的监测装置的技术。

背景技术

目前,变电站中各保护、测量、计量、监视、控制等设备大都就地安装,其测控数据大多通过串行通信方式与当地后台系统完成数据上传或下发,从而达到实时监视的目的,其中一些重要数据不但需要就地备份,还须通过串行通信接口上传到调度所。变电站在进行上述数据的交互时都需要使用串行通信接口,但是由于现场各种设备的串行通信接口驱动能力不尽相同,因此经常会出现即便B机与C机的配置相同,仍会发生A机与B机之间的串行通信正常,而A机与C机之间的串行通信却异常的现象,造成该现象的其中一重要原因是各设备中串行通信接口的驱动电路驱动能力、输入阻抗等不尽相同,再加上信号载体特征阻抗、接点布置等种种原因,使得变电站的串行通信异常现象时有发生。因此,需要对一些重要的串行通信信号的质量进行实时监视,以便于实时修复发生通信异常的设备。

实用新型内容                                             

针对上述现有技术中存在的缺陷,本实用新型所要解决的技术问题是提供一种能实时监视串行通信信号的质量的串行通信信号电平幅值的监测装置。

为了解决上述技术问题,本实用新型所提供的一种串行通信信号电平幅值的监测装置,其特征在于:包括CPU、采样电路和参考电平输出电路;

所述CPU设有一个三线串行接口、两个信号采样端,其两个采样端分别为第一采样端、第二采样端;

所述采样电路包括第一运放芯片、第二运放芯片、第一二极管、第二二极管、第一比较器、第二比较器;

所述第一运放芯片的同相输入端及第二运放芯片的同相输入端连接受测串行通信信号;

所述第一运放芯片的输出端接到第一二极管的正极,其反相输入端接到第一二极管的负极;所述第一二极管的负极经一限流电阻接到第一比较器的反相输入端,并经一充电电容接到地,该充电电容并接一放电电阻;所述第一比较器的同相输入端接参考电平输出电路的正电平输出端,其输出端经一光耦接到CPU的第一采样端;

所述第二运放芯片的输出端接到第二二极管的负极,其反相输入端接到第二二极管的正极;所述第二二极管的正极经另一限流电阻接到第二比较器的同相输入端,并经另一充电电容接到地,该充电电容并接另一放电电阻;所述第二比较器的反相输入端接参考电平输出电路的负电平输出端,其输出端经另一光耦接到CPU的第二采样端;

所述参考电平输出电路包括数字式可控模拟电源输出芯片、第三运放芯片、第四运放芯片;

所述数字式可控模拟电源输出芯片设有一个三线串行信号接口、一个基准电压输出端,其三线串行信号接口经光耦接到CPU的三线串行信号接口,其基准电压输出端分别接到第三运放芯片的同相输入端及第四运放芯片的反相输入端;

所述第三运放芯片的输出端为参考电平输出电路的正电平输出端,其反相输入端接其输出端;

所述第四运放芯片的输出端为参考电平输出电路的负电平输出端,其反相输入端接其输出端,其同相输入端接地。

本实用新型提供的串行通信信号电平幅值的监测装置,通过CPU自动调节参考电平输出电路输出的正负电压值,通过比较器将参考电平输出电路输出的正负电压值与受测串行通信信号进行比较,进而测出受测串行通信信号的电压幅值,从而为变电站、调度所或其它使用串行通信方式的用户判断串行通信信号的质量提供了依据。

附图说明

图1是本实用新型实施例的串行通信信号电平幅值的监测装置中的采样电路的电路图;

图2是本实用新型实施例的串行通信信号电平幅值的监测装置中的参考电平输出电路的电路图。

具体实施方式

以下结合附图说明对本实用新型的实施例作进一步详细描述,但本实施例并不用于限制本实用新型,凡是采用本实用新型的相似结构及其相似变化,均应列入本实用新型的保护范围。

如图1所示,本实用新型实施例所提供的一种串行通信信号电平幅值的监测装置,其特征在于:包括CPU(图中未示)、采样电路和参考电平输出电路;

所述CPU设有一个三线串行接口、两个信号采样端,其两个采样端分别为第一采样端CPU1、第二采样端CPU2;

所述采样电路包括第一运放芯片U1、第二运放芯片U2、第一二极管D1、第二二极管D2、第一比较器U3、第二比较器U4;

所述第一运放芯片U1的同相输入端及第二运放芯片U2的同相输入端连接受测串行通信信号Sin;

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