[发明专利]用于与物理层信息一起使用的网络管理系统有效
申请号: | 201080016474.5 | 申请日: | 2010-02-12 |
公开(公告)号: | CN102754388A | 公开(公告)日: | 2012-10-24 |
发明(设计)人: | M.拉扎;K.佩特尔;J.安德森;J.科菲 | 申请(专利权)人: | ADC长途电讯有限公司 |
主分类号: | H04L12/24 | 分类号: | H04L12/24;H04L12/26;H04L29/06 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 王岳;王洪斌 |
地址: | 美国明*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 物理层 信息 一起 使用 网络 管理 系统 | ||
对相关申请的交叉引用
本申请要求2009年2月13日提交的美国临时专利申请序列号61/152,624的权益,该美国临时专利申请在此通过引用合并到本文中。
技术领域
本发明涉及用于与物理层信息一起使用的网络管理系统。
背景技术
通信网络典型地包括各项设备之间的众多逻辑通信链路。往往使用若干件物理通信媒体来实施单个逻辑通信链路。例如,计算机与互联网络(inter-networking)设备诸如集线器或路由器之间的逻辑通信链路可以如下实施。第一电缆把计算机连接到墙壁中安装的插孔(jack)。第二电缆把壁装式插孔连接到接插板(patch panel)的端口,而第三电缆把互联网络设备连接到接插板的另一个端口。“接插线”把两者交叉连接在一起。换言之,往往使用若干段(segment)物理通信媒体来实施单个逻辑通信链路。
网络或企业管理系统(通常在这里被称为“网络管理系统”或“NMS”)典型地知道在网络中存在的逻辑通信链路但是典型地没有关于用来实施逻辑通信链路的具体物理层媒体的信息。事实上,NMS系统典型地没有能力来显示或者以其他方式提供关于如何在物理层级处实施逻辑通信链路的信息。
物理层管理(PLM)系统确实存在。然而,现有的PLM系统被典型地设计成便于在给定位置处的特定接插板或一组接插板处的交叉连接的添加、改变和去除。通常,这样的PLM系统包括如下功能性(functionality):跟踪什么连接到接插板的每个端口,追踪使用接插板建立的连接,并且向接插板处的用户提供视觉指示。然而,这样的PLM系统典型地是以“接插板”为中心的,因为它们集中于帮助技术员正确地添加、改变或去除接插板处的交叉连接。在接插板中包括的或者耦合到接插板的任何“智能”典型地仅设计成便于在接插板处进行准确的交叉连接并且对相关问题进行检修(例如,通过检测接插线是否插入到给定端口中和/或通过确定使用接插线来彼此耦合哪些端口)。
此外,这样的PLM系统收集的任何信息典型地仅用在PLM系统内。换言之,这样的PLM系统维持的信息收集是未在应用层级处被其他系统使用的逻辑“岛”。尽管这样的PLM系统有时连接到其他网络(例如,连接到局域网或因特网),但是这样的网络连接典型地仅用来使得用户能够远程地访问PLM系统。也就是说,用户使用外部网络连接来远程地访问驻留在PLM系统自身中的PML相关应用层功能性,但是外部系统或网络它们自身通常不包括利用驻留在PLM系统中的任何物理层相关信息的任何应用层功能性。
发明内容
一个示例性实施例针对网络管理系统(NMS),其包括:接口,用于通信地耦合NMS到网络;以及可编程处理器,被配置成执行软件。所述软件包括接收物理层信息(PLI)的物理层信息功能性。NMS使用所述物理层信息的至少一部分来执行网络管理功能。从包括在物理通信媒体中或物理通信媒体上的存储器设备读取所述物理层信息的至少一部分。
另一个示例性实施例针对当信道已被证明为符合至少一个信道规范时执行的方法。该方法包括:接收关于用来实施信道的部件与至少一个部件规范的符合性的信息;以及接收关于用来实施信道的永久链路与至少一个永久链路规范的符合性的信息。该方法还包括:接收关于信道与至少一个信道规范的符合性的信息;以及使用与在那时用来实施信道的部件关联的物理层信息,确定用于被证明为符合至少一个信道规范的信道的基础自从信道被证明为符合至少一个信道时以来是否改变。与在那时用来实施信道的部件关联的物理层信息包括存储在识别部件的部件上或部件中的信息。
下面在附图和说明书中阐述要求保护的发明的各种实施例的细节。其它特征和优点将根据说明书、附图和权利要求而变得显而易见。
附图说明
图1是包括物理层信息(PLI)功能性以及物理层管理(PLM)功能性的系统的一个示例性实施例的框图。
图2是适合于用在图1的系统中的端口和媒体读取接口的一个高级实施例的框图。
图3示出了包括物理层信息(PLI)功能性以及物理层管理(PLM)功能性的系统的一个示例性实施例。
图4是图3中示出的每个从(slave)处理器模块的一个示例性实施例的框图。
图5是图3的主(master)处理器单元的一个实施例的框图。
图6是示出适合于用在图3的系统中的接插线的一个实施例的图示。
图7是示出适合于用在图3的系统中的接插线的另一个示例性实施例的图示。
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