[发明专利]快闪存储器数据存储装置中的数据分条无效

专利信息
申请号: 201080020488.4 申请日: 2010-04-05
公开(公告)号: CN102428455A 公开(公告)日: 2012-04-25
发明(设计)人: 阿尔贝特·T·博尔歇斯;安德鲁·T·斯温;罗伯特·S·斯普林科 申请(专利权)人: 谷歌公司
主分类号: G06F13/42 分类号: G06F13/42;G06F3/06
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 刘国伟
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 闪存 数据 存储 装置 中的
【权利要求书】:

1.一种将数据从主机(106、350、551)分条到数据存储装置(100、302、501)的方法,所述数据存储装置(100、302、501)包括多个存储器芯片(118a、118b、218、318)及用于在所述主机(106、350、551)与所述多个存储器芯片(118a、118b、218、318)之间传递数据的多个物理通道(112),每一通道(112)可操作地连接到不同多个所述存储器芯片(118a、118b、218、318),所述方法包含:

确定(602)所述多个通道(112)中的物理通道(112)的数目;

确定(604)借以将数据写入到连接到单独通道(112)的存储器芯片(118a、118b、218、318)的第一通道组块大小;

经由所述主机(106、350、551)将逻辑顺序数据分段(606)成第一通道组块大小段;及

按第一通道组块大小单位将数据分条(608)到所述数据存储装置(100、302、501)的不同通道(112)。

2.根据权利要求1所述的方法,其进一步包含:

确定(610)借以将数据写入到不同存储器芯片(118a、118b、218、318)的芯片组块大小;

针对所述所确定物理通道(112)中的每一者,确定(612)可操作地连接到所述通道的存储器芯片(118a、118b、218、318)的数目;

经由所述主机(106、350、551)将所述第一通道组块大小段分段(614)成芯片组块大小段;

按芯片组块大小单位将第一通道组块大小段中的数据分条(616)到连接到通道(112)的不同存储器芯片(118a、118b、218、318)。

3.根据前述权利要求中任一权利要求所述的方法,其进一步包含:

确定(618)借以将数据写入到连接到单独通道(112)的存储器芯片(118a、118b、218、318)的第二通道组块大小;

经由所述主机(106、350、551)将逻辑顺序数据分段(620)成第二通道组块大小段;及

按第二通道组块大小单位将数据分条(622)到所述数据存储装置(100、302、501)的不同通道(112)。

4.根据前述权利要求中任一权利要求所述的方法,其中所述逻辑顺序数据由数据文件组成。

5.根据前述权利要求中任一权利要求所述的方法,其进一步包含:

在从第二通道读取数据的同时将数据写入到第一通道(112)。

6.根据前述权利要求中任一权利要求所述的方法,其中确定所述多个通道(112)中的物理通道(112)的所述数目包括将指示所述数据存储装置(100、302、501)中的通道(112)的所述数目的信息从所述数据存储装置(100、302、501)传输到所述主机(106、350、551)。

7.根据前述权利要求中任一权利要求所述的方法,其中确定所述多个通道(112)中的物理通道(112)的所述数目包括读取存储于所述主机(106、350、551)上的指示所述数据存储装置(100、302、501)中的通道(112)的所述数目的数据。

8.根据前述权利要求中任一权利要求所述的方法,其中所述确定所述第一通道组块大小是基于来自用户的经由所述主机(106、350、551)键入的输入。

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