[发明专利]分割快闪存储器数据存储装置无效

专利信息
申请号: 201080020489.9 申请日: 2010-04-05
公开(公告)号: CN102428452A 公开(公告)日: 2012-04-25
发明(设计)人: 阿尔贝特·T·博尔歇斯;安德鲁·T·斯温;罗伯特·S·斯普林科 申请(专利权)人: 谷歌公司
主分类号: G06F13/38 分类号: G06F13/38;G06F3/06
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 刘国伟
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 分割 闪存 数据 存储 装置
【说明书】:

相关申请案交叉参考

本申请案请求对在2009年4月8日提出申请且标题为“数据存储装置(DATASTORAGE DEVICE)”的第61/167,709号美国临时申请案及在2009年6月17日提出申请且标题为“快闪存储器数据存储装置中的分割及剥离(PARTITIONING AND STRIPING IN A FLASH MEMORY DATA STORAGE DEVICE)”的第61/187,835号美国临时申请案的权益,其两者以整体引用的方式并入本文中。

技术领域

本说明涉及一种数据存储装置。

背景技术

可使用数据存储装置来存储数据。数据存储装置可与计算装置一同使用以提供所述计算装置的数据存储需要。在某些实例中,可期望在数据存储装置上存储大量数据。此外,可期望快速地执行从所述数据存储装置读取数据及向所述数据存储装置写入数据的命令。

发明内容

根据一个一般方面,揭示一种分割包括多个存储器芯片的数据存储装置的方法。所述方法包括确定所述数据存储装置中的存储器芯片的数目。耦合到所述数据存储装置的主机界定所述数据存储装置的第一分区及第二分区,其中所述第一分区包括所述多个存储器芯片的第一子集且其中所述第二分区包括所述多个存储器芯片的第二子集。所述第一子集不包括所述第二子集中的任何存储器芯片,且其中所述第二子集不包括所述第一子集中的任何存储器芯片。

在另一一般方面中,揭示一种分割包括多个存储器芯片的数据存储装置的方法,其中读取:所述数据存储装置的物理配置,其中包括所述数据存储装置中的存储器芯片的数目;及所述数据存储装置的分割方案。耦合到所述数据存储装置的主机界定所述数据存储装置的第一分区及第二分区,其中所述第一分区包括所述多个存储器芯片的第一子集且所述第二分区包括所述多个存储器芯片的第二子集,且其中所述第一子集不包括所述第二子集中的任何存储器芯片且其中所述第二子集不包括所述第一子集中的任何存储器芯片。针对所述第一分区分配逻辑/物理存储器映射且针对所述第二分区分配逻辑/物理存储器映射。

实施方案可包括以下特征中的一者或一者以上。可在从所述第二分区读取数据的同时将数据写入到所述第一分区。确定所述数据存储装置中的存储器芯片的数目可包括将指示所述数据存储装置中的存储器芯片的所述数目的信息从所述数据存储装置传输到所述主机。所述主机可界定所述数据存储装置中的将从所述主机向其写入数据的地址位置,其中所述地址位置规定将所述数据写入到所述多个存储器芯片中的特定一者。

所述数据存储装置可包括用于在所述主机与所述多个存储器芯片之间传递数据的多个物理通道,每一通道可操作地连接到不同多个所述存储器芯片,且接着可确定物理通道的所述数目。可界定所述通道的第一子集及第二子集,其中所述通道的所述第一子集中的通道仅可操作地连接到存储器芯片的所述第一子集中的存储器芯片且其中所述通道的所述第二子集中的通道仅可操作地连接到存储器芯片的所述第二子集中的存储器芯片。且所述主机可界定所述数据存储装置中的将从所述主机向其写入数据的地址位置,其中所述地址位置规定经由特定通道将所述数据写入到所述多个存储器芯片中的特定一者。所述第一分区可包括可操作地连接到单个通道的存储器芯片。

所述主机可将所述数据存储装置的所述第一分区重新界定为包括所述多个存储器芯片的第三子集,其中所述第三子集不同于所述第一子集,且其中所述第三子集不包括所述第二子集中的任何存储器芯片且其中所述第二子集不包括所述第三子集中的任何存储器芯片。可接收所述第一子集中的所述存储器芯片中的一者已出故障或接近出故障的指示,且接着重新界定所述第一分区可包括将所述第三子集界定为所述第一子集的除已出故障或接近出故障的所述存储器芯片以外的存储器芯片。

在另一一般方面中,一种设备包括:数据存储装置,其包括多个存储器芯片;及主机,其经由接口可操作地耦合到所述数据存储装置。所述主机包括:配置检测引擎,其经配置以检测所述数据存储装置中的存储器芯片的数目;及分区引擎。所述分区引擎经配置以:界定所述数据存储装置的第一分区,其中所述第一分区包括所述多个存储器芯片的第一子集;及界定所述数据存储装置的第二分区,其中所述第二分区包括所述多个存储器芯片的第二子集,且其中所述第一子集不包括所述第二子集中的任何存储器芯片且其中所述第二子集不包括所述第一子集中的任何存储器芯片。

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