[发明专利]用于在多处理器核心系统中执行节能的网络数据包处理的方法和装置有效
申请号: | 201080028104.3 | 申请日: | 2010-06-25 |
公开(公告)号: | CN102460342A | 公开(公告)日: | 2012-05-16 |
发明(设计)人: | C-F·辛;J-S·蔡;T-Y·C·泰 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F1/32 | 分类号: | G06F1/32;G06F13/16;G06F9/46 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 刘瑜;王英 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 处理器 核心 系统 执行 节能 网络 数据包 处理 方法 装置 | ||
技术领域
本公开涉及并且具体涉及多处理器核心系统中的节能,并且具体涉及节能的网络数据包处理。
背景技术
一般,具有多个处理器核心的计算机系统通过在所有的处理器核心之间分配工作负荷来处理高工作负荷。然而,随着工作负荷减少,多个处理器核心中的每一个可能没有被充分利用。
为了减小低工作负荷时多个处理器核心的功耗,操作系统可以基于系统使用水平来调整使用的处理器核心的数量。未被使用的处理器核心被置于低功率空闲状态(“搁置的”)并且可以保持该低功率空闲状态较长的连续时间间隔。操作系统继续在没有处于低功率空闲状态的处理器核心之间分配工作负荷。
附图说明
随着下面详细描述的进行,并且在参照附图后,所要求主题的实施例的特征将变得显而易见,在附图中相同的数字描述相同的部件,并且在附图中:
图1是包括支持接收侧调节的网络接口控制器的实施例的系统的框图;
图2是示出了图1中所示的网络接口控制器和存储器的实施例的框图;
图3是根据本发明的原理动态地调整核心相关性(affinity)设置的方法的实施例的流程图;以及
图4是示出了图1中所示的网络接口控制器和存储器的另一实施例的框图。
虽然参考所要求主题的示例性实施例进行下面的详细描述,但是对本领域技术人员来说,其的多种替换、修改以及变型将是显而易见的。因此,所要求主题旨在被视为是广泛的,并且仅如所附权利要求阐述的那样进行限定。
具体实施方式
计算机系统可以包括网络接口控制器(适配器、卡),该网络接口控制器接收来自网络的网络数据包并且将用于处理的所接收的网络数据包转发至多个处理器核心中的一个。在处理器核心之间分配的工作负荷可以包括对由网络接口控制器接收的网络数据包的处理。
例如,在计算机系统中,对网络数据包的处理可以在处理器核心之间分配,使得对相同通信流(例如,具有相同源地址和目的地址的网络数据包)的处理由相同的处理器核心执行。当工作负荷低时,操作系统可以仅使用多个处理器核心的一个子集,并且将其它的处理器核心置于低功率空闲状态。然而,如果特定通信流的所接收的要被处理的网络数据包被指派给了处于低功率空闲状态的处理器核心(该通信流的核心相关性设置),则该处理器核心从低功率空闲状态唤醒。结果,处于低功率空闲状态的处理器核心不具有保持低功率空闲状态较长时间的机会。
本发明实施例基于操作系统是否将任意的处理器核心置于低功率空闲状态来动态地调整网络数据包处理的核心相关设置。
将对于具有支持由的操作系统(OS)使用的接收侧调节(RSS)的网络接口控制器的计算机系统描述本发明实施例。然而,本发明不限于RSS。在其它实施例中,网络适配器可以支持由包括具有功率节省模式特征的调度器的Linux操作系统或者包括功率节省模式的任意其它操作系统使用的可调节输入/输出(I/O)。
图1是包括支持接收侧调节的网络接口控制器108的实施例的系统100的框图。系统100包括处理器101、存储控制器中心(MCH)102和输入/输出(I/O)控制器中心(ICH)104。MCH 102包括控制处理器101和存储器110之间的通信的存储控制器106。处理器101和MCH 102通过系统总线116进行通信。
处理器101可以是多核心处理器,诸如Pentium D、处理器、或者双核处理器、CoreTM i7处理器或者任意其它类型的处理器。在所示出的实施例中,系统包括两个多核心处理器101,每个均具有至少两个处理器核心(“核心”)122。在一个实施例中,每个多核心处理器包括四个核心122。
存储器110可以是动态随机存取存储器(DRAM)、静态随机存取存储器(SRAM)、同步动态随机存取存储器(SDRAM)、双数据速率2(DDR2)RAM或Rambus动态随机存取存储器(RDRAM),或者任意其它类型的存储器。
ICH 104可以使用诸如直接媒体接口(DMI)的高速芯片到芯片互联114来耦合至MCH 102。DMI经由两个单向通道支持2千兆比特/秒的并发传输速率。
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