[发明专利]用于多客户端的可配置高速缓存有效
申请号: | 201080053459.8 | 申请日: | 2010-09-24 |
公开(公告)号: | CN102640127A | 公开(公告)日: | 2012-08-15 |
发明(设计)人: | 亚历山大·L·明金;史蒂文·詹姆斯·海因里希;拉杰什瓦拉恩·赛尔瓦内桑;布雷特·W·库恩;查理斯·麦卡弗;安佳娜·拉金德拉恩;斯图尔特·G·卡尔顿 | 申请(专利权)人: | 辉达公司 |
主分类号: | G06F13/00 | 分类号: | G06F13/00 |
代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 顾珊;魏宁 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 客户端 配置 高速缓存 | ||
1.一种在一级(L1)高速缓存内分配单独的存储器空间的方法,所述方法包括:
在静态随机访问存储器(SRAM)存储资源中配置第一组条目,以用作本地-全局数据高速缓存;
在所述SRAM存储资源中配置第二组条目,以用作直接映射寄存器;以及
对由所述L1高速缓存从第一客户端和第二客户端接收的存储器访问请求进行仲裁,所述第一客户端被配置为产生向所述第二组条目存储数据的访问请求,所述第二客户端被配置为产生从所述第二组条目加载数据、向所述第一组条目存储数据以及从所述第一组条目加载数据的访问请求。
2.根据权利要求1所述的方法,其中,对所述第一组条目的加载请求被指定为不被高速缓存,并且由所述加载请求所请求的数据从另一存储资源读取,且不被存储到所述SRAM存储资源中。
3.根据权利要求1所述的方法,其中,对所述第一组条目的加载请求被指定为不被高速缓存,并且由所述加载请求所请求的数据被存储在所述SRAM存储资源的第一条目中、从所述第一条目输出,然后所述第一条目被无效。
4.根据权利要求1所述的方法,其中,对所述第一组条目的存储请求被指定为不被高速缓存,并且与所述加载请求包含在一起的写入数据绕开所述SRAM存储。
5.根据权利要求1所述的方法,其中,对所述第一组条目的存储请求被指定为不被高速缓存,并且与所述加载请求包含在一起的写入数据被存储在所述SRAM存储资源中的第一条目中、从所述第一条目输出,然后所述第一条目被无效。
6.根据权利要求1所述的方法,其中,部分地路由由所述第一客户端提供的第一地址和由所述第二客户端提供的第二地址,以对所提供的所述第一地址和所述第二地址进行重排以访问SRAM存储资源。
7.根据权利要求1所述的方法,其中,部分地路由从所述SRAM存储资源读取的数据,以重排该数据从而在单个时钟周期中输出到所述第一客户端或所述第二客户端。
8.根据权利要求1所述的方法,进一步包括这样的步骤:在重配置所述SRAM存储资源之前,使所述SRAM存储资源内的所述第一组条目中的所有条目无效,以将所述第二组条目中的至少一部分条目改为用作本地-全局数据高速缓存。
9.根据权利要求1所述的方法,进一步包括这样的步骤:转储清除所述SRAM存储资源中的所述第二组条目,以将所述第二组条目存储在另一存储资源中。
10.一种用于使用统一存储器空间地址访问单独的并行存储器空间的系统,所述系统包括:
处理器,所述处理器被配置为:
在静态随机访问存储器(SRAM)存储资源中配置第一组条目,以用作本地-全局数据高速缓存;
在所述SRAM存储资源中配置第二组条目,以用作直接映射寄存器;以及
对由L1高速缓存从第一客户端和第二客户端接收的存储器访问请求进行仲裁,所述第一客户端被配置为产生向所述第二组条目存储数据的访问请求,所述第二客户端被配置为产生从所述第二组条目加载数据、向所述第一组条目存储数据以及从所述第一组条目加载数据的访问请求。
11.根据权利要求10所述的系统,进一步包括存储器存储指令,当由所述处理器执行时,所述存储器存储指令将所述处理器配置为:
在所述SRAM存储资源中配置所述第一组条目;
在所述SRAM存储资源中配置所述第二组条目;以及
对由所述L1高速缓存从第一客户端和第二客户端接收的存储器访问请求进行仲裁,以产生所述访问请求。
12.根据权利要求10所述的系统,其中,对所述第一组条目的加载请求被指定为不被高速缓存,并且由所述加载请求所请求的数据从另一存储资源读取,且不被存储到所述SRAM存储资源中。
13.根据权利要求10所述的系统,其中,对所述第一组条目的存储请求被指定为不被高速缓存,并且与所述加载请求包含在一起的写入数据绕开所述SRAM存储。
14.根据权利要求10所述的系统,其中,所述SRAM存储器存储被配置为在每个时钟周期内执行仅仅一个读取操作和仅仅一个写入操作。
15.根据权利要求10所述的系统,其中,部分地路由由所述第一客户端提供的第一地址和由所述第二客户端提供的第二地址,以对所提供的所述第一地址和所述第二地址进行重排以访问SRAM存储资源。
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