[发明专利]多处理器计算机系统和方法无效

专利信息
申请号: 201080069910.5 申请日: 2010-11-01
公开(公告)号: CN103180819A 公开(公告)日: 2013-06-26
发明(设计)人: R.盖伊;R.J.霍尔宁 申请(专利权)人: 惠普发展公司;有限责任合伙企业
主分类号: G06F9/28 分类号: G06F9/28;G06F15/80;G06F15/163
代理公司: 中国专利代理(香港)有限公司 72001 代理人: 马永利;王洪斌
地址: 美国德*** 国省代码: 美国;US
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摘要:
搜索关键词: 处理器 计算机系统 方法
【说明书】:

背景技术

具有多个处理器插座的计算机系统形成高性能计算产业的骨干。将多个处理器安装到单个系统中提供比仅提供单处理器的系统明显更大的计算能力。处理器制造商已经将多处理器能力直接集成到芯片架构中,Intel的QuickPath Interconnect(“QPI”)和AMD的HyperTransport提供了芯片制造商如何寻求利用多处理器系统的仅两个示例。

芯片制造商认识到多处理器系统的价值和重要性并且对具有用于与一个或者多个附加处理器互连的能力的处理器相应地定价。经常可以相对于让其多处理器互连能力使能的相同处理器折扣购买让其多处理器互连能力禁用的处理器。在系统中供应单个的互连禁用的处理器的情况下,为希望将系统扩展成多处理器系统的用户留有用工厂配置的多处理器系统代替整个系统或者用新的互连使能的处理器代替现有的互连禁用的处理器并且然后添加第二相似处理器的不值得羡慕(并且高成本)的选择。两个选项对于用户而言成本高并且不方便。

附图说明

一个或者多个公开的实施例的优点可以在阅读下文详细描述时和参照以下附图时变得清楚,在附图中:

图1是描绘根据这里描述的一个或者多个实施例的示例多处理器计算机系统的框图;

图2是描绘根据这里描述的一个或者多个实施例的另一示例多处理器计算机系统的框图;

图3是描绘根据这里描述的一个或者多个实施例的示例多处理器计算机方法的流程图;并且

图4是描绘根据这里描述的一个或者多个实施例的另一示例多处理器计算机方法的流程图。

具体实施方式

高性能计算平台越来越多地利用具有多处理器能力的系统架构。在系统内使用多个处理器增添明显的计算功率(horsepower)而无尝试使用单处理器系统来构造相似系统的附加成本。如这里所用,术语“处理器”可以包括能够执行一个或者多个指令集或者指令序列的任何计算设备。术语“处理器”因此可以包括中央处理单元(CPU)以及被配置用于执行指令的任何其他处理器。

处理器制造商理解多处理器系统的重要性并且经常提供具有互连路径的处理器。处理器制造商有时禁用互连路径并且以显著折扣提供处理器。购买具有仅安装的单个工厂处理器的具有多处理器能力的系统的用户可以发现在安装的处理器上的互连路径已经被处理器制造商禁用,由此限制用户随后升级系统以利用多处理器系统的增强性能的能力。

用于将计算设备划分成独立计算子系统的能力向其计算需要随时间演变或者是异质的用户提供灵活性并且有时提供财务优点。计算机划分主要是为高端低容量系统保留的昂贵提议。这样的系统的成本反映实现划分而需要的专门化处理器、芯片组和互连的使用。输入/输出(I/O)或者互连解决方案例如一般要求使用重复资源在划分模式中提供独立资源集合。具有使用高容量、低成本、非划分认知部件的能力的系统将大大地减少具有划分能力的系统的成本。

多处理器系统可以具有经常在单处理器系统上不可用的独特能力,诸如硬盘驱动器可扩展性或者高图形卡功率预算。希望这样的能力的用户可以购买多处理器系统,但是利用仅一个处理器配置系统。这样的解决方案从用户的观点来看成本效率低,因为他们将为包括高层计数印刷电路板、第二处理器电压调节、扩展的母板和底盘、附加电源轨等的未使用的多处理器支持能力付费。提供具有可用于在提供附加独立计算机中使用的这些未使用(untapped)能力的系统因此向最终用户提供显著经济性。

提供一种多处理器计算机系统。该多处理器计算机系统可以包括多个通信地耦合的处理器,每个处理器耦合到共同母板并且每个处理器与存储器关联。该系统可以包括可从标准模式和独立模式中的至少一个模式执行的引导代码。多个通信地耦合的处理器可以在标准模式中执行引导代码的一个实例,并且多个通信地耦合的处理器的至少一部分可以在独立模式中执行引导代码的一个实例。

如这里所用,术语“母板”可以指代包含一个或者多个集成电路并且其他板可以耦合到的任何印刷电路板。示例可能包括但不限于包含计算设备中包括的基本电路和扩展端口的主印刷电路板。

也提供一种多处理器计算机方法。该方法可以包括进入独立模式。在独立模式内,该方法可以包括从第一引导代码存储设备取回第一引导代码并且从第二引导代码存储设备取回第二引导代码。该方法可以包括在从耦合到母板的多个处理器选择的第一组处理器上执行第一引导代码而同时在从耦合到母板的多个处理器选择的第二组处理器上执行第二引导代码。

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