[发明专利]一种格雷码编码的并行设计电路无效
申请号: | 201110052367.4 | 申请日: | 2011-03-04 |
公开(公告)号: | CN102655414A | 公开(公告)日: | 2012-09-05 |
发明(设计)人: | 左耀华 | 申请(专利权)人: | 上海华虹集成电路有限责任公司 |
主分类号: | H03M13/15 | 分类号: | H03M13/15 |
代理公司: | 上海东创专利代理事务所(普通合伙) 31245 | 代理人: | 曹立维 |
地址: | 201203 上海*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 格雷码 编码 并行 设计 电路 | ||
【权利要求书】:
1.一种格雷码编码的并行设计电路,其特征在于所述电路由异或运算单元组合构成。
2.如权利要求1所述的一种格雷码编码的并行设计电路,其特征在于所述电路的异或运算单元为八个。
3.如权利要求1所述的一种格雷码编码的并行设计电路,其特征在于所述电路输入位宽为八比特。
4.如权利要求1所述的一种格雷码编码的并行设计电路,其特征在于所述八个异或运算单元采样外部输入的八位数据,同时进行异或运算产生运算结果。
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