[发明专利]视频信号处理电路与其方法无效
申请号: | 201110078905.7 | 申请日: | 2011-03-22 |
公开(公告)号: | CN102695046A | 公开(公告)日: | 2012-09-26 |
发明(设计)人: | 林信一 | 申请(专利权)人: | 联咏科技股份有限公司 |
主分类号: | H04N7/24 | 分类号: | H04N7/24;H04N7/26;H04N5/44 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 郭蔚 |
地址: | 中国台湾新竹*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 视频信号 处理 电路 与其 方法 | ||
1.一种视频信号处理电路,包括:
一传输串流译码单元,译码一解调变后模拟射频信号以产生一第一传输串流信号;以及
一传输串流率控制单元,耦接至该传输串流译码单元,根据该第一传输串流信号的位率,决定是否插入一空白封包串流至该第一传输串流信号以产生一第二传输串流信号。
2.根据权利要求1所述的视频信号处理电路,其特征在于,该传输串流率控制单元包括:
一传输串流缓冲单元,用以暂存该第一传输串流信号的一封包信号;
一控制逻辑电路,从该第一传输串流信号的一频率信号与该第一传输串流信号的一数据有效指示信号产生一操作控制信号、一地址信号、一多任务器控制信号、该第二传输串流信号的一频率信号与该第二传输串流信号的一数据有效指示信号;
一空白封包串流产生单元,产生该空白封包串流;以及
一多任务器,耦接至该传输串流缓冲单元、该控制逻辑电路与该空白封包串流产生单元,根据该控制逻辑电路所产生的该多任务器控制信号,以决定将该传输串流缓冲单元所暂存的该第一传输串流信号的该封包信号与该空白封包串流的至少一者传输至该控制逻辑电路;
其中,该传输串流缓冲单元根据该控制逻辑电路所产生的该操作控制信号与该地址信号而进行读/写操作;以及
其中,如果该控制逻辑电路判断暂存于该传输串流缓冲单元内的一可封包数量大于一可用封包门坎值的话,则该控制逻辑电路从该第二传输串流信号的该封包信号由该传输串流缓冲单元所提供,否则,该控制逻辑电路判断该第二传输串流信号的该封包信号由该空白封包串流产生单元所提供。
3.根据权利要求2所述的视频信号处理电路,其特征在于,该控制逻辑电路包括:
一写入控制信号产生单元,耦接至该传输串流译码单元,从该第一传输串流信号的该频率信号的多个取样信号与该第一传输串流信号的该数据有效指示信号来产生一写入控制信号给该传输串流缓冲单元,以控制该传输串流缓冲单元的一写入操作。
4.根据权利要求3所述的视频信号处理电路,其特征在于,该控制逻辑电路更包括:
一写入地址产生单元,耦接至该写入控制信号产生单元,当该写入控制信号出现时,该写入地址产生单元递增一写入地址,该写入地址控制该传输串流缓冲单元的该写入操作,当该写入地址到达一上限值时,该写入地址产生单元重设该写入地址。
5.根据权利要求4所述的视频信号处理电路,其特征在于,该控制逻辑电路更包括:
一读取控制信号产生单元,递增一参数,并根据该参数与一频率比值间的一关系来产生一频率设定信号与一频率重设信号,该读取控制信号产生单元根据该频率重设信号与该多任务器控制信号来产生一读取控制信号以控制该传输串流缓冲单元的一读取操作。
6.根据权利要求5所述的视频信号处理电路,其特征在于,该控制逻辑电路更包括:
一读取地址产生单元,耦接至该读取控制信号产生单元,当该读取控制信号出现时,该读取地址产生单元递增一读取地址,该读取地址控制该传输串流缓冲单元的该读取操作,当该读取地址到达一上限值时,该读取地址产生单元重设该读取地址。
7.根据权利要求6所述的视频信号处理电路,其特征在于,该控制逻辑电路更包括:
一可用封包量指示单元,耦接至该写入控制信号产生单元与该读取控制信号产生单元;
在该传输串流缓冲单元被写入时,该可用封包量指示单元递增一可用封包量指示数量;
在该传输串流缓冲单元被读取时,该可用封包量指示单元递减该可用封包量指示数量。
8.根据权利要求7所述的视频信号处理电路,其特征在于,该控制逻辑电路更包括:
一输出封包产生单元,耦接至该多任务器,当该频率设定频率出现时,该输出封包产生单元从该多任务器的一输出信号产生该第二传输串流信号的该封包信号。
9.根据权利要求8所述的视频信号处理电路,其特征在于,该控制逻辑电路更包括:
一频率产生单元,耦接至该读取控制信号产生单元;
当该频率设定信号出现时,该频率产生单元设定该第二传输串流信号的该频率信号;以及
当该频率重设信号出现时,该频率产生单元重设该第二传输串流信号的该频率信号。
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