[发明专利]采样保持电路及方法有效
申请号: | 201110102036.7 | 申请日: | 2011-04-22 |
公开(公告)号: | CN102291146A | 公开(公告)日: | 2011-12-21 |
发明(设计)人: | 朱国军 | 申请(专利权)人: | 四川和芯微电子股份有限公司 |
主分类号: | H03M1/54 | 分类号: | H03M1/54 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 610041 四川省*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 采样 保持 电路 方法 | ||
1.一种采样保持电路,包括一运算放大器、一分别与所述运算放大器相连的第一级采样保持电路及一第二级采样保持电路,所述运算放大器具有一正输入端、一负输入端、一正输出端及一负输出端,所述采样保持电路具有一第一相位及一第二相位,所述第二级采样保持电路包括一采样电容,其特征在于:在所述第一相位时,所述采样电容连接于所述运算放大器的正输入端与负输出端之间,在所述第二相位时,所述采样电容连接于所述运算放大器的负输入端与正输出端之间。
2.如权利要求1所述的采样保持电路,其特征在于:所述采样保持电路还包括一第一输入端、一第二输入端、一第一输出端及一第二输出端,所述第一级采样保持电路包括一第一开关、一第二开关、一第三开关、一第四开关、一第五开关、一第六开关、一第七开关、一第八开关、一第九开关、一第十开关、一第十一开关、一第十二开关、一共模电压端、一第一电容、一第二电容、一第三电容及一第四电容,所述第二级采样保持电路包括一第十三开关、一第十四开关、一第十五开关、一第十六开关、一第十七开关、一第十八开关、一第十九开关、一第二十开关、一第二十一开关、一第二十二开关、一第二十三开关、一第二十四开关、一第六电容、一第七电容及一第八电容,所述采样电容为一第五电容。
3.如权利要求2所述的采样保持电路,其特征在于:所述第一开关、第二开关、第五开关、第六开关、第十一开关、第十二开关、第十五开关、第十六开关、第十九开关、第二十开关、第二十一开关及第二十二开关由所述第一相位控制,所述第三开关、第四开关、第七开关、第八开关、第九开关、第十开关、第十三开关、第十四开关、第十七开关、第十八开关、第二十三开关及第二十四开关由所述第二相位控制。
4.如权利要求3所述的采样保持电路,其特征在于:所述第一输入端与所述第一开关的一端相连,所述第一开关的另一端与所述第一电容的一端及所述第三开关的一端相连,所述第一电容的另一端与所述第五开关的一端相连,并通过一第一电压端与所述第七开关的一端相连,所述第七开关的另一端与所述运算放大器的正输入端相连,所述第二输入端与所述第二开关的一端相连,所述第二开关的另一端与所述第二电容的一端及所述第四开关的一端相连,所述第二电容的另一端与所述第六开关的一端相连,并通过一第二电压端与所述第八开关的一端相连,所述第八开关的另一端与所述运算放大器的负输入端相连,所述第三开关的另一端、所述第四开关的另一端、所述第五开关的另一端及所述第六开关的另一端与所述共模电压端相连。
5.如权利要求4所述的采样保持电路,其特征在于:所述第三电容的一端与所述第一电压端相连,另一端通过一第三电压端与所述第九开关的一端、所述第十一开关的一端及所述第十三开关的一端相连,所述第九开关的另一端与所述运算放大器的负输出端相连,所述第四电容的一端与所述第二电压端相连,另一端通过一第四电压端与所述第十开关的一端、所述第十二开关的一端及所述第十四开关的一端相连,所述第十开关的另一端与所述运算放大器的正输出端相连,所述第十一开关的另一端及所述第十二开关的另一端与所述共模电压端相连。
6.如权利要求5所述的采样保持电路,其特征在于:所述第五电容的一端与所述第十三开关的另一端及所述第十五开关的一端相连,另一端与所述第十七开关的一端相连,并通过一第五电压端与所述第十九开关的一端相连,所述第十九开关的另一端与所述运算放大器的负输入端相连,所述第六电容的一端与所述第十四开关的另一端及所述第十六开关的一端相连,另一端与所述第十八开关的一端相连,并通过一第六电压端与所述第二十开关的一端相连,所述第二十开关的另一端与所述运算放大器的正输入端相连,所述第十五开关的另一端、所述第十六开关的另一端、所述第十七开关的另一端及所述第十八开关的另一端与所述共模电压端相连。
7.如权利要求6所述的采样保持电路,其特征在于:所述第七电容的一端与所述第五电压端相连,另一端与所述第二十一开关的一端、所述第二十三开关的一端及所述第一输出端相连,所述第二十一开关的另一端与所述运算放大器的正输出端相连,所述第八电容的一端与所述第六电压端相连,另一端与所述第二十二开关的一端、所述第二十四开关的一端及所述第二输出端相连,所述第二十二开关的另一端与所述运算放大器的负输出端相连,所述第二十三开关及所述第二十四开关的另一端与所述共模电压端相连。
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