[发明专利]一种SOI场效应晶体管的TCAD仿真校准方法无效
申请号: | 201110112178.1 | 申请日: | 2011-05-03 |
公开(公告)号: | CN102184879A | 公开(公告)日: | 2011-09-14 |
发明(设计)人: | 柴展;陈静;罗杰馨;伍青青;王曦 | 申请(专利权)人: | 中国科学院上海微系统与信息技术研究所 |
主分类号: | H01L21/66 | 分类号: | H01L21/66;G06F17/50 |
代理公司: | 上海光华专利事务所 31219 | 代理人: | 李仪萍 |
地址: | 200050 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 soi 场效应 晶体管 tcad 仿真 校准 方法 | ||
1.一种SOI场效应晶体管的TCAD仿真校准方法,其特征在于,包括以下步骤:
1)根据SOI CMOS实际工艺流程和具体工艺参数、版图尺寸信息,建立TCAD工艺仿真程序,由该工艺仿真程序,运行得到不同沟道长度Lgate的工艺仿真MOS器件结构;
2)按照步骤1)中的SOI CMOS实际工艺流程和具体工艺参数,利用与所述版图尺寸信息匹配的版图进行实际流片,制作得到不同沟道长度Lgate的MOS器件;
3)利用实际流片得到的MOS器件进行栅区侧壁隔离结构处的透射电镜测试,得到MOS器件中栅区侧壁隔离结构的实际形貌,并以此校准工艺仿真MOS器件结构的栅区侧壁隔离结构形貌;
4)利用实际流片得到的MOS器件进行栅区下方阱区杂质的二次离子质谱仪测试,得到阱区杂质分布曲线,并以此校准工艺仿真MOS器件结构中的阱区杂质分布;
5)利用实际流片得到的MOS器件进行电学CV测试,由电学CV测试结果得到栅氧化层厚度拟合值,并以此校准工艺仿真MOS器件结构中栅氧化层厚度Tox值;
6)利用实际流片得到的MOS器件进行晶片接受度测试绘制出阈值电压Vt随沟道长度Lgate减小的变化曲线图,并以此校准工艺仿真MOS器件结构中的源/漏轻掺杂延伸区杂质横向扩散分布,使得到的工艺仿真MOS器件结构的阈值电压Vt随沟道长度Lgate减小的变化曲线图与晶片接受度测试绘制出的阈值电压Vt随沟道长度Lgate减小的变化曲线图基本拟合;
7)利用实际流片得到的MOS器件进行方块电阻测试,得到源/漏区的方块电阻,并以此校准工艺仿真MOS器件结构中的源/漏区杂质分布,使得到的工艺仿真MOS器件结构中源/漏区的方块电阻与实测的源/漏区方块电阻基本拟合;
8)在经步骤3)-7)校准后的工艺仿真MOS器件结构的基础上,进行器件电学性能仿真,运行得到不同沟道长度Lgate的各MOS器件的关键电学参数的仿真结果,从而完成SOI场效应晶体管关键电学参数的TCAD仿真校准。
2.根据权利要求1所述一种SOI场效应晶体管的TCAD仿真校准方法,其特征在于:步骤4)通过调整工艺仿真程序中的阱区杂质注入模型及扩散模型,使得到的工艺仿真MOS器件结构的阱区杂质分布与SIMS实测的杂质分布曲线基本拟合。
3.根据权利要求1所述一种SOI场效应晶体管的TCAD仿真校准方法,其特征在于:步骤6)通过调整工艺仿真程序中的源/漏轻掺杂延伸区杂质注入模型及扩散模型,并对得到的工艺仿真MOS器件结构进行器件电学性能仿真,使得到的工艺仿真MOS器件结构的阈值电压Vt随沟道长度Lgate减小的变化曲线图与晶片接受度测试绘制出的阈值电压Vt随沟道长度Lgate减小的变化曲线图基本拟合。
4.根据权利要求1所述一种SOI场效应晶体管的TCAD仿真校准方法,其特征在于:步骤7)通过调整工艺仿真程序中的源/漏区杂质注入模型及扩散模型,使得到的工艺仿真MOS器件结构的方块电阻与实测的方块电阻基本拟合。
5.根据权利要求1所述一种SOI场效应晶体管的TCAD仿真校准方法,其特征在于:步骤8)在经步骤3)-7)校准后的工艺仿真MOS器件结构的基础上,再根据实际电参数测试条件和相关器件物理模型,建立器件仿真程序,进行器件电学性能仿真,运行得到不同沟道长度Lgate的各MOS器件的关键电学参数的仿真结果。
6.根据权利要求1所述一种SOI场效应晶体管的TCAD仿真校准方法,其特征在于:步骤8)中的关键电学参数包括阈值电压Vt和饱和电流Idsat。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造