[发明专利]运算装置、高速缓存装置及其控制方法有效

专利信息
申请号: 201110145879.5 申请日: 2011-06-01
公开(公告)号: CN102331922A 公开(公告)日: 2012-01-25
发明(设计)人: 伊藤忠幸 申请(专利权)人: 佳能株式会社
主分类号: G06F9/38 分类号: G06F9/38;G06F12/08
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 罗银燕
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 运算 装置 高速缓存 及其 控制 方法
【权利要求书】:

1.一种运算装置,包括:

多个第一保持单元,所述多个第一保持单元中的每一个包含串行连接的多个第一节点,并且将保持在各第一节点中的第一数据移动到位于第一方向上的相邻节点;

多个第二保持单元,所述多个第二保持单元中的每一个包含串行连接的多个第二节点,并且将保持在各第二节点中的第二数据移动到位于第二方向上的相邻节点,其中,各第一节点与所述多个第二节点中的至少一个对应;

运算单元,所述运算单元对于作为第一保持单元的所述多个第一节点之一的关注节点,使用保持在关注节点中的第一数据和保持在关注节点所对应的所述多个第二节点中的至少一个中的第二数据来执行运算;以及

输入单元,所述输入单元将第一数据并行输入到所述多个第一保持单元之中的至少两个,并且将第二数据串行输入到所述多个第二保持单元之中的至少两个。

2.根据权利要求1的运算装置,还包括:

获取单元,所述获取单元从外部装置获取第一数据和第二数据;

第一输入单元,所述第一输入单元复制获取的第一数据,并且将复制的第一数据输入到所述多个第一保持单元中的每一个;以及

第二输入单元,所述第二输入单元将获取的第二数据输入到所述多个第二保持单元之一。

3.根据权利要求1的运算装置,还包括:

多个运算电路,所述多个运算电路中的每一个包含一个第一保持单元和一个第二保持单元,

其中,所述多个运算电路被分组成多个组,以及

输入单元对于各组将第二数据输入到组中的一个运算电路的第二保持单元,并且第二保持单元对于各组被串行连接。

4.根据权利要求3的运算装置,还包括:

动态改变所述组的单元。

5.一种确定装置,包括根据权利要求1的运算装置,其中:

各第一保持单元是第一流水线,所述第一流水线包含多个第一节点,并且将保持在一个第一节点中的第一数据移动到相对于所述一个第一节点位于第一方向上的另一第一节点;

各第二保持单元是第二流水线,所述第二流水线包含多个第二节点,并且将保持在一个第二节点中的第二数据移动到相对于所述一个第二节点位于与第一方向相反的第二方向上的另一第二节点;以及

运算单元是比较单元,所述比较单元对于作为第一流水线的所述多个第一节点之一的关注节点,比较保持在关注节点中的第一数据是否与保持在关注节点所对应的所述多个第二节点中的至少一个中的第二数据匹配。

6.一种高速缓存装置,所述高速缓存装置包括多个数据处理装置,所述多个数据处理装置中的每一个包括:

第一流水线,所述第一流水线包含多个第一节点,并且将保持在一个第一节点中的地址移动到相对于所述一个第一节点位于第一方向上的另一第一节点;

第二流水线,所述第二流水线包含多个第二节点,并且将保持在一个第二节点中的高速缓存标记移动到相对于所述一个第二节点位于与第一方向相反的第二方向上的另一第二节点,其中,各第一节点与所述多个第二节点中的至少一个对应;以及

比较单元,所述比较单元对于作为第一流水线的所述多个第一节点之一的关注节点,比较保持在关注节点中的地址与保持在关注节点所对应的第二节点中的至少一个中的高速缓存标记,以确定地址是否与高速缓存标记匹配;所述高速缓存装置还包括:

高速缓存存储器,所述高速缓存存储器对存储在外部存储器件中的数据中的一些进行存储;

获取单元,所述获取单元从处理装置获取数据的请求;

第一输入单元,所述第一输入单元复制获取的数据的地址,并且将复制的地址输入到所述多个数据处理装置的第一流水线;

第二输入单元,所述第二输入单元将存储于高速缓存存储器中的数据的高速缓存标记输入到所述多个数据处理装置之一的第二流水线;以及

确定单元,所述确定单元当确定比较单元的比较结果指示匹配时,确定获取的数据的高速缓存命中,

其中,所述多个数据处理装置的第二流水线被串行连接。

7.根据权利要求6的高速缓存装置,其中,所述多个数据处理装置被分组成多个组,

第二输入单元对于各组将高速缓存标记输入到组中的一个数据处理装置的第二流水线,以及

所述多个数据处理装置的第二流水线对于各组被串行连接。

8.根据权利要求7的高速缓存装置,还包括动态改变所述组的单元。

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